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數(shù)控仿真

  • 仿真器原理圖.rar

    TI的dsp仿真器xd510的自制原理圖,經測試完全可以使用。使用芯片cy7c68013a,sn74act8990,emp7032,244.

    標簽: 仿真器 原理圖

    上傳時間: 2013-04-24

    上傳用戶:魚魚魚yu

  • 基于Howland電流泵的圧控電流源設計

    常規的壓控電源采用的是并聯電流負反饋電路,這種電路輸出電壓柔性較差,電壓輸出效率低,因為取樣電阻要占掉很大一部分的電壓,并且常規的壓控電流源不能實現一端接地,這也是并聯電流負反饋本身的

    標簽: Howland 電流泵 電流源設計

    上傳時間: 2013-07-02

    上傳用戶:yyyyyyyyyy

  • 基于MCS 51單片機的PLC仿真器

    可編程控制器PLC以抗擾性強、可靠性高和編程靈活等特點在工業上得到廣泛應用,為了優化PLC系統設計,介紹一種基于MCS.51單片機的PLC仿真器,并給出了硬、軟件設計與實現方法。編程設計主要包括監控主

    標簽: MCS PLC 51單片機 仿真器

    上傳時間: 2013-07-07

    上傳用戶:yzhl1988

  • AM超外差接收機的仿真

    AM超外差接收機的仿真:1.熟悉System View仿真軟件的使用方法。2.掌握AM超外差收音機的工作原理,學習用System View元件庫構建一個基本的AM超外差收音機系統。3.

    標簽: 超外差接收機 仿真

    上傳時間: 2013-07-27

    上傳用戶:dong

  • MSP430仿真器幾套制作資料

    MSP430USB仿真器制作資料+430JTAG簡版仿真器+利爾達- 輕松制作MSP430 JTAG Adapter+制作的單面板的MSP430JTAG仿真器 幾套430JTAG制作方案,做不好你找我........

    標簽: MSP 430 仿真器 制作資料

    上傳時間: 2013-07-26

    上傳用戶:liaofamous

  • 應用EDA 技術仿真電子線路分析

    應用EDA 技術仿真電子線路分析 摘 要 介紹了電子電路仿真軟件Elect ronicsWo rkbench 在EDA 中的應用, 給出了仿真實

    標簽: EDA 仿真 電子線路

    上傳時間: 2013-07-27

    上傳用戶:變形金剛

  • 多功能EDA仿真/教學實驗系統

    多功能EDA仿真/教學實驗系統產品簡介北京普立華電子科技有限公司研發部提供核心模塊-單片機系統核心模塊-CPLD核心模塊-FP

    標簽: EDA 多功能 仿真 教學實驗系統

    上傳時間: 2013-05-26

    上傳用戶:rocwangdp

  • 點陣LCD的驅動顯控原理

    點陣LCD的驅動顯控原理,lcd方面的使用已經實例。

    標簽: LCD 點陣 驅動

    上傳時間: 2013-05-26

    上傳用戶:jing911003

  • 地面數字電視融合方案發端的FPGA設計與仿真

    本項目完成的是中國地面數字電視融合方案發端系統的FPGA設計與實現。采用Stratix系列的EP1S80F1020C5FPGA為基礎構建了主硬件處理平臺。系統中能量擴散、LDPC編碼、符號交織、星座映射、同步PN頭插入、3780點IFFTOFDM調制以及信號成形4倍插值滾降濾波器等都是基于FPGA硬件設計實現的。本文首先介紹了數字電視的發展現狀,融合方案發端系統的整體結構以及FPGA設計的相關知識。第三章重點、詳細地介紹了基于FPGA的融合方案發端系統除LDPC編碼部分的各個模塊的具體實現,并對級連后的整個系統的性能進行了仿真、分析和驗證。第四章簡要介紹了與融合方案發端系統結構類似的一個窄帶LDPC解碼-誤碼測試實驗平臺發端的FPGA設計,并對該測試平臺的性能進行了分析驗證。我在項目中完成的工作主要有: 1.閱讀相關文獻資料,了解中國地面數字電視融合方案的整體結構和原理。 2.制定了整個發端系統FPGA實現的框架以及各模塊的接口定義。 3.完成了3780點IFFTOFDM的FPGA設計和驗證。 4.完成了4倍插值169階滾降濾波器的算法改進和FPGA設計與驗證。 5.完成了整個融合方案系統的功能仿真、分析和驗證。 6.完成了窄帶LDPC解碼-誤碼測試實驗平臺發端的FPGA設計以及仿真、驗證。

    標簽: FPGA 地面數字電視 仿真 方案

    上傳時間: 2013-07-05

    上傳用戶:qq521

  • 基于FPGA/CPLD實現的FFT算法與仿真分析

    可編程邏輯器件FPGA(現場可編程門陣列)和CPLD(復雜可編程邏輯器件)越來越多的應用于數字信號處理領域,與傳統的ASIC(專用集成電路)和DSP(數字信號處理器)相比,基于FPGA和CPLD實現的數字信號處理系統具有更高的實時性和可嵌入性,能夠方便地實現系統的集成與功能擴展。 FFT的硬件結構主要包括蝶形處理器、存儲單元、地址生成單元與控制單元。本文提出的算法在蝶形處理器內引入流水線結構,提高了FFT的運算速度。同時,流水線寄存器能夠寄存蝶形運算中的公共項,這樣在設計蝶形處理器時只用到了一個乘法器和兩個加法器,降低了硬件電路的復雜度。 為了進一步提高FFT的運算速度,本文在深入研究各種乘法器算法的基礎上,為蝶形處理器設計了一個并行乘法器。在實現該乘法器時,本文采用改進的布斯算法,用以減少部分積的個數。同時,使用華萊士樹結構和4-2壓縮器對部分積并行相加。 本文以32點復數FFT為例進行設計與邏輯綜合。通過設計相應的存儲單元,地址生成單元和控制單元完成FFT電路。電路的仿真結果與軟件計算結果相符,證明了本文所提出的算法的正確性。 另外,本文還對設計結果提出了進一步的改進方案,在乘法器內加入一級流水線寄存器,使FFT的速度能夠提高到當前速度的兩倍,這在實時性要求較高的場合具有極高的實用價值。

    標簽: FPGA CPLD FFT 算法

    上傳時間: 2013-07-18

    上傳用戶:wpt

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