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時序邏輯電路

  • 中頻驗波是對信號進行中頻直接采樣和數字正交處理后,產生的I 支路和Q 支路信號序列在時間上會錯開一個采樣間隔,需要進行定序處理,恢復成同步輸出的I、Q 兩路信號序列。現代雷達普遍采用相參信號處理,而如

    中頻驗波是對信號進行中頻直接采樣和數字正交處理后,產生的I 支路和Q 支路信號序列在時間上會錯開一個采樣間隔,需要進行定序處理,恢復成同步輸出的I、Q 兩路信號序列。現代雷達普遍采用相參信號處理,而如何獲得高精度基帶數字正交( I , Q) 信號是整個系統信號處理成敗的關鍵,以前通常的做法是采用模擬相位檢波器得到I、Q信號,其正交性能一般為:幅度平衡在2 % 左右, 相位正交誤差在2°左右,即幅相誤差引入的鏡像功率在- 34dB 左右。這限制了信號處理器性能的提高, 為此, 近年來提出了對低中頻直接采樣恢復I、Q 信號的數字相位檢波器。隨著高位、高速A/ D 的研制成功和普遍應用,使得數字相位檢波方法的實現成為可能。

    標簽: 信號 中頻 支路 序列

    上傳時間: 2016-12-27

    上傳用戶:kr770906

  • 透過電腦觀察紅外線和無線波形,有線路圖,自己做

    透過電腦觀察紅外線和無線波形,有線路圖,自己做

    標簽: 波形

    上傳時間: 2014-01-13

    上傳用戶:lvzhr

  • 三軸伺服馬達控制程式利用軟體DDA方式讀回目前位置然後以取樣時間計算出下一點位置取誤差後利用DA將命令電壓送出做三軸控制

    三軸伺服馬達控制程式利用軟體DDA方式讀回目前位置然後以取樣時間計算出下一點位置取誤差後利用DA將命令電壓送出做三軸控制

    標簽: DDA 控制 伺服 命令

    上傳時間: 2017-04-02

    上傳用戶:firstbyte

  • S3C6410 線路設計時一定要參考的文件,尤其是DDR Layout guide一定要看.以免開發出的板子不能動.

    S3C6410 線路設計時一定要參考的文件,尤其是DDR Layout guide一定要看.以免開發出的板子不能動.

    標簽: S3C6410 Layout guide DDR

    上傳時間: 2017-05-01

    上傳用戶:lacsx

  • Computer Networks 4th Ed 學習電腦網路的實用原文書

    Computer Networks 4th Ed 學習電腦網路的實用原文書

    標簽: Computer Networks 4th Ed

    上傳時間: 2013-12-18

    上傳用戶:磊子226

  • 電子時鐘 電子時鐘 電子時鐘 電子時鐘

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    標簽:

    上傳時間: 2013-12-21

    上傳用戶:CSUSheep

  • 龍族全部地圖端口(地圖全開的Mapserver),path的路徑請按照自己電腦上的路徑設置

    龍族全部地圖端口(地圖全開的Mapserver),path的路徑請按照自己電腦上的路徑設置

    標簽: Mapserver path 端口

    上傳時間: 2017-08-02

    上傳用戶:han_zh

  • 四路頻率為70MHz的四相序正弦載波(相位分別為0°90°180°270°)的設計

    四路頻率為70MHz的四相序正弦載波(相位分別為0°、90°、180°、270°)的設計.

    標簽: 正弦載波

    上傳時間: 2022-04-26

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  • 直序擴頻軟件無線電發射機研究

    軟件無線電是無線通信領域繼固定到移動、模擬到數字之后的第三次革命,是目前乃至未來的無線電領域的技術發展方向,它在提高系統靈活性上有無可比擬的優勢,是實現未來無線通信系統的有效手段。擴頻通信具有卓越的抗干擾和保密性能。擴頻通信相對于傳統的窄帶通信,在頻譜利用率上也有明顯的優勢,是未來無線通信系統中的關鍵技術,直接序列擴頻則是其中在民用領域使用最多的一種擴頻技術。FPGA在分布式計算、并行處理、流水線結構上有獨特的優勢,自然成為設計擴頻軟件無線電系統的首選技術之一。 首先介紹了軟件無線電的理論基礎,并分析了它的硬件結構和技術關鍵。軟件無線電的關鍵思路在于構建一個通用的強大的硬件平臺,這也正是本課題的主要工作之一。而后,重點介紹了直序擴頻的理論基礎。對于發射機,其中最關鍵的是尋找一種相關特性卓越的偽隨機序列,本課題主要對m序列、OVSF碼和Gold碼進行了深入研究。最后,詳述了基于DDFS的數字調制技術和FPGA技術。 基于以上理論基礎研究,根據軟件無線電硬件結構,開發了基于Altera公司Cyclone系列FPGA的硬件平臺。該平臺具有210Mbps的高速DAC,并配有串口、USB接口、音頻CODEC輸入輸出通道、以及LVDS擴展口和SDRAM,考慮到通用性,設計中加入了足以開發出接收機的兩路40Mbps的高速ADC。FPGA的代碼開發也是核心內容,本課題編寫了大量相應的代碼,包括加擴模塊(含偽隨機序列發生器)、基于DDFS的數字調制模塊以及串口通信模塊、LCD驅動模塊,SDRAM Controller、ADC驅動模塊,并編寫了相應的測試代碼。整個系統測試通過。關于硬件平臺設計和代碼開發,在本文第三章和第四章詳細介紹。 總體說來,本課題基于現有的理論發展,在充分理解相關理論的前提下,將主要經歷集中于具體應用的研究與開發,并取得了一定的成果。

    標簽: 直序擴頻 發射機 軟件無線電

    上傳時間: 2013-06-27

    上傳用戶:xauthu

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

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