<button id="mu0eo"></button> 主要是模擬8051電路板上LED顯示器.透過vb程式.經由RS232去傳送信號到電路板上.模擬出與VB介面顯示地動作相同
上傳時間： 2017-04-05
上傳用戶：jkhjkh1982
智能微粒群為最小二乘支持向量機調參的示例程序（LSSVM+PSO）
上傳時間： 2017-05-07
上傳用戶：一諾88
智能天線算法中的非盲算法中的最小二乘法算法，運行后直接出來結果
上傳時間： 2017-09-06
上傳用戶：nairui21
智能天線算發中的最小均方誤差算法，運行后可以直接出結果
上傳時間： 2013-11-25
上傳用戶：王小奇
教你如何做打蚊子的互動小遊戲 這非常有趣喔 試試看
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上傳時間： 2017-09-25
上傳用戶：CHENKAI
飛思卡爾智能小車模數程序 用于智能小車的設計與研發供廣大愛好者參考
上傳時間： 2013-12-16
上傳用戶：whenfly
實用電子技術專輯 385冊 3.609G新型智慧驅動器可簡化開關電源隔離拓樸結構中同步整流器.pdf
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上傳時間： 2014-05-05
上傳用戶：時代將軍
小鼎炒幣機器人智能交易機器人，全球第一款一鍵啟動，多種策略結合，人工智能，超高盈利。這一簡單易用的數字資產智能交易系統為幣圈投資者提供了簡單穩健的投資策略。廢話不多說，下面來介紹 小鼎炒幣機器人軟件是如何幫你賺取比特幣的。一 告別盯盤 機器人在云服務器24小時工作 不斷電不斷網。設置參數后，自動按照策略進行。達到設定條件就自動買入或者賣出。二 機器人內置多種交易策略，從保守到激進 滿足你不同的情緒要求。沖動 恐懼 貪婪 對交易者不好 容易梭哈上頭 自己的執行力比不上機器人。三 同時監控多個交易品種，也許你們都知道 一流的交易員都是好幾臺電腦時刻盯盤可一般人也不是專業交易員 所以這樣的事情只能交給機器人干。滿足條件可以自動觸發。自動買入 這是人為比不上 速度可以精確到毫秒級。四 一鍵設置策略 一鍵啟動 簡單點說 你賬戶里有usdt 或者是btc 以太坊計價幣選好你要交易的幣 就自動幫你操作。五 小鼎炒幣機器人團隊10年以上交易經驗 自動分配倉位 倍投交易數學模型 防瀑布機制，瀑布來了，你從登入到賣出，需要多久？5秒有了吧。可瀑布來了，2秒都來不及，但是小鼎炒幣機器人軟件是毫秒級的，可以瞬間幫你止損。六 目前只支持主流平臺 幣安 火幣 zb ok
上傳時間： 2022-06-22
上傳用戶：zhaiyawei
基于STC89C52單片機，LCD1602，DS1302開發的智能小時鐘設計，仿真源碼+原理圖
標簽： stc89c52 單片機 lcd1602 ds1302 智能時鐘
上傳時間： 2022-07-23
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人臉自動識別技術是模式識別、圖像處理等學科的一個最熱門研究課題之一。隨著社會的發展,各方面對快速有效的自動身份驗證的要求日益迫切，而人臉識別技術作為各種生物識別技術中最重要的方法之一，已經越來越多的受到重視。對于具有實時，快捷，低誤識率的高性能算法以及對算法硬件加速的研究也逐漸展開。 本文詳細分析了智能人臉識別算法原理，發展概況和前景，包括人臉檢測算法，人眼定位算法，預處理算法，PCA和ICA 算法，詳細分析了項目情況，系統劃分，軟硬件平臺的資源和使用。并在ISE軟件平臺上，用硬件描述語言(verilog HDL)對算法部分嚴格按照FPGA代碼風格進行了RTL 硬件建模，并對C++算法進行了優化處理，通過仿真與軟件算法結果進行比對，評估誤差，最后在VirtexII Pro FPGA 上進行了綜合實現。 主要研究內容如下： 首先，對硬件平臺xilinx的VirtexII Pro FPGA 上的系統資源進行了描述和研究，對存儲器sdram,RS-232 串口，JTAG 進行了研究和調試，對Coreconnect的OPB總線仲裁機理進行了兩種算法的比較，RTL 設計，仿真和綜合。利用ISE和VC++軟件平臺，對verilog和C++算法進行同步比較測試，使每步算法對應正確的結果。對軟硬件平臺的合理使用使得在項目中能盡可能多的充分利用硬件資源，制板時正確選型，以及加快設計和調試進度。其次，對人臉識別算法流程中的人臉檢測，人眼定位，預處理，識別算法分別進行了比較研究，選取其中各自性能最好的一種算法對其原理進行了分析討論。人臉檢測采用adaboost 算法，因其速度和精度的綜合性能表現優異。人眼定位采用小塊合并算法，因為它具有快速，準確，弱時實的特點。預處理算法采用直方圖均衡加平滑的算法，簡單，高效。 識別算法采用PCA 加ICA 算法，它能最大的弱化姿態和光照對人臉識別的影響。 最后，使用Verilog HDL 硬件描述語言進行算法的RTL 建模，在C++算法的基礎上，保證原來效果的前提下，根據FPGA 硬件特點對算法進行了優化。視頻輸入輸出是人臉識別的前提，它提供FPGA 上算法需要處理的數據，預處理算法在C++算法的基礎上進行了優化，最大的減少了運算量，提高了運算速度，16 位計算器模塊使得在算法實現時可以根據系統要求，在FPGA的ip 核和自己設計的模塊之間選擇性能更好的一個來調用，FIFO的設計提供同步和異步時鐘域的數據緩存。設計在ISE和VC++軟件平臺同時進行，隨時對verilog和C++數據進行監測和比對。全部設計模塊通過仿真，達到預定的性能要求，并在FPGA 上綜合實現。
上傳時間： 2013-07-13
上傳用戶：李夢晗
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