軟件無線電(Software Radio)具有高度靈活性、開放性，很容易實現與現有和未來多種電臺的兼容，能最大限度的滿足了互聯互通的要求。而基于多相濾波器組的信道化軟件無線電接收技術以其固有的全概率接收、降采樣速率以及其大幅提高運算速率的能力越來越受到重視。本文主要研究了基于現場可編程門陣列(FPGA)的軟件無線電信道化中頻接收技術設計與實現。 首先介紹了軟件無線電的基本概念以及其發展狀況，深入討論了軟件無線電的基本理論，主要介紹了設計中所用到的帶通采樣技術、信號的抽取技術與多相濾波技術。 然后簡要介紹了信道化中頻接收機的射頻(Radio Frequency，RF)前端接收技術，設置寬中頻超外差接收機射頻前端的設計指標，給出了改進的實信號濾波器組低通型實現結構，并依此推導和建立了實信號多相濾波器組信道化中頻接收機的數學模型。 最后基于EP1S80開發平臺實現了實信號多相濾波器組信道化的中頻接收機。給出了多相濾波器、抽取運算、FFT運算、信道劃分以及復乘運算的設計方案。仿真結果表明，該接收機能夠實現對中頻信號的正確接收，驗證了系統設計的可行性。
上傳時間： 2013-05-24
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DC/DC變換器的并聯技術是提高DC/DC變換器功率等級的有效途徑，而如何實現并聯模塊間輸出電流的平均分配是實現并聯的核心技術.目前的并聯均流技術多是在并聯模塊參數差異不大的情況下實現的，對于并聯系統在并聯模塊參數差異較大的極限情況下的穩態和暫態性能則很少涉及.該文著重對并聯系統在參數差異很大的條件下的工作情況進行了研究.首先利用基于狀態空間平均法的小信號分析對最大均流法的均流原理進行了分析，并對并聯系統的穩定性進行了討論.之后針對已有的均流方案的局限性提出了一種新的具有限流功能的三環控制均流策略.為了驗證所提出的方案的可行性，建立了MATLAB仿真平臺，利用模塊化仿真的思想進行了系統仿真，初步驗證了方案的合理性.最后搭建了實際的DC/DC并聯系統試驗平臺，對采用該方案的并聯系統的穩態和暫態性能進行了全面的考察，得到了令人滿意的結果，證明了具有限流功能的三環控制均流策略是切實可行的.
上傳時間： 2013-04-24
上傳用戶：lzm033
軟件無線電(Software Radio)具有高度靈活性、開放性，很容易實現與現有和未來多種電臺的兼容，能最大限度的滿足了互聯互通的要求。而基于多相濾波器組的信道化軟件無線電接收技術以其固有的全概率接收、降采樣速率以及其大幅提高運算速率的能力越來越受到重視。本文主要研究了基于現場可編程門陣列(FPGA)的軟件無線電信道化中頻接收技術設計與實現。 首先介紹了軟件無線電的基本概念以及其發展狀況，深入討論了軟件無線電的基本理論，主要介紹了設計中所用到的帶通采樣技術、信號的抽取技術與多相濾波技術。 然后簡要介紹了信道化中頻接收機的射頻(Radio Frequency，RF)前端接收技術，設置寬中頻超外差接收機射頻前端的設計指標，給出了改進的實信號濾波器組低通型實現結構，并依此推導和建立了實信號多相濾波器組信道化中頻接收機的數學模型。 最后基于EP1S80開發平臺實現了實信號多相濾波器組信道化的中頻接收機。給出了多相濾波器、抽取運算、FFT運算、信道劃分以及復乘運算的設計方案。仿真結果表明，該接收機能夠實現對中頻信號的正確接收，驗證了系統設計的可行性。
上傳時間： 2013-06-12
上傳用戶：qq521
為了提高Forward變換器非線性系統的控制性能，采用了精確線性化控制方法。首先采用開關函數和開關周期平均算子建立適合微分幾何方法的仿射非線性系統模型。從理論上證明了該模型滿足系統精確線性化的條件。對非線性坐標變換后得到的線性系統，利用二次型最優控制策略推導出非線性狀態反饋控制律。實驗結果表明，系統具有良好的靜態和動態性能，驗證了該控制方法的有效性和正確性。
上傳時間： 2013-11-10
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上傳時間： 2013-10-10
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上傳時間： 2013-12-13
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這時最簡單的一個程序，運行后，三個LED在閃，因為程序沒有初始化串口，所以運行后超級終端沒有反應
標簽： 程序
上傳時間： 2015-03-28
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適用于S3C2410的最簡ADS1.2工程！ 工程中僅包括一個匯編代碼，生成的bin文件僅87字節。可以完成初始化并點亮一個LED燈，您可以這個工程為基礎開始2410開發板的熟悉過程。
上傳時間： 2015-05-16
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雖然Windows下可視化開發工具如VC、Delphi、C＋＋ Builder等都有專用的定時器控件Timer，而且使用很方便，可以實現一定的定時功能，但最小計時精度僅為55ms，且定時器消息在多任務操作系統中的優先級很低，不能得到及時響應，往往不能滿足實時控制環境下的應用。不過Microsoft公司在Win32 API函數庫中已經為用戶提供了一組用于高精度計時的底層函數，如果用戶使用得當，計時精度可到1ms。這個計時精度、對于一般的實時系統控制完全可以滿足要求。現將由C＋＋ Builder 4.0提供的重新封裝后的一組與時間相關的主要接口函數（函數名、參數、功能與Win32 API基本相同）說明如下：
標簽： Windows Builder Delphi Timer
上傳時間： 2013-12-21
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嵌入式系統中閃存設備IO軟件的設計與實現 閃存作為最常用的嵌入式存儲設備，其管理和訪問技術對整個系統的性能有著較大的影響。目前嵌入式系統中廣泛采用的閃存管理軟件在可移植性、靈活性方面都存在不足。因此本文在分析了這些管理軟件現存問題的基礎上提出了一種比較合理的閃存I/O軟件分層結構，并通過對軟件的模塊化設計與實現證明了該分層結構在移植性、通用性方面的優勢。
上傳時間： 2015-09-05
上傳用戶：杜瑩12345
