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  • 高速永磁無刷直流電機轉子渦流損耗的研究.rar

    高速電機由于轉速高、體積小、功率密度高,在渦輪發電機、渦輪增壓器、高速加工中心、飛輪儲能、電動工具、空氣壓縮機、分子泵等許多領域得到了廣泛的應用。永磁無刷直流電機由于效率高、氣隙大、轉子結構簡單,因此特別適合高速運行。高速永磁無刷直流電機是目前國內外研究的熱點,其主要問題在于:(1)轉子機械強度和轉子動力學;(2)轉子損耗和溫升。本文針對高速永磁無刷直流電機主要問題之一的轉子渦流損耗進行了深入分析。轉子渦流損耗是由定子電流的時間和空間諧波以及定子槽開口引起的氣隙磁導變化所產生的。首先通過優化定子結構、槽開口和氣隙長度的大小來降低電流空間諧波和氣隙磁導變化所產生的轉子渦流損耗;通過合理地增加繞組電感以及采用銅屏蔽環的方法來減小電流時間諧波引起的轉子渦流損耗。其次對轉子充磁方式和轉子動力學進行了分析。最后制作了高速永磁無刷直流電機樣機和控制系統,進行了空載和負載實驗研究。論文主要工作包括: 一、采用解析計算和有限元仿真的方法研究了不同的定子結構、槽開口大小、以及氣隙長度對高速永磁無刷直流電機轉子渦流損耗的影響。對于2極3槽集中繞組、2極6槽分布疊繞組和2極6槽集中繞組的三臺電機的定子結構進行了對比,利用傅里葉變換,得到了分布于定子槽開口處的等效電流片的空間諧波分量,然后采用計及轉子集膚深度和渦流磁場影響的解析模型計算了轉子渦流損耗,通過有限元仿真對解析計算結果加以驗證。結果表明:3槽集中繞組結構的電機中含有2次、4次等偶數次空間諧波分量,該諧波分量在轉子中產生大量的渦流損耗。采用有限元仿真的方法研究了槽開口和氣隙長度對轉子渦流損耗的影響,在空載和負載狀態下的研究結果均表明:隨著槽開口的增加或者氣隙長度的減小,轉子損耗隨之增加。因此從減小高速永磁無刷電機轉子渦流損耗的角度考慮,2極6槽的定子結構優于2極3槽結構。 二、高速永磁無刷直流電機額定運行時的電流波形中含有大量的時間諧波分量,其中5次和7次時間諧波分量合成的電樞磁場以6倍轉子角速度相對轉子旋轉,11次和13次時間諧波分量合成的電樞磁場以12倍轉子角速度相對轉子旋轉,這些諧波分量與轉子異步,在轉子保護環、永磁體和轉軸中產生大量的渦流損耗,是轉子渦流損耗的主要部分。首先研究了永磁體分塊對轉子渦流損耗的影響,分析表明:永磁體的分塊數和透入深度有關,對于本文設計的高速永磁無刷直流電機,當永磁體分塊數大于12時,永磁體分塊才能有效地減小永磁體中的渦流損耗;反之,永磁體分塊會使永磁體中的渦流損耗增加。為了提高轉子的機械強度,在永磁體表面通常包裹一層高強度的非磁性材料如鈦合金或者碳素纖維等。分析了不同電導率的包裹材料對轉子渦流損耗的影響。然后利用渦流磁場的屏蔽作用,在轉子保護環和永磁體之間增加一層電導率高的銅環。有限元分析表明:盡管銅環中會產生渦流損耗,但正是由于銅環良好的導電性,其產生的渦流磁場抵消了氣隙磁場的諧波分量,使永磁體、轉軸以及保護環中的損耗顯著下降,整體上降低了轉子渦流損耗。分析了不同的銅環厚度對轉子渦流損耗的影響,研究表明轉子各部分的渦流損耗隨著銅屏蔽環厚度的增加而減小,當銅環的厚度達到6次時間諧波的透入深度時,轉子損耗減小到最小。 三、對于給定的電機尺寸,設計了兩臺電感值不同的高速永磁無刷直流電機,通過研究表明:電感越大,電流變化越平緩,電流的諧波分量越低,轉子渦流損耗越小,因此通過合理地增加繞組電感能有效的降低轉子渦流損耗。 四、研究了高速永磁無刷直流電機的電磁設計和轉子動力學問題。對比分析了平行充磁和徑向充磁對高速永磁無刷直流電機性能的影響,結果表明:平行充磁優于徑向充磁。設計并制作了兩種不同結構的轉子:單端式軸承支撐結構和兩端式軸承支撐結構。對兩種結構進行了轉子動力學分析,實驗研究表明:由于轉子設計不合理,單端式軸承支撐結構的轉子轉速達到40,000rpm以上時,保護環和定子齒部發生了摩擦,破壞了轉子動平衡,導致電機運行失敗,而兩端式軸承支撐結構的轉子成功運行到100,000rpm以上。 五、最后制作了平行充磁的高速永磁無刷直流電機樣機和控制系統,進行了空載和負載實驗研究。對比研究了PWM電流調制和銅屏蔽環對轉子損耗的影響,研究表明:銅屏蔽環能有效的降低轉子渦流損耗,使轉子損耗減小到不加銅屏蔽環時的1/2;斬波控制會引入高頻電流諧波分量,使得轉子渦流損耗增加。通過計算繞組反電勢系數的方法,得到了不同控制方式下帶銅屏蔽環和不帶銅屏蔽環轉子永磁體溫度。采用簡化的暫態溫度場有限元模型分析了轉子溫升,有限元分析和實驗計算結果基本吻合,驗證了銅屏蔽環的有效性。

    標簽: 無刷直流 電機轉子 渦流損耗

    上傳時間: 2013-05-18

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  • 混合動力汽車42V電源系統研究.rar

    汽車從批量生產到現在已經有100多年的歷史,其中,車輛電子化、電動化取得了驚人的進展,伴隨而來的是汽車用電量的迅速增加。專家預計到2010年電氣方面功率會達到10kW,電流將會增加3倍以上,如不增加電流,最有效的方法是盡量提高汽車電源供電電壓。電壓最好能在人體安全電壓范圍(DC60V)以下,42V是一種解決辦法。采用42V電源,可以直接減小導線尺寸和實現輕量化,從而降低成本。 在新的42V電源系統中,采用42V/14V雙電壓方案,對目前的電氣系統沖擊較小,過渡平緩。本文在綜合國內外相關研究的基礎上,對42V/14V雙電壓電氣系統的技術發展以及現狀進行了較系統的研究。主要研究內容如下: 首先,本文分析了汽車電源升壓的原因,介紹了國內外的現狀。研究探討新型42V電源系統對汽車蓄電池的影響,介紹了混合動力車用蓄電池的特點,比較目前混合動力車用幾種蓄電池的方案。因為42V/14V雙電壓共存,存在多種直流電壓變換器,本文分析了DC/DC變換器的結構和原理,設計了高頻斬波型和二重軟開關兩種DC/DC變換器模塊方案。 其次,介紹了混合動力汽車42V一體化啟動發電機系統裝置的特點,敘述其工作原理和系統組成。提出了一種基于永磁同步電機ISG系統的設計方案。在對永磁同步電機理論研究的基礎上,本文完成了對永磁同步電機起動的實驗和調試。通過對實驗樣機做起動實驗,驗證了本文設計的ISG系統及電機的硬件驅動的可行性。 最后,汽車電源系統升壓會產生更高的瞬態高壓和更強的電磁干擾,本文簡要分析了其產生的原因,闡述了基本的抑制方法。 目前汽車電源系統由14V電源向42V電源發展已經是必然的趨勢。作為過渡階段,對42V/14V雙電壓系統的研究將會是汽車界最近時期的一個重要內容。42V汽車電源系統標準的實施,將對汽車電器和電子設備帶來巨大的沖擊,同時也會給整個汽車界帶來新一輪的電氣技術革命。

    標簽: 42V 混合動力汽車 電源

    上傳時間: 2013-07-23

    上傳用戶:wkchong

  • 3kW光伏并網逆變器最大功率點跟蹤控制的研究.rar

    光伏發電是集開發可再生能源、改善生態環境于一體的重大課題,有巨大的經濟、社會效益和學術研究價值。 本文首先介紹了3kW光伏并網逆變器系統的組成和結構。3kW光伏并網逆變器采用兩級式結構,主電路由前級Boost變換器和后級的單相逆變橋組成。控制部分以DSP(DSP56F803)為核心,實現了光伏陣列最大功率點的跟蹤控制,以及產生與電網壓同頻同相的正弦電流,實現并網的功能。本文重點對逆變器系統的最大功率點跟蹤(MPPT)控制進行研究。 針對基于外特性建立的光伏陣列模型雖然簡單、參數易解,但精度低的問題,本文建立了基于物理特性的光伏陣列模型,并考慮光照強度、環境溫度對光伏陣列的影響,模型參數與實際參數嚴格對應。將幾種最大功率點跟蹤算法應用于所建立的光伏陣列模型使用MATLAB進行仿真,分析仿真結果,比較各種算法的優缺點,總結出每種算法所適用的環境,并給出了最大功率點跟蹤控制在并網逆變器系統的實現策略。 設計了適用于額定功率為100W的光伏陣列最大功率點跟蹤的Boost電路,分別給出了利用PIC單片機16F873實現擾動觀察法和增量電導法的程序流程圖,實現了這兩種算法控制下光伏陣列的最大功率點跟蹤,并分析了兩種算法的跟蹤性能。

    標簽: 3kW 光伏并網 逆變器

    上傳時間: 2013-04-24

    上傳用戶:fudong911

  • 有機電致發光顯示器件新型封裝技術及材料的研究.rar

    有機發光顯示器件(OrganicLight-EmittingDiodes,OLEDs)作為下一代顯示器倍受關注,它具有輕、薄、高亮度、快速響應、高清晰度、低電壓、高效率和低成本等優點,完全可以媲美CRT、LCD、LED等顯示器件。作為全固化顯示器件,OLED的最大優越性是能夠與塑料晶體管技術相結合實現柔性顯示,應用前景非常誘人。OLED如此眾多的優點和廣闊的商業前景,吸引了全球眾多研究機構和企業參與其研發和產業化。然而,OLED也存在一些問題,特別是在發光機理、穩定性和壽命等方面還需要進一步的研究。要達到這些目標,除了器件的材料,結構設計外,封裝也十分重要。 本論文的主要工作是利用現有的材料,從綠光OLED器件制作工藝、發光機理,結構和封裝入手,首先,探討了作為陽極的ITO玻璃表面處理工藝和ITO玻璃的光刻工藝。ITO表面的清潔程度嚴重影響著光刻質量和器件的最終性能;ITO表面經過氧等離子處理后其表面功函數增大,明顯提高了器件的發光亮度和發光效率。 其次,針對光刻、曝光工藝技術進行了一系列相關實驗,在光刻工藝中,光刻膠的厚度是影響光刻質量的一個重要因素,其厚度在1.2μm左右時,光刻效果理想。研究了OLED器件陰極隔離柱成像過程中的曝光工藝,摸索出了最佳工藝參數。 然后采用以C545T作為綠光摻雜材料制作器件結構為ITO/CuPc(20nm)/NPB(100nm)/Alq3(80nm):C545T(2.1%摻雜比例)/Alq3(70nm)/LiF(0.5nm)/Al(1,00nm)的綠光OLED器件。最后基于以上器件采用了兩種封裝工藝,實驗一中,在封裝玻璃的四周涂上UV膠,放入手套箱,在氮氣保護氣氛下用紫外冷光源照射1min進行一次封裝,然后取出OLED片,在ITO玻璃和封裝玻璃接口處涂上UV膠,真空下用紫外冷光源照射1min,固化進行二次封裝。實驗二中,在各功能層蒸鍍完成后,又在陰極的外面蒸鍍了一層薄膜封裝層,然后再按實驗一的方法進行封裝。薄膜封裝層的材料分別為硒(Se)、碲(Te)、銻(Sb)。分別對兩種封裝工藝器件的電流-電壓特性、亮度-電壓特性、發光光譜及壽命等特性進行了測試與討論。通過對比,研究發現增加薄膜封裝層器件的壽命比未加薄膜封裝層器件壽命都有所延長,其中,Se薄膜封裝層的增加將器件的壽命延長了1.4倍,Te薄膜封裝層的增加將器件的壽命延長了兩倍多,Sb薄膜封裝層的增加將器件的壽命延長了1.3倍,研究還發現薄膜封裝層基本不影響器件的電流-電壓特性、色坐標等光電性能。最后,分別對三種薄膜封裝層材料硒(Se)、碲(Te)、銻(Sb)進行了研究。

    標簽: 機電 發光 顯示器件

    上傳時間: 2013-07-11

    上傳用戶:liuwei6419

  • 風力發電機組最大功率點跟蹤控制系統的研究.rar

    本文主要研究變速風力發電系統最大功率點的跟蹤問題,以使風力機在處于額定風速以下時能夠實現最大風能捕獲。風力發電系統所采用的功率變流器和最大功率點的跟蹤控制策略提供了基本的研究平臺,以完成本課題的研究。 為了將風能輸送給電網,變速風力機要有變流器將發電機發出的電壓和頻率都不斷改變的電能轉換成恒頻恒壓的電能,再傳輸給電網。本文采用了變速風力機,永磁發電機,三相AC-DC-DC-AC變流器,變壓器等構建了變速風力發電系統。AC-DC-DC-AC變流器用于將永磁發電機發出的電壓和頻率都不斷改變的電能傳輸給電網。鑒于DC-DC直流環節在能量傳輸中的重要性,本文專門研究了單重Sepic變換器和雙重Sepic變換器在變速風力發電系統中所起的作用。 一個先進的變速風力發電系統的最大功率點跟蹤控制策略要對所控制的風力機起到良好的控制效果,不僅與風電系統所采用的變流器的拓撲結構有關,也與自身的控制方式有關。本文在對常用的幾種最大功率點的跟蹤控制策略分析研究的基礎上提出了以風力機的輸出功率和系統儲能的變化率以及風力機轉速等相關數據來確定風力機的實際工作點的最大功率點跟蹤控制策略,該策略的實施不依賴于風力機自身的特性,不需要測量風速等。 由于對變速風力機的建模和仿真是理解和驗證風力發電系統特性和最大功率點跟蹤控制策略的可行性的重要手段。因此本文在Matlab軟件的Simulink環境下對所研究的變速風力發電系統作了建模和仿真。仿真結果充分證明了本文所提出的變速風力發電系統最大功率點跟蹤控制策略的正確性和可行性。

    標簽: 風力發電 機組 最大功率點跟蹤

    上傳時間: 2013-04-24

    上傳用戶:Wwill

  • AUTOCAD_2007_PPT格式教程(目前最完美的Auto_CAD2007教程).rar

    AUTOCAD_2007_PPT格式教程(目前最完美的Auto_CAD2007教程

    標簽: 2007 Auto_CAD AUTOCAD

    上傳時間: 2013-05-21

    上傳用戶:szchen2006

  • 最全的IC封裝代號及尺寸.rar

    最全的IC封裝代號及尺寸 幫助我們更快的找到藥封裝的器件

    標簽: IC封裝 代號 尺寸

    上傳時間: 2013-06-12

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  • FPGA內全數字延時鎖相環的設計.rar

    現場可編程門陣列(FPGA)的發展已經有二十多年,從最初的1200門發展到了目前數百萬門至上千萬門的單片FPGA芯片。現在,FPGA已廣泛地應用于通信、消費類電子和車用電子類等領域,但國內市場基本上是國外品牌的天下。 在高密度FPGA中,芯片上時鐘分布質量變的越來越重要,時鐘延遲和時鐘偏差已成為影響系統性能的重要因素。目前,為了消除FPGA芯片內的時鐘延遲,減小時鐘偏差,主要有利用延時鎖相環(DLL)和鎖相環(PLL)兩種方法,而其各自又分為數字設計和模擬設計。雖然用模擬的方法實現的DLL所占用的芯片面積更小,輸出時鐘的精度更高,但從功耗、鎖定時間、設計難易程度以及可復用性等多方面考慮,我們更愿意采用數字的方法來實現。 本論文是以Xilinx公司Virtex-E系列FPGA為研究基礎,對全數字延時鎖相環(DLL)電路進行分析研究和設計,在此基礎上設計出具有自主知識產權的模塊電路。 本文作者在一年多的時間里,從對電路整體功能分析、邏輯電路設計、晶體管級電路設計和仿真以及最后對設計好的電路仿真分析、電路的優化等做了大量的工作,通過比較DLL與PLL、數字DLL與模擬DLL,深入的分析了全數字DLL模塊電路組成結構和工作原理,設計出了符合指標要求的全數字DLL模塊電路,為開發自我知識產權的FPGA奠定了堅實的基礎。 本文先簡要介紹FPGA及其時鐘管理技術的發展,然后深入分析對比了DLL和PLL兩種時鐘管理方法的優劣。接著詳細論述了DLL模塊及各部分電路的工作原理和電路的設計考慮,給出了全數字DLL整體架構設計。最后對DLL整體電路進行整體仿真分析,驗證電路功能,得出應用參數。在設計中,用Verilog-XL對部分電路進行數字仿真,Spectre對進行部分電路的模擬仿真,而電路的整體仿真工具是HSIM。 本設計采用TSMC0.18μmCMOS工藝庫建模,設計出的DLL工作頻率范圍從25MHz到400MHz,工作電壓為1.8V,工作溫度為-55℃~125℃,最大抖動時間為28ps,在輸入100MHz時鐘時的功耗為200MW,達到了國外同類產品的相應指標。最后完成了輸出電路設計,可以實現時鐘占空比調節,2倍頻,以及1.5、2、2.5、3、4、5、8、16時鐘分頻等時鐘頻率合成功能。

    標簽: FPGA 全數字 延時

    上傳時間: 2013-06-10

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  • 基于FPGA的高速FIR數字濾波器設計.rar

    本論文設計了一種基于FPGA的高速FIR數字濾波器,濾波器實現低通濾波,截止頻率為1MHz,通帶波紋小于1 dB,阻帶最大衰減為-40 dB,輸入輸出數據為8位二進制,采樣頻率為10MHz。 論文首先簡要介紹了數字濾波器的基本原理和線性FIR數字濾波器的性質、結構,根據濾波器的性能要求選擇窗函數、確定系數,在算法上為了滿足數字濾波器的要求,對系數放大512倍并取整,并用Matlab對數字濾波器原理進行了證明。同時簡述了EDA技術和FPGA設計流程。 其次,論文說明了FIR數字濾波器模塊的劃分,并用Verilog語言在Modelsim環境下進行了功能測試。對于數字濾波器系數中的-1,-2,4這些簡單的系數乘法直接進行移位和取反,可以極大的節省資源和優化設計。而對普通系數乘法采用4-BANT(4bits-at-a-time)的并行算法,用加法累加快速實現了乘積的運算;另外,在本設計進行部分積累加時,采用舍取冗余位,主要是根據設計時已對系數進行了放大,而輸出時又要將結果相應的縮小,所以在累加時,提前對部分積縮小,從而減少了運算量,從時間和資源上都得到了優化。 論文的最后分別用Modelsim和Quartus II進行了FIR數字濾波器的前仿真和后仿真,將仿真的結果和Matlab中原理驗證時得到的理想值進行了比較,并對所產生的誤差進行了分析。仿真結果表明:本16階FIR數字濾波器設計能夠實現截止頻率為1MHz的低通濾波,并且工作頻率可達150MHz以上。

    標簽: FPGA FIR 數字

    上傳時間: 2013-05-24

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  • 基于H.264編解碼的算法優化研究及FPGA的硬件實現.rar

    H.264/AVC是由ITU和ISO兩大組織聯合組成的JVT共同制定的一項新的視頻壓縮技術標準,在較低帶寬上提供高質量的圖像傳輸是H.264/AVC的應用亮點。在同樣的視覺質量前提下,H.264/AVC比H.263和MPEG-4節約了50%的碼率。但H.264獲得優越性能的代價是計算復雜度的增加,據估計其編碼的計算復雜度大約為H.263的3倍,因此很難應用于實時視頻處理領域。針對這一現狀,業內做了大量的研究工作,力圖降低其計算復雜度和提高運行效率。比如在運動估計方面,國內外在這方面的研究已經很成熟。而針對幀內/幀間預測編碼的研究卻較少。因此研究預測模式的快速算法具有理論意義和應用價值。 本文在詳細研究H.264標準視頻壓縮編碼特點基礎上,分析了H.264幀內編碼, 幀間編碼及變換,量化技術的原理及特點,提出了一種基于局部邊緣方向信息的快速幀內模式判決算法,通過結合SAD的模式選擇方法來減少模式選擇數目。它采用了Sobel梯度算子計算當前塊的邊緣信息,累加當前塊中屬于同一方向像素點的邊緣矢量構造不同模式下的邊緣方向直方圖,以便確定最可能的預測模式。該算法有效降低了編碼器的運算復雜度,在并未顯著降低編碼性能的情況下提升了編碼器效率。仿真表明:Foreman 圖像序列編碼性能有了提高,其中PSNR平均降低了0.06dB,Bitrate平均降低了19.4%,這大大提高了視頻傳輸的質量。 另外在幀間預測模式選擇算法方面進行了改進研究:按順序對不同類型進行判決,有選擇地去比較可能模式,使得在有效減少需判決的模式數量的同時,結合小塊模式搜索中途停止準則來確定最優模式。仿真表明:改進算法相對與原來算法能夠節省很多的編碼時間(平均下降了49.3%),但帶來的圖像質星的下降(平均下降0.08dB,可以忽略)和碼率較少的增加。 同時在整數DCT變換模塊中,提出了一種快速蝶形算法,使得對4×4點數據做一次變換,只需通過8×8次加法和2×8次移位運算便可完成,與原來12×8次加法和4×8次移位相比,新算法大大降低了運算復雜度。 最后介紹FPGA的特點及設計流程,并實現了H.264編解碼器中變換編碼及量化和熵解碼模塊的硬件。這種基于FPGA所實現的H.264編碼視頻處理模塊設計具備了成本低,周期短,設計方法靈活等優點,具有廣闊的市場應用前景。 仿真表明,通過使用本文提出的幀內/幀間速算法方法可使得H.264編碼速度獲得顯著的提高,使H.264 Baseline編碼器能在PC平臺上實現實時編碼。

    標簽: FPGA 264 編解碼

    上傳時間: 2013-07-18

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