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核方法

  • 雷達(dá)信號(hào)處理系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn).rar

    雷達(dá)信號(hào)處理是雷達(dá)系統(tǒng)的重要組成部分。在數(shù)字信號(hào)處理技術(shù)飛速發(fā)展的今天,雷達(dá)信號(hào)處理中也普遍使用數(shù)字信號(hào)處理技術(shù)。而現(xiàn)場(chǎng)可編程門陣列(FPGA)在數(shù)字信號(hào)處理中的廣泛應(yīng)用,使得FPGA在雷達(dá)信號(hào)處理中也占據(jù)了重要地位。 針對(duì)雷達(dá)信號(hào)處理的設(shè)計(jì)與實(shí)現(xiàn),本文在以下兩個(gè)方面展開研究: 一方面以線性調(diào)頻信號(hào)(LFM)為例,分別對(duì)幾種基本的雷達(dá)信號(hào)處理,如正交相干檢波、脈沖壓縮、動(dòng)目標(biāo)顯示(MTI)/動(dòng)目標(biāo)檢測(cè)(MTD)和恒虛警(CFAR)詳細(xì)地闡述了其原理,在此基礎(chǔ)上給出了其經(jīng)常采用的實(shí)現(xiàn)方法,并在MATLAB環(huán)境中對(duì)各個(gè)環(huán)節(jié)進(jìn)行了參數(shù)化仿真,詳盡地給出了各環(huán)節(jié)的仿真波形圖。針對(duì)仿真結(jié)果,直觀形象地說(shuō)明了不同實(shí)現(xiàn)方法的優(yōu)劣。 另一方面結(jié)合MATLAB仿真結(jié)果,給出利用FPGA實(shí)現(xiàn)雷達(dá)信號(hào)處理的方案。在Xilinx ISE6.3i軟件集成環(huán)境下,通過(guò)對(duì)Xilinx提供的IP核的調(diào)用,并與VHDL語(yǔ)言相結(jié)合,完成雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)。

    標(biāo)簽: FPGA 雷達(dá)信號(hào) 處理系統(tǒng)

    上傳時(shí)間: 2013-06-08

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  • 基于FPGA的TS流復(fù)用器及其接口的設(shè)計(jì)與實(shí)現(xiàn).rar

    在數(shù)字電視系統(tǒng)中,MPEG-2編碼復(fù)用器是系統(tǒng)傳輸?shù)暮诵沫h(huán)節(jié),所有的節(jié)目、數(shù)據(jù)以及各種增值服務(wù)都是通過(guò)復(fù)用打包成傳輸流傳輸出去。目前,只有少數(shù)公司掌握復(fù)用器的核心算法技術(shù),能夠采用MPEG-2可變碼率統(tǒng)計(jì)復(fù)用方法提高帶寬利用率,保證高質(zhì)量圖像傳輸。由于目前正處廣播電視全面向數(shù)字化過(guò)渡期間,市場(chǎng)潛力巨大,因此對(duì)復(fù)用器的研究開發(fā)非常重要。本文針對(duì)復(fù)用器及其接口技術(shù)進(jìn)行研究并設(shè)計(jì)出成形產(chǎn)品。 文中首先對(duì)MPEG-2標(biāo)準(zhǔn)及NIOS Ⅱ軟核進(jìn)行分析。重點(diǎn)研究了復(fù)用器中的部分關(guān)鍵技術(shù):PSI信息提取及重構(gòu)算法、PID映射方法、PCR校正及CRC校驗(yàn)算法,給出了實(shí)現(xiàn)方法,并通過(guò)了硬件驗(yàn)證。然后對(duì)復(fù)用器中主要用到的AsI接口和DS3接口進(jìn)行了分析與研究,給出了設(shè)計(jì)方法,并通過(guò)了硬件驗(yàn)證。 本文的主要工作如下: ●首先對(duì)復(fù)用器整體功能進(jìn)行詳細(xì)分析,并劃分軟硬件各自需要完成的功能。給出復(fù)用器的整體方案以及ASI接口和DS3接口設(shè)計(jì)方案。 ●在FPGA上采用c語(yǔ)言實(shí)現(xiàn)了PSI信息提取與重構(gòu)算法。 ●給出了實(shí)現(xiàn)快速的PID映射方法,并根據(jù)FPGA特點(diǎn)給出一種新的PID映射方法,減少了邏輯資源的使用,提高了穩(wěn)定性。 ●采用Verilog設(shè)計(jì)了SI信息提取與重構(gòu)的硬件平臺(tái),并用c語(yǔ)言實(shí)現(xiàn)了SDT表的提取與重構(gòu)算法,在FPGA中成功實(shí)現(xiàn)了動(dòng)態(tài)分配內(nèi)存空間。 ●在FPGA上實(shí)現(xiàn)了.ASI接口,主要分析了位同步的實(shí)現(xiàn)過(guò)程,實(shí)現(xiàn)了一種新的快速實(shí)現(xiàn)字節(jié)同步的設(shè)計(jì)。 ●在FPGA上實(shí)現(xiàn)了DS3接口,提出并實(shí)現(xiàn)了一種兼容式DS3接口設(shè)計(jì)。并對(duì)幀同步設(shè)計(jì)進(jìn)行改進(jìn)。 ●完成部分PCB版圖設(shè)計(jì),并進(jìn)行調(diào)試監(jiān)測(cè)。 本復(fù)用器設(shè)計(jì)最大特點(diǎn)是將軟件設(shè)計(jì)和硬件設(shè)計(jì)進(jìn)行合理劃分,硬件平臺(tái)及接口采用Verilog語(yǔ)言實(shí)現(xiàn),PSI信息算法主要采用c語(yǔ)言實(shí)現(xiàn)。這種軟硬件的劃分使系統(tǒng)設(shè)計(jì)更加靈活,且軟件設(shè)計(jì)與硬件設(shè)計(jì)可同時(shí)進(jìn)行,極大的提高了工作效率。 整個(gè)項(xiàng)目設(shè)計(jì)采用verilog和c兩種語(yǔ)言完成,采用Altera公司的FPGA芯片EP1C20,在Quartus和NIOS IDE兩種設(shè)計(jì)平臺(tái)下設(shè)計(jì)實(shí)現(xiàn)。根據(jù)此方案已經(jīng)開發(fā)出兩臺(tái)帶有ASI和DS3接口的數(shù)字電視TS流復(fù)用器,經(jīng)測(cè)試達(dá)到了預(yù)期的性能和技術(shù)指標(biāo)。

    標(biāo)簽: FPGA TS流 復(fù)用器

    上傳時(shí)間: 2013-08-03

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  • 基于FPGA的MCS51核的VHDL語(yǔ)言設(shè)計(jì)與實(shí)現(xiàn).rar

    本文以研究嵌入式微處理器為主,自主地設(shè)計(jì)了能夠運(yùn)行MCS-51系列單片機(jī)指令的MCU系統(tǒng)。系統(tǒng)采用了VHDL 語(yǔ)言與原理框圖的綜合設(shè)計(jì)方法,并且在Altera公司的FPGA上通過(guò)驗(yàn)證。論文深入地研究了微處理器的指令系統(tǒng)和數(shù)據(jù)地址通路,采用VHDL 語(yǔ)言完成了取指單元,指令譯碼器單元,存儲(chǔ)器單元和邏輯運(yùn)算單元的電路模塊的設(shè)計(jì)與實(shí)現(xiàn);研究了控制單元的實(shí)現(xiàn)方法和基于全局狀態(tài)機(jī)的設(shè)計(jì)理論,采用硬件描述語(yǔ)言完成了對(duì)各個(gè)控制線的相關(guān)設(shè)計(jì)與實(shí)現(xiàn)。論文通過(guò)原理示意圖和示例代碼的演示,著重介紹了指令譯碼器的實(shí)現(xiàn)方式,基于此種方式形成的譯碼電路還能夠?qū)崿F(xiàn)更為復(fù)雜的CISC指令。 本系統(tǒng)采用分模塊的設(shè)計(jì)方式,把具有相同功能的邏輯電路集中到一個(gè)框圖里,使得系統(tǒng)的可移植性大大地提高。系統(tǒng)還采用層次框圖的設(shè)計(jì)方式,把明顯地具有主從關(guān)系的電路放在不同的層次里,這也使得系統(tǒng)模塊功能的可擴(kuò)展性大大地增強(qiáng)。內(nèi)部邏輯共分為數(shù)據(jù)存儲(chǔ)器模塊;程序存儲(chǔ)器模塊;時(shí)序控制模塊;特殊功能寄存器模塊和Core核心模塊這五個(gè)部分,文中對(duì)各個(gè)模塊的設(shè)計(jì)作了詳細(xì)的介紹。本文在最后對(duì)已實(shí)現(xiàn)的部分典型指令進(jìn)行了邏輯仿真測(cè)試,測(cè)試結(jié)果表明,本文所設(shè)計(jì)的MCU系統(tǒng)能夠如預(yù)期地執(zhí)行相應(yīng)的指令。在指令執(zhí)行的過(guò)程中,相應(yīng)寄存器和總線上的值也均符合設(shè)計(jì)要求,實(shí)現(xiàn)了設(shè)計(jì)目標(biāo)。

    標(biāo)簽: FPGA VHDL MCS

    上傳時(shí)間: 2013-05-20

    上傳用戶:2525775

  • 基于FPGA的8051單片機(jī)IP核設(shè)計(jì)及應(yīng)用.rar

    單片微型計(jì)算機(jī)(單片機(jī))是將微處理器CPU、程序存儲(chǔ)器、數(shù)據(jù)存儲(chǔ)器、定時(shí)/計(jì)數(shù)器、輸入/輸出并行接口等集成在一起。由于單片機(jī)具有專門為嵌入式系統(tǒng)設(shè)計(jì)的體系結(jié)構(gòu)與指令系統(tǒng),所以它最能滿足嵌入式系統(tǒng)的應(yīng)用要求。Intel公司生產(chǎn)的MCS-51系列單片機(jī)是我國(guó)目前應(yīng)用最廣的單片機(jī)之一。 隨著可編程邏輯器件設(shè)計(jì)技術(shù)的發(fā)展,每個(gè)邏輯器件中門電路的數(shù)量越來(lái)越多,一個(gè)邏輯器件就可以完成本來(lái)要由很多分立邏輯器件和存儲(chǔ)芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本,提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。IP核是將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,設(shè)計(jì)成可修改參數(shù)的模塊,讓其他用戶可以直接調(diào)用這些模塊,這樣就大大減輕了工程師的負(fù)擔(dān),避免重復(fù)勞動(dòng)。隨著FPGA的規(guī)模越來(lái)越大,設(shè)計(jì)越來(lái)越復(fù)雜,使用IP核是一個(gè)發(fā)展趨勢(shì)。 本課題結(jié)合FPGA與8051單片機(jī)的優(yōu)點(diǎn),主要針對(duì)以下三個(gè)方面研究: (1)FPGA開發(fā)平臺(tái)的硬件實(shí)現(xiàn)選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件,采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內(nèi)程序存儲(chǔ)器,搭建FPGA的硬件開發(fā)平臺(tái)。 (2)用VHDL語(yǔ)言實(shí)現(xiàn)8051IP核分析研究8051系列單片機(jī)內(nèi)部各模塊結(jié)構(gòu)以及各部分的連接關(guān)系,實(shí)現(xiàn)了基于FPGA的8051IP核。主要包括如下幾個(gè)模塊:CPU模塊、片內(nèi)數(shù)據(jù)存儲(chǔ)器模塊、定時(shí)/計(jì)數(shù)器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復(fù)位模塊等。 (3)基于FPGA的8051IP核應(yīng)用用所設(shè)計(jì)的8051IP核,實(shí)現(xiàn)了對(duì)一個(gè)4×4鍵盤的監(jiān)測(cè)掃描、鍵盤確認(rèn)、按鍵識(shí)別等應(yīng)用。

    標(biāo)簽: FPGA 8051 單片機(jī)

    上傳時(shí)間: 2013-06-21

    上傳用戶:stampede

  • 基于FPGA的調(diào)制解調(diào)器的研究和設(shè)計(jì).rar

    當(dāng)今電子系統(tǒng)的設(shè)計(jì)是以大規(guī)模FPGA為物理載體的系統(tǒng)芯片的設(shè)計(jì),基于FPGA的片上系統(tǒng)可稱為可編程片上系統(tǒng)(SOPC)。SOPC的設(shè)計(jì)是以知識(shí)產(chǎn)權(quán)核(IPCore)為基礎(chǔ),以硬件描述語(yǔ)言為主要設(shè)計(jì)手段,借助以計(jì)算機(jī)為平臺(tái)的EDA工具進(jìn)行的。 本文在介紹了FPGA與SOPC相關(guān)技術(shù)的基礎(chǔ)上,給出了SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的方案。在分析設(shè)計(jì)軟件Matlab/DSP(Digital Signal Processing)。builder以及Quartus Ⅱ開發(fā)軟件進(jìn)行SOPC(System On a Programmable Chip)設(shè)計(jì)流程后,依據(jù)調(diào)制解調(diào)算法提出了一種基于DSP Builder調(diào)制解調(diào)器的SOPC實(shí)現(xiàn)方案,模塊化的設(shè)計(jì)方法大大縮短了調(diào)制解調(diào)器的開發(fā)周期。 在SOPC技術(shù)開發(fā)調(diào)制解調(diào)器的過(guò)程中,用MATLAB/Simulink的圖形方式調(diào)用Altera DSP Builder和其他Simulink庫(kù)中的圖形模塊(Block)進(jìn)行系統(tǒng)建模,在Simulink中仿真通過(guò)后,利用DSP Builder將Simulink的模型文件(.mdl)轉(zhuǎn)化成通用的硬件描述語(yǔ)言VHDL文件,從而避免了VHDL語(yǔ)言手動(dòng)編寫系統(tǒng)的煩瑣過(guò)程,將精力集中于算法的優(yōu)化上。 基于DSP Builder的開發(fā)功能,調(diào)制解調(diào)器電路中的低通濾波器可直接調(diào)用FIRIP Core,進(jìn)一步提高了開發(fā)效率。 在進(jìn)行編譯、仿真調(diào)試成功后,經(jīng)過(guò)QuartusⅡ?qū)⒕幾g生成的編程文件下載到ALTERA公司Cyclone Ⅱ系列的FPGA芯片EP2C5F256C6,完成器件編程,從而給出了一種調(diào)制解調(diào)器的SOPC系統(tǒng)實(shí)現(xiàn)方案。

    標(biāo)簽: FPGA 調(diào)制解調(diào)器

    上傳時(shí)間: 2013-06-24

    上傳用戶:liuchee

  • 基于FPGA的精確時(shí)鐘同步方法研究.rar

    在工業(yè)控制領(lǐng)域,多種現(xiàn)場(chǎng)總線標(biāo)準(zhǔn)共存的局面從客觀上促進(jìn)了工業(yè)以太網(wǎng)技術(shù)的迅速發(fā)展,國(guó)際上已經(jīng)出現(xiàn)了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業(yè)以太網(wǎng)協(xié)議。將傳統(tǒng)的商用以太網(wǎng)應(yīng)用于工業(yè)控制系統(tǒng)的現(xiàn)場(chǎng)設(shè)備層的最大障礙是以太網(wǎng)的非實(shí)時(shí)性,而實(shí)現(xiàn)現(xiàn)場(chǎng)設(shè)備間的高精度時(shí)鐘同步是保證以太網(wǎng)高實(shí)時(shí)性的前提和基礎(chǔ)。 IEEE 1588定義了一個(gè)能夠在測(cè)量和控制系統(tǒng)中實(shí)現(xiàn)高精度時(shí)鐘同步的協(xié)議——精確時(shí)間協(xié)議(Precision Time Protocol)。PTP協(xié)議集成了網(wǎng)絡(luò)通訊、局部計(jì)算和分布式對(duì)象等多項(xiàng)技術(shù),適用于所有通過(guò)支持多播的局域網(wǎng)進(jìn)行通訊的分布式系統(tǒng),特別適合于以太網(wǎng),但不局限于以太網(wǎng)。PTP協(xié)議能夠使異質(zhì)系統(tǒng)中各類不同精確度、分辨率和穩(wěn)定性的時(shí)鐘同步起來(lái),占用最少的網(wǎng)絡(luò)和局部計(jì)算資源,在最好情況下能達(dá)到系統(tǒng)級(jí)的亞微級(jí)的同步精度。 基于PC機(jī)軟件的時(shí)鐘同步方法,如NTP協(xié)議,由于其實(shí)現(xiàn)機(jī)理的限制,其同步精度最好只能達(dá)到毫秒級(jí);基于嵌入式軟件的時(shí)鐘同步方法,將時(shí)鐘同步模塊放在操作系統(tǒng)的驅(qū)動(dòng)層,其同步精度能夠達(dá)到微秒級(jí)。現(xiàn)場(chǎng)設(shè)備間微秒級(jí)的同步精度雖然已經(jīng)能滿足大多數(shù)工業(yè)控制系統(tǒng)對(duì)設(shè)備時(shí)鐘同步的要求,但是對(duì)于運(yùn)動(dòng)控制等需求高精度定時(shí)的系統(tǒng)來(lái)說(shuō),這仍然不夠。基于嵌入式軟件的時(shí)鐘同步方法受限于操作系統(tǒng)中斷響應(yīng)延遲時(shí)間不一致、晶振頻率漂移等因素,很難達(dá)到亞微秒級(jí)的同步精度。 本文設(shè)計(jì)并實(shí)現(xiàn)了一種基于FPGA的時(shí)鐘同步方法,以IEEE 1588作為時(shí)鐘同步協(xié)議,以Ethernet作為底層通訊網(wǎng)絡(luò),以嵌入式軟件形式實(shí)現(xiàn)TCP/IP通訊,以數(shù)字電路形式實(shí)現(xiàn)時(shí)鐘同步模塊。這種方法充分利用了FPGA的特點(diǎn),通過(guò)準(zhǔn)確捕獲報(bào)文時(shí)間戳和動(dòng)態(tài)補(bǔ)償晶振頻率漂移等手段,相對(duì)于嵌入式軟件時(shí)鐘同步方法實(shí)現(xiàn)了更高精度的時(shí)鐘同步,并通過(guò)實(shí)驗(yàn)驗(yàn)證了在以集線器互連的10Mbps以太網(wǎng)上能夠達(dá)到亞微秒級(jí)的同步精度。

    標(biāo)簽: FPGA 時(shí)鐘同步 方法研究

    上傳時(shí)間: 2013-08-04

    上傳用戶:hn891122

  • 基于H264的網(wǎng)絡(luò)視頻監(jiān)控的FPGA實(shí)現(xiàn)研究.rar

    隨著科學(xué)技術(shù)的發(fā)展與公共安全保障需求的提高,視頻監(jiān)控系統(tǒng)在工業(yè)生產(chǎn)、日常生活、警備與軍事方面的應(yīng)用越來(lái)越廣泛。采用基于 FPGA 的SOPC技術(shù)、H.264壓縮編碼技術(shù)和網(wǎng)絡(luò)傳輸控制技術(shù)實(shí)現(xiàn)網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng),在穩(wěn)定性、功能、成本與擴(kuò)展性等方面都有著突出的優(yōu)勢(shì),具有重要的學(xué)術(shù)意義與實(shí)用意義, 本課題所設(shè)計(jì)的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)由以Nios Ⅱ?yàn)楹诵牡那度胧綀D像服務(wù)器、相關(guān)網(wǎng)絡(luò)設(shè)備與若干PC機(jī)客戶端組成。嵌入式圖像服務(wù)器實(shí)時(shí)采集圖像,采用H.264 編碼算法進(jìn)行壓縮,并持續(xù)監(jiān)聽網(wǎng)絡(luò)。PC機(jī)客戶端可通過(guò)網(wǎng)絡(luò)對(duì)服務(wù)器進(jìn)行遠(yuǎn)程訪問(wèn),接收編碼數(shù)據(jù),使用H.264解碼算法重建圖像并實(shí)時(shí)顯示,使監(jiān)控人員有效地掌握現(xiàn)場(chǎng)情況, 在嵌入式圖像服務(wù)器設(shè)計(jì)階段,本文首先進(jìn)行了芯片選型與開發(fā)平臺(tái)選擇。然后構(gòu)建圖像采集子系統(tǒng),采用雙緩存乒乓交換的方法設(shè)計(jì)圖像采集用戶自定義模塊。接著設(shè)計(jì)雙Nios Ⅱ架構(gòu)的SOPC系統(tǒng),闡述了雙軟核設(shè)計(jì)中定制連接、內(nèi)存芯片共享、數(shù)據(jù)搬移、通信與互斥的解決方法。同時(shí)完成了網(wǎng)絡(luò)服務(wù)器的設(shè)計(jì),采用μC/OS-Ⅱ進(jìn)行多任務(wù)的管理與調(diào)度, H.264視頻壓縮編解碼算法設(shè)計(jì)與實(shí)現(xiàn)是本文的重點(diǎn)。文中首先分析H.264.標(biāo)準(zhǔn),規(guī)劃編解碼器結(jié)構(gòu)。接著設(shè)計(jì)了16×16幀內(nèi)預(yù)測(cè)算法,并設(shè)計(jì)宏塊掃描方式,采用兩次判決策略進(jìn)行預(yù)測(cè)模式選擇。然后設(shè)計(jì)4×4子塊掃描方式,編寫整數(shù)變換與量化算法程序。熵編碼采用Exp-Golomb編碼與CAVLC相結(jié)合的方案,針對(duì)除拖尾系數(shù)之外的非零系數(shù)值編碼子算法,實(shí)現(xiàn)了一種基于表示范圍判別的編碼方法。最后設(shè)計(jì)了網(wǎng)絡(luò)傳輸?shù)拇a流組成格式,并針對(duì)編碼算法設(shè)計(jì)相應(yīng)解碼算法。使用VC++完成算法驗(yàn)證,并進(jìn)行測(cè)試,觀察不同參數(shù)下壓縮率與失真度的變化。 算法驗(yàn)證完成后,本文進(jìn)行了PC機(jī)客戶端設(shè)計(jì),使其具有遠(yuǎn)程訪問(wèn)、H.264解碼與實(shí)時(shí)顯示的功能。同時(shí)將H.264 編碼算法程序移植到NiosⅡ中,并將嵌入式圖像服務(wù)器與若干客戶端接入網(wǎng)絡(luò)進(jìn)行聯(lián)合調(diào)試,構(gòu)建完整的網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng), 實(shí)驗(yàn)結(jié)果表明,本系統(tǒng)視頻壓縮率高,監(jiān)控圖像質(zhì)量良好,充分證明了系統(tǒng)軟硬件與圖像編解碼算法設(shè)計(jì)成功。本系統(tǒng)具有成本低、擴(kuò)展性好及適用范圍廣等優(yōu)點(diǎn),發(fā)展前景十分廣闊。

    標(biāo)簽: H264 FPGA 網(wǎng)絡(luò)視頻監(jiān)控

    上傳時(shí)間: 2013-04-24

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  • 基于FPGA嵌入式指紋識(shí)別系統(tǒng)研究.rar

    隨著科學(xué)技術(shù)的發(fā)展,指紋識(shí)別技術(shù)被廣泛應(yīng)用到各種不同的領(lǐng)域。對(duì)于一般的指紋識(shí)別系統(tǒng),其設(shè)計(jì)要求具有很高的實(shí)時(shí)性和易用性,因此識(shí)別算法應(yīng)該具有較低的復(fù)雜度,較快的運(yùn)算速度,從而滿足實(shí)時(shí)性的要求。所以有必要根據(jù)不同的識(shí)別算法采用不同的實(shí)現(xiàn)平臺(tái),使得指紋識(shí)別系統(tǒng)具有較高的可靠性、實(shí)時(shí)性、有效性等性能要求。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計(jì)領(lǐng)域中最熱門的概念。NiosⅡ是Altera.公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入到FPGA內(nèi)部,與用戶自定義邏輯組建成一個(gè)基于FPGA的片上專用系統(tǒng)。 本文在綜合考慮各種應(yīng)用情況的基礎(chǔ)上,以網(wǎng)絡(luò)技術(shù)、數(shù)據(jù)庫(kù)技術(shù)、指紋識(shí)別技術(shù)和嵌入式系統(tǒng)技術(shù)為理論基礎(chǔ),提出了一種有效可行的系統(tǒng)架構(gòu)方案。對(duì)指紋識(shí)別技術(shù)中各個(gè)環(huán)節(jié)的算法和原理進(jìn)行了深入研究,合理的改進(jìn)了部分指紋識(shí)別算法;同時(shí)為了提高系統(tǒng)的實(shí)時(shí)性,采用NiosⅡ嵌入式處理器和FPGA硬件模塊實(shí)現(xiàn)指紋圖像處理主要算法。論文主要包括以下幾個(gè)方面: 1、對(duì)指紋圖像預(yù)處理、特征提取和特征匹配算法原理進(jìn)行闡述,同時(shí)改進(jìn)了指紋圖像的細(xì)化算法,提高了算法的性能,并設(shè)計(jì)了一套實(shí)用的指紋特征數(shù)據(jù)結(jié)構(gòu); 2、針對(duì)指紋圖像預(yù)處理模塊,包括圖像的歸一化、頻率提取、方向提取以及方向?yàn)V波,采用基于FPGA的硬件電路的方式實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明,在保證系統(tǒng)誤識(shí)率較低、可靠性高的基礎(chǔ)上,大大提高了系統(tǒng)的執(zhí)行速度; 3、改變了傳統(tǒng)的單枚指紋識(shí)別方法,提出采用多枚指紋唯一標(biāo)識(shí)身份,大大降低了識(shí)別系統(tǒng)的誤識(shí)率; 4、改進(jìn)了傳統(tǒng)的基于三角形匹配中獲取基準(zhǔn)點(diǎn)的方法,同時(shí)結(jié)合可變界限盒思想進(jìn)行指紋特征匹配。 5、結(jié)合COM+技術(shù)、數(shù)據(jù)庫(kù)技術(shù)和網(wǎng)絡(luò)技術(shù),開發(fā)了后臺(tái)指紋特征匹配服務(wù)系統(tǒng),實(shí)現(xiàn)了嵌入式指紋識(shí)別系統(tǒng)同數(shù)據(jù)庫(kù)的實(shí)時(shí)信息交換。 實(shí)驗(yàn)結(jié)果表明,本文所提出的系統(tǒng)構(gòu)架方案有效可行,基于FPGA的自動(dòng)指紋識(shí)別系統(tǒng)在速度、功耗、擴(kuò)展性等方面具有獨(dú)特的優(yōu)勢(shì),擁有廣闊的發(fā)展前景。

    標(biāo)簽: FPGA 嵌入式 指紋識(shí)別

    上傳時(shí)間: 2013-08-04

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  • 單片機(jī)產(chǎn)生準(zhǔn)確頻率正弦波的新方法.rar

    單片機(jī)產(chǎn)生正弦波,簡(jiǎn)紹了單片機(jī)產(chǎn)生高精度正弦波的方法

    標(biāo)簽: 單片機(jī) 頻率 正弦波

    上傳時(shí)間: 2013-04-24

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  • MDIO接口邏輯設(shè)計(jì)及其FPGA驗(yàn)證.rar

    隨著集成電路技術(shù)的飛速發(fā)展,芯片的規(guī)模越來(lái)越大,集成度越來(lái)越高,工作頻率越來(lái)越快,但是芯片的設(shè)計(jì)能力卻面臨巨大的挑戰(zhàn)。而IP核的重用則是解決當(dāng)今芯片設(shè)計(jì)所面臨問(wèn)題的最有效的解決方法。 MDIO接口模塊為以太網(wǎng)接口芯片中MAC層對(duì)PHY器件的控制管理接口。隨著以太網(wǎng)技術(shù)的快速發(fā)展以及MAC應(yīng)用越來(lái)越廣泛,MDIO接口模塊的應(yīng)用也越來(lái)越多,因此將MDIO接口模塊設(shè)計(jì)成可重用的IP核對(duì)于以各種太網(wǎng)接口集成芯片的設(shè)計(jì)具有很重要的作用。 本文詳細(xì)描述了MDIO接口模塊IP核的設(shè)計(jì),介紹了該IP核的系統(tǒng)結(jié)構(gòu)以及各個(gè)子模塊的詳細(xì)設(shè)計(jì)方法,對(duì)此IP核進(jìn)行了仿真驗(yàn)證,最后進(jìn)行了FPGA測(cè)試,功能和性能達(dá)到了要求,最終通過(guò)了IP審核流程并且已成功應(yīng)用于企業(yè)的以太網(wǎng)接口芯片中。

    標(biāo)簽: MDIO FPGA 接口

    上傳時(shí)間: 2013-06-20

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