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模擬<b>乘法器</b>
這是一個用VHDL層次化設計的一個九九乘法表源文件,還包含仿真波形
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相應加法器的測試向量（test bench)
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vhdl和verling hdl 的加法器
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超前進位加法器的例子,包括源碼和測試文件,壓縮包,無密碼.
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這是數值計算當中最小二乘法的例子
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99乘法表的實現,采用ASM語言.語言簡單易用好學!
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浮點加法器的VHDL算法設計 浮點加法器的VHDL算法設計
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最小二乘法曲線擬合程序
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超大整數乘法
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dsp程序：矩陣乘法
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