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模擬c<b>MOS</b>集成電路

簡單的串列埠自我測試持式測試硬體電路是否正確

簡單的串列埠自我測試持式測試硬體電路是否正確

標(biāo)簽： 正

上傳時間： 2015-04-25

上傳用戶：FreeSky
完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現(xiàn)精簡電路

完整的jpeg encoder verilog code,DCT部分採用1991 IEEE transection paper,利用skew circular convolution來實現(xiàn)精簡電路

標(biāo)簽： convolution transection circular encoder

上傳時間： 2014-01-20

上傳用戶：waizhang
ALTERA PWM電路這是一個ALTERA的PWM電路

ALTERA PWM電路這是一個ALTERA的PWM電路，可以整合到NIOSII IDE中，來完成一個PWM的系統(tǒng)。

標(biāo)簽： ALTERA PWM

上傳時間： 2013-12-08

上傳用戶：zxc23456789
使用FPGA設(shè)計WiMax接收機之OFDM同步硬體電路(內(nèi)附VHDL code)

使用FPGA設(shè)計WiMax接收機之OFDM同步硬體電路(內(nèi)附VHDL code)

標(biāo)簽： WiMax FPGA OFDM VHDL

上傳時間： 2016-01-22

上傳用戶：zhuyibin
ADS操作影片,教我們怎麼tuning電路.中文發(fā)音,步驟清楚,非常適合初學(xué)入門者.希望對大家有幫助.

ADS操作影片,教我們怎麼tuning電路.中文發(fā)音,步驟清楚,非常適合初學(xué)入門者.希望對大家有幫助.

標(biāo)簽： tuning ADS 操作家

上傳時間： 2016-02-25

上傳用戶：trepb001
一個可以計算分壓電路的源碼。可透過輸出與輸入電壓

一個可以計算分壓電路的源碼。可透過輸出與輸入電壓，計算電阻的大小；或透過輸入電壓與電阻，計算最後輸出之電壓

標(biāo)簽： 分

上傳時間： 2014-12-09

上傳用戶：hoperingcong
是一個用verilog寫成的加法器電路,可把七個元件加起來

是一個用verilog寫成的加法器電路,可把七個元件加起來

標(biāo)簽： verilog 加法器元件

上傳時間： 2014-01-07

上傳用戶：zhangzhenyu
使用硬體描述語言HDL 設(shè)計硬體電路

使用硬體描述語言HDL 設(shè)計硬體電路，臺灣人寫的PPT講義，非常不錯。VHDL硬件設(shè)計入門學(xué)習(xí)。VHDL基本語法架構(gòu)，VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。

標(biāo)簽： HDL

上傳時間： 2014-01-22

上傳用戶：cxl274287265
5 bits 的加法器與減法器合併電路之原始程式製作

5 bits 的加法器與減法器合併電路之原始程式製作

標(biāo)簽： bits 加法器法器程式

上傳時間： 2016-05-18

上傳用戶：ippler8
verilog除頻器可用於編碼段運用可以穩(wěn)定電路設(shè)計

verilog除頻器可用於編碼段運用可以穩(wěn)定電路設(shè)計

標(biāo)簽： verilog

上傳時間： 2013-12-26

上傳用戶：372825274