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模數(shù)轉換芯片

  • 降壓型同步控制器可采用低至2.2V的工作輸入電源

    許多電信和計算應用都需要一個能夠從非常低輸入電壓獲得工作電源的高效率降壓型 DC/DC 轉換器。高輸出功率同步控制器 LT3740 就是這些應用的理想選擇,該器件能把 2.2V 至 22V 的輸入電源轉換為低至 0.8V 的輸出,並提供 2A 至 20A 的負載電流。其應用包括分布式電源繫統、負載點調節和邏輯電源轉換。

    標簽: 2.2 降壓型 同步控制器 輸入

    上傳時間: 2013-12-30

    上傳用戶:arnold

  • 四相升壓型轉換器提供348W功率而無需采用散熱器

    在汽車、工業和電信行業的設計師當中,使用高功率升壓型轉換器的現像正變得越來越普遍。當需要 300W 或更高的功率時,必須在功率器件中實現高效率 (低功率損耗),以免除增設龐大散熱器和采用強迫通風冷卻的需要

    標簽: 348W 升壓型轉換器 功率 散熱器

    上傳時間: 2014-12-01

    上傳用戶:lhc9102

  • 為DELL的layer 2 Switch的Web server中java applet的源始碼

    為DELL的layer 2 Switch的Web server中java applet的源始碼,功能為利用java applet主動傳送訊息到browser,借著此訊息轉換成網頁,再顯現在browser。

    標簽: Switch applet server layer

    上傳時間: 2014-01-19

    上傳用戶:cc1

  • USB是PC體系中的一套全新的工業標準

    USB是PC體系中的一套全新的工業標準,它支持單個主機與多個外接設備同時進行數據交換。 首先會介紹USB的結構和特點,包括總線特徵、協議定義、傳輸方式和電源管理等等。這部分內容會使USB開發者和用戶對USB有一整體的認識。

    標簽: USB

    上傳時間: 2015-10-18

    上傳用戶:lixinxiang

  • ABBYY FineReader 8.0專業版是最新、最準確的ABBYY OCR軟體版本。它可以為用戶提供 最高級別識字精確率

    ABBYY FineReader 8.0專業版是最新、最準確的ABBYY OCR軟體版本。它可以為用戶提供 最高級別識字精確率,是一個非常節省時間的好方案。FineReader允許你將各種紙張和 電子文件轉換、編輯以及重新使用,包括:雜誌、報紙、傳真、複製和PDF文件。

    標簽: ABBYY FineReader 8.0 OCR

    上傳時間: 2016-02-11

    上傳用戶:q123321

  • 俄羅斯方塊

    俄羅斯方塊,畫面比較好看 哦 運行時必需按轉了 ANT 如果已安裝,就直接雙擊Build.bat 然後雙擊Run.bat 關於代碼中的注釋如果出現亂碼,你就把原始檔案用word打開 然後 工具->語言->中文簡繁轉換

    標簽: 俄羅斯方塊

    上傳時間: 2016-08-28

    上傳用戶:xjz632

  • 如果您是從使用的角度來看JSF

    如果您是從使用的角度來看JSF,則您不用理會HTTP、資料轉換等細節,JSF將細節都隱藏起來了,無論您是網頁設計人員或是應用程式設計人員,都可以使用自己熟悉的方式來看JSF。

    標簽: JSF 角度

    上傳時間: 2016-12-10

    上傳用戶:lijinchuan

  • 量測可變電阻的類比電壓值

    量測可變電阻的類比電壓值,並將10位元的良測結果轉換成ASCII編碼,並輸出到個人電腦上的終端機

    標簽:

    上傳時間: 2014-01-19

    上傳用戶:hzy5825468

  • 花錢購買的C51學習板里的源碼

    花錢購買的C51學習板里的源碼,包括電路圖,源碼和hex文件,參照圖紙接線后,直接燒錄可運行。 內容齊全,包括鍵盤,數碼管,溫度顯示芯片,LCD,ADC數模轉換,時鐘顯示芯片,連接電腦鍵盤,與電腦通信,蜂鳴器,紅外遙控等。。。單片機入門好資料

    標簽: C51 源碼

    上傳時間: 2017-04-28

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  • ADS8329 Verilog fpga 驅動源碼 2.7V 至 5.5V 16 位 1MSPS 串

    ADS8329 Verilog fpga 驅動源碼,2.7V 至 5.5V 16 位 1MSPS 串行模數轉換器 ADC芯片ADS8329數據采集的verilog代碼,已經用在工程中,可以做為你的設計參考。( input clock,  input timer_clk_r, input reset,  output reg sample_over,  output reg ad_convn,  input ad_eocn,  output reg ad_csn,  output reg ad_clk,  input ad_dout,  output reg ad_din,  output reg [15:0] ad_data_lock);reg [15:0] ad_data_old;reg [15:0] ad_data_new;  reg [19:0] ad_data_temp; reg [15:0] ad_data;reg [4:0]  ad_data_cnt;reg [4:0]  ad_spi_cnt; reg [5:0]  time_dly_cnt;   parameter [3:0] state_mac_IDLE = 0,                state_mac_0 = 1,                state_mac_1 = 2,                state_mac_2 = 3,                state_mac_3 = 4,                state_mac_4 = 5,                state_mac_5 = 6,                state_mac_6 = 7,     state_mac_7 = 8,                state_mac_8 = 9,                state_mac_9 = 10,     state_mac_10 = 11,                state_mac_11 = 12,                state_mac_12 = 13,     state_mac_13 = 14,                state_mac_14 = 15; reg [3:0] state_curr;reg [3:0] state_next;

    標簽: ads8329 verilog fpga 驅動

    上傳時間: 2022-01-30

    上傳用戶:1208020161

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