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模糊圖像

  • 基于FPGA的視頻圖像畫面分割器的設(shè)計(jì).rar

    視頻監(jiān)控一直是人們關(guān)注的應(yīng)用技術(shù)熱點(diǎn)之一,它以其直觀、方便、信息內(nèi)容豐富而被廣泛用于在電視臺(tái)、銀行、商場(chǎng)等場(chǎng)合。在視頻圖像監(jiān)控系統(tǒng)中,經(jīng)常需要對(duì)多路視頻信號(hào)進(jìn)行實(shí)時(shí)監(jiān)控,如果每一路視頻信號(hào)都占用一個(gè)監(jiān)視器屏幕,則會(huì)大大增加系統(tǒng)成本。視頻圖像畫面分割器主要功能是完成多路視頻信號(hào)合成一路在監(jiān)視器顯示,是視頻監(jiān)控系統(tǒng)的核心部分。 傳統(tǒng)的基于分立數(shù)字邏輯電路甚至DSP芯片設(shè)計(jì)的畫面分割器的體積較大且成本較高。為此,本文介紹了一種基于FPGA技術(shù)的視頻圖像畫面分割器的設(shè)計(jì)與實(shí)現(xiàn)。 本文對(duì)視頻圖像畫面分割技術(shù)進(jìn)行了分析,完成了基于ITU-RBT.656視頻數(shù)據(jù)格式的畫面分割方法設(shè)計(jì);系統(tǒng)采用Xilinx公司的FPGA作為核心控制器,設(shè)計(jì)了視頻圖像畫面分割器的硬件電路,該電路在FPGA中,將數(shù)字電路集成在一起,電路結(jié)構(gòu)簡潔,具有較好的穩(wěn)定性和靈活性;在硬件電路平臺(tái)基礎(chǔ)上,以四路視頻圖像分割為例,完成了I2C總線接口模塊,異步FIFO模塊,有效視頻圖像數(shù)據(jù)提取模塊,圖像存儲(chǔ)控制模塊和圖像合成模塊的設(shè)計(jì),首先,由攝像頭采集四路模擬視頻信號(hào),經(jīng)視頻解碼芯片轉(zhuǎn)換為數(shù)字視頻圖像信號(hào)后送入異步FIFO緩沖。然后,根據(jù)畫面分割需要進(jìn)行視頻圖像數(shù)據(jù)抽取,并將抽取的視頻圖像數(shù)據(jù)按照一定的規(guī)則存儲(chǔ)到圖像存儲(chǔ)器。最后,按照數(shù)字視頻圖像的數(shù)據(jù)格式,將四路視頻圖像合成一路編碼輸出,實(shí)現(xiàn)了四路視頻圖像分割的功能。從而驗(yàn)證了電路設(shè)計(jì)和分割方法的正確性。 本文通過由FPGA實(shí)現(xiàn)多路視頻圖像的采集、存儲(chǔ)和合成等邏輯控制功能,I2C總線對(duì)兩片視頻解碼器進(jìn)行動(dòng)態(tài)配置等方法,實(shí)現(xiàn)四路視頻圖像的輪流采集、存儲(chǔ)和圖像的合成,提高了系統(tǒng)集成度,并可根據(jù)系統(tǒng)需要修改設(shè)計(jì)和進(jìn)一步擴(kuò)展功能,同時(shí)提高了系統(tǒng)的靈活性。

    標(biāo)簽: FPGA 視頻圖像 畫面分割器

    上傳時(shí)間: 2013-04-24

    上傳用戶:gundan

  • 視頻圖像采集和預(yù)處理系統(tǒng)的FPGA實(shí)現(xiàn).rar

    本文研究的視頻處理系統(tǒng)是上海市科委技術(shù)攻關(guān)基金項(xiàng)目“計(jì)算機(jī)視覺及其芯片化實(shí)現(xiàn)”的一部分,主要完成計(jì)算機(jī)視覺系統(tǒng)的一些基本工作,即視頻圖像的采集、預(yù)處理和顯示等。 視頻圖像采集和預(yù)處理系統(tǒng)以Xilinx公司Virtex-ⅡPro系列的FPGA為核心控制器件,結(jié)合視頻模數(shù)轉(zhuǎn)換芯片和VGA顯示器,完成視頻圖像的實(shí)時(shí)采集、預(yù)處理和顯示。采集和顯示部分作為同外界交流信息的渠道,是構(gòu)成計(jì)算機(jī)視覺系統(tǒng)必不可少的一部分;圖像預(yù)處理則是計(jì)算機(jī)視覺系統(tǒng)進(jìn)行高層處理的基礎(chǔ),優(yōu)秀的預(yù)處理算法能有效改善圖像質(zhì)量,提高系統(tǒng)分析判斷的準(zhǔn)確性。 本文在介紹基于FPGA的視頻采集、預(yù)處理系統(tǒng)整體架構(gòu)的基礎(chǔ)上,圍繞以下四個(gè)方面展開了工作: 1.研究并給出了兩種基于FPGA的設(shè)計(jì)方案用于實(shí)現(xiàn)YCrCb色度空間到RGB色度空間的轉(zhuǎn)換; 2.針對(duì)采集的視頻圖像,根據(jù)VGA顯示的要求,給出了一種實(shí)現(xiàn)圖像去隔行的方案; 3.分析了一系列圖像濾波的預(yù)處理算法,如均值濾波、中值濾波和自適應(yīng)濾波等,在比較和總結(jié)各算法特點(diǎn)的基礎(chǔ)上,提出了一種新的適用于處理混合噪聲的濾波算法:混合自適應(yīng)濾波法; 4.根據(jù)算法特點(diǎn)設(shè)計(jì)了多種采用FPGA實(shí)現(xiàn)的圖像濾波算法,并對(duì)硬件算法進(jìn)行RTL級(jí)的功能仿真和驗(yàn)證,還給出了各種濾波算法的實(shí)驗(yàn)結(jié)果,在此基礎(chǔ)上對(duì)各種算法的效果進(jìn)行直觀的比較。 文中,預(yù)處理算法的實(shí)現(xiàn)充分利用了FPGA的片內(nèi)資源,體現(xiàn)了FPGA在圖像處理方面的特點(diǎn)及優(yōu)勢(shì)。同時(shí),視頻采集和顯示的控制模塊也由同一FPGA芯片實(shí)現(xiàn),從而簡化了系統(tǒng)整體結(jié)構(gòu)。視頻采集和預(yù)處理系統(tǒng)在FPGA上的成功實(shí)現(xiàn)為“計(jì)算機(jī)視覺及其芯片化實(shí)現(xiàn)”奠定了必要的基礎(chǔ)、提供了一定理論依據(jù)。

    標(biāo)簽: FPGA 視頻圖像

    上傳時(shí)間: 2013-07-26

    上傳用戶:alia

  • 基于FPGA的圖像處理算法研究及硬件設(shè)計(jì).rar

    隨著圖像分辨率的越來越高,軟件實(shí)現(xiàn)的圖像處理無法滿足實(shí)時(shí)性的需求;同時(shí)FPGA等可編程器件的快速發(fā)展使得硬件實(shí)現(xiàn)圖像處理變得可行。如今基于FPGA的圖像處理研究成為了國內(nèi)外的一個(gè)熱門領(lǐng)域。 本文在FPGA平臺(tái)上,用Verilog HDL實(shí)現(xiàn)了一個(gè)研究圖像處理算法的可重復(fù)配置的硬件模塊架構(gòu),架構(gòu)包括PC機(jī)預(yù)處理和通信軟件,控制模塊,計(jì)算單元,存儲(chǔ)器模塊和通信適配模塊五個(gè)部分。其中的計(jì)算模塊負(fù)責(zé)具體算法的實(shí)現(xiàn),根據(jù)不同的圖像處理算法可以獨(dú)立實(shí)現(xiàn)。架構(gòu)為計(jì)算模塊實(shí)現(xiàn)了一個(gè)可添加、移出接口,不同的算法設(shè)計(jì)只要符合該接口就可以方便的加入到模塊架構(gòu)中來進(jìn)行調(diào)試和運(yùn)行。 在硬件架構(gòu)的基礎(chǔ)上本文實(shí)現(xiàn)了排序?yàn)V波,中值濾波,卷積運(yùn)算及高斯濾波,形態(tài)學(xué)算子運(yùn)算等經(jīng)典的圖像處理算法。討論了FPGA的圖像處理算法的設(shè)計(jì)方法及優(yōu)化策略,通過性能分析,F(xiàn)PGA實(shí)現(xiàn)圖像處理在時(shí)間上比軟件處理有了很大的提高;通過結(jié)果的比較,發(fā)現(xiàn)FPGA的處理結(jié)果達(dá)到了軟件處理幾乎同等的效果水平。最后本文在實(shí)現(xiàn)較大圖片處理和圖像處理窗口的大小可配置性方面做了一定程度的討論和改進(jìn),提高了算法的可用性,同時(shí)為進(jìn)一步的研究提供了更加便利的平臺(tái)。 整個(gè)設(shè)計(jì)都是在ISE8.2和ModelSim第三方仿真軟件環(huán)境下開發(fā)的,在xilinx的Spartan-3E XC3S500E硬件平臺(tái)上實(shí)現(xiàn)。在軟件仿真過程中利用了ISE8.2自帶仿真工具和ModelSim結(jié)合使用。 本課題為制造FPGA的專用圖像處理芯片做了有益的探索性研究,為實(shí)現(xiàn)FPGA為核心處理芯片的實(shí)時(shí)圖像處理系統(tǒng)有著積極的作用。

    標(biāo)簽: FPGA 圖像處理 算法研究

    上傳時(shí)間: 2013-07-29

    上傳用戶:愛順不順

  • 視頻格式轉(zhuǎn)換算法研究及FPGA實(shí)現(xiàn)——去隔行、幀頻轉(zhuǎn)換、分辨率變換.rar

    在當(dāng)今的廣播系統(tǒng)中,絕大部分的視頻信號(hào)是隔行采樣的。采用這種掃描格式,能夠大幅度地減少視頻的帶寬,但也會(huì)引起彩色爬行、畫面閃爍、邊緣模糊及鋸齒等現(xiàn)象。這種缺陷經(jīng)人尺寸屏幕放大后就更加明顯。為改善畫面的視覺效果,去隔行技術(shù)應(yīng)運(yùn)而生。同時(shí),視頻信號(hào)本身的低幀頻也會(huì)導(dǎo)致行抖動(dòng)、線爬行以及大面積閃爍等視覺效果上的缺陷。增加掃描頻率會(huì)把這些視覺缺陷搬移到人眼不敏感的高頻區(qū)域上去從而產(chǎn)生較好的主觀圖象質(zhì)量。而為了適應(yīng)不同顯示終端以及對(duì)圖像大小變化的要求就必須對(duì)原始信號(hào)分辨率即每幀行數(shù)和每行像素?cái)?shù)進(jìn)行變換。因此去隔行、幀頻轉(zhuǎn)換、分辨率變換成為視頻格式轉(zhuǎn)換的基本內(nèi)容。 FPGA 的出現(xiàn)是VLSI技術(shù)和EDA技術(shù)發(fā)展的結(jié)果。FPGA器件集成度高、體積小,具有通過用戶編程實(shí)現(xiàn)專門應(yīng)用的功能。它允許電路設(shè)計(jì)者利用基于計(jì)算機(jī)的開發(fā)平臺(tái),經(jīng)過設(shè)計(jì)輸入、仿真、測(cè)試和校驗(yàn),直到達(dá)到預(yù)期的結(jié)果。使用FPGA器件可以大大縮短系統(tǒng)的研制周期,減少資金投入。另外采用FPGA器件可以將原來的電路板級(jí)產(chǎn)品集成芯片級(jí)產(chǎn)品,從而降低了功耗,提高了可靠性,同時(shí)還可以很方便的對(duì)設(shè)計(jì)進(jìn)行在線修改。 該文在介紹了視頻格式轉(zhuǎn)換中的主要算法后,重點(diǎn)對(duì)去隔行、幀頻轉(zhuǎn)換、分辨率變換的FPGA綜合實(shí)現(xiàn)方案進(jìn)行了由簡單到復(fù)雜的深入研究,分別給出了最簡解決方案、基于非線性算法的解決方案和基于運(yùn)動(dòng)補(bǔ)償?shù)慕鉀Q方案。最簡解決方案利用線性算法將去隔行,幀頻轉(zhuǎn)換,分辨率變換三項(xiàng)處理同時(shí)實(shí)現(xiàn),達(dá)到FPGA內(nèi)部資源和外部RAM耗用量都為最小的要求,是后續(xù)復(fù)雜方案的基礎(chǔ)。其中去隔行采用場(chǎng)合并方式,幀頻轉(zhuǎn)換采用幀重復(fù)方式,分辨率變換采用均勻插值方式。基于非線性算法的解決方案中加入了對(duì)靜止區(qū)域的判斷,靜止區(qū)域的輸出像素值直接選用相應(yīng)位置的已存輸入數(shù)據(jù),非靜止區(qū)域的輸出像素值通過對(duì)已存輸入數(shù)據(jù)進(jìn)行非線性運(yùn)算得出。基于運(yùn)動(dòng)補(bǔ)償?shù)慕鉀Q方案在對(duì)靜止區(qū)域進(jìn)行判斷和處理的基礎(chǔ)上,對(duì)欲生成的變頻后的場(chǎng)間插值幀進(jìn)行運(yùn)動(dòng)估計(jì),根據(jù)運(yùn)動(dòng)矢量得出非靜止區(qū)域的輸出像素值。其中為求得輸入場(chǎng)間相應(yīng)時(shí)間位置上的插值幀輸出數(shù)據(jù),該方案采用了自定義的前后向塊匹配運(yùn)動(dòng)估計(jì)方式,通過對(duì)三步搜索算法的高效實(shí)現(xiàn),將SAD 值進(jìn)行比較得出運(yùn)動(dòng)矢量。

    標(biāo)簽: FPGA 視頻格式轉(zhuǎn)換 算法研究

    上傳時(shí)間: 2013-07-19

    上傳用戶:米卡

  • 基于FPGA的圖像壓縮系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn).rar

    隨著信息技術(shù)和計(jì)算機(jī)技術(shù)的飛速發(fā)展,數(shù)字信號(hào)處理已經(jīng)逐漸發(fā)展成一門關(guān)鍵的技術(shù)科學(xué)。圖像處理作為一種重要的現(xiàn)代技術(shù),己經(jīng)在通信、航空航天、遙感遙測(cè)、生物醫(yī)學(xué)、軍事、信息安全等領(lǐng)域得到廣泛的應(yīng)用。圖像處理特別是高分辨率圖像實(shí)時(shí)處理的實(shí)現(xiàn)技術(shù)對(duì)相關(guān)領(lǐng)域的發(fā)展具有深遠(yuǎn)意義。另外,現(xiàn)場(chǎng)可編程門陣列FPGA和高效率硬件描述語言Verilog HDL的結(jié)合,大大變革了電子系統(tǒng)的設(shè)計(jì)方法,加速了系統(tǒng)的設(shè)計(jì)進(jìn)程,為圖像壓縮系統(tǒng)的實(shí)現(xiàn)提供了硬件支持和軟件保障。 本文主要包括以下幾個(gè)方面的內(nèi)容: (1)結(jié)合某工程的具體需求,設(shè)計(jì)了一種基于FPGA的圖像壓縮系統(tǒng),核心硬件選用XILINX公司的Virtex-Ⅱ Pro系列FPGA芯片,存儲(chǔ)器件選用MICRON公司的MT48LC4M16A2SDRAM,圖像壓縮的核心算法選用近無損壓縮算法JPEG-LS。 (2)用Verilog硬件描述語言實(shí)現(xiàn)了JPEG-LS標(biāo)準(zhǔn)中的基本算法,為課題組成員進(jìn)行算法改進(jìn)提供了有力支持。 (3)用Verilog硬件描述語言設(shè)計(jì)并實(shí)現(xiàn)了SDRAM控制器模塊,使核心壓縮模塊能夠方便靈活地訪問片外存儲(chǔ)器。 (4)構(gòu)建了圖像壓縮系統(tǒng)的測(cè)試平臺(tái),對(duì)實(shí)現(xiàn)的SDRAM控制器模塊和JPEG-LS基本算法模塊進(jìn)行了軟件仿真測(cè)試和硬件測(cè)試,驗(yàn)證了其功能的正確性。

    標(biāo)簽: FPGA 圖像壓縮系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:a3318966

  • 基于FPGA的圖像處理算法的研究與硬件設(shè)計(jì).rar

    隨著微電子技術(shù)的高速發(fā)展,實(shí)時(shí)圖像處理在多媒體、圖像通信等領(lǐng)域有著越來越廣泛的應(yīng)用。FPGA就是硬件處理實(shí)時(shí)圖像數(shù)據(jù)的理想選擇,基于FPGA的圖像處理專用芯片的研究將成為信息產(chǎn)業(yè)的新熱點(diǎn)。 本文以FPGA為平臺(tái),使用VHDL硬件描述語言設(shè)計(jì)并實(shí)現(xiàn)了中值濾波、順序?yàn)V波、數(shù)學(xué)形態(tài)學(xué)、卷積運(yùn)算和高斯濾波等圖像處理算法。在設(shè)計(jì)過程中,通過改進(jìn)算法和優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性,采用流水線結(jié)構(gòu)優(yōu)化算法,提高了頂層濾波模塊的處理速度。在中值濾波器的硬件設(shè)計(jì)中,本文提出了一種快速中值濾波算法,該算法大大節(jié)省了硬件資源,處理速度也很快。在數(shù)學(xué)形態(tài)學(xué)算法的硬件實(shí)現(xiàn)中,本文提出的最大值濾波和最小值濾波算法大大減少了硬件資源的占用率,適應(yīng)了流水線設(shè)計(jì)的要求,提高了圖像處理速度。 整個(gè)設(shè)計(jì)及各個(gè)模塊都在Altera公司的開發(fā)環(huán)境QuartusⅡ以及第三方仿真軟件Modelsim上進(jìn)行了邏輯綜合以及仿真。綜合和仿真的結(jié)果表明,使用FPGA硬件處理圖像數(shù)據(jù)不僅能夠獲得很好的處理效果,達(dá)到較高的工作頻率,處理速度也遠(yuǎn)遠(yuǎn)高于軟件法處理圖像,可滿足實(shí)時(shí)圖像處理的要求。 本課題為圖像處理專用FPGA芯片的設(shè)計(jì)做了有益的探索性嘗試,對(duì)今后完成以FPGA圖像處理芯片為核心的實(shí)時(shí)圖像處理系統(tǒng)的設(shè)計(jì)有著積極的意義。

    標(biāo)簽: FPGA 圖像處理 法的研究

    上傳時(shí)間: 2013-06-08

    上傳用戶:shuiyuehen1987

  • 基于DSPFPGA的圖像識(shí)別系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn).rar

    近年來,圖像處理與識(shí)別技術(shù)得到了迅速的發(fā)展。人們已經(jīng)充分認(rèn)識(shí)到圖像處理和識(shí)別技術(shù)是認(rèn)識(shí)世界、改造世界的重要手段。目前,圖像識(shí)別技術(shù)已應(yīng)用到很多領(lǐng)域,滲入到各行各業(yè),在醫(yī)學(xué)、公安、交通、工業(yè)等領(lǐng)域具有廣闊的應(yīng)用前景。 這篇論文介紹了一種基于DSP+FPGA構(gòu)架的實(shí)時(shí)圖像識(shí)別系統(tǒng)。DSP作為圖像識(shí)別模塊的核心,負(fù)責(zé)圖像識(shí)別算法的實(shí)現(xiàn);FPGA作為圖像采集模塊的核心,負(fù)責(zé)圖像的采集,并且完成預(yù)處理工作。圖像識(shí)別算法的運(yùn)算量大,并且控制復(fù)雜,對(duì)系統(tǒng)的性能要求很高。DSP的特殊結(jié)構(gòu)和優(yōu)良性能很好地滿足了系統(tǒng)的需要,而FPGA的高速性和靈活性也保證了系統(tǒng)實(shí)時(shí)性,并且簡化了外圍電路,減少了系統(tǒng)設(shè)計(jì)難度。 系統(tǒng)使用模板匹配和神經(jīng)網(wǎng)絡(luò)算法對(duì)數(shù)字0~9進(jìn)行識(shí)別。模板匹配一般適用于識(shí)別規(guī)范化的數(shù)字、字符等小型字符集(特別是同一字體的字符集)。由于結(jié)構(gòu)比較簡單,系統(tǒng)處理能力強(qiáng),模板匹配的識(shí)別速度快并且識(shí)別率高,取得很好的效果。神經(jīng)網(wǎng)絡(luò)所具有的分布式存儲(chǔ)、高容錯(cuò)性、自組織和自學(xué)習(xí)功能,使其對(duì)圖像識(shí)別問題顯示出極大的優(yōu)越性。 研究表明,在DSP+FPGA的構(gòu)架上實(shí)現(xiàn)的圖像識(shí)別系統(tǒng),具有結(jié)構(gòu)靈活、通用性強(qiáng)的特點(diǎn),適用于模塊化設(shè)計(jì),有利于提高算法的效率。系統(tǒng)可以充分發(fā)揮和結(jié)合DSP和FPGA的優(yōu)勢(shì),準(zhǔn)確快速地實(shí)現(xiàn)圖像識(shí)別。通過軟、硬件的靈活組合,系統(tǒng)可以實(shí)現(xiàn)圖像處理大部分的相關(guān)功能,使之能夠運(yùn)用到工業(yè)視覺檢測(cè)、汽車牌照識(shí)別等系統(tǒng)中。

    標(biāo)簽: DSPFPGA 圖像識(shí)別 系統(tǒng)設(shè)計(jì)

    上傳時(shí)間: 2013-06-18

    上傳用戶:com1com2

  • 作物葉片圖像采集系統(tǒng)的研究與設(shè)計(jì)

    本文研制了一套基于數(shù)碼相機(jī)的圖像采集系統(tǒng),用于拍攝作物葉片。該系統(tǒng)采用漫反射式的多光源正面照明設(shè)計(jì)方案,具有實(shí)時(shí)、高效、可控的特點(diǎn)。研究通過正交試驗(yàn)對(duì)照明系統(tǒng)參數(shù)進(jìn)行優(yōu)化,運(yùn)用matlab 對(duì)

    標(biāo)簽: 圖像采集系統(tǒng)

    上傳時(shí)間: 2013-07-30

    上傳用戶:xlcky

  • 基于DSP+FPGA的小波變換實(shí)時(shí)圖像處理系統(tǒng)設(shè)計(jì)

      本課題設(shè)計(jì)和完成了一套基于DSP+FPGA結(jié)構(gòu)的小波變換實(shí)時(shí)圖像處理系統(tǒng)。采用小波算法對(duì)圖像進(jìn)行邊緣提取、圖像增強(qiáng)、圖像融合等處理,并在ADSP-BF535上實(shí)現(xiàn)了小波算法,分析了其運(yùn)行小波算法的性能。圖像處理的數(shù)據(jù)量比較大,而且運(yùn)算比較復(fù)雜,DSP的特殊結(jié)構(gòu)和性能很好地滿足了系統(tǒng)實(shí)現(xiàn)的需要,而FPGA的高速性和靈活性也滿足了系統(tǒng)實(shí)時(shí)性和穩(wěn)定性的需要,所以采用DSP+FPGA來實(shí)現(xiàn)圖像處理系統(tǒng)是可靠的,也是可行的。系統(tǒng)的硬件設(shè)計(jì)以DSP和FPGA為平臺(tái),DSP實(shí)現(xiàn)算法、管理系統(tǒng)運(yùn)行、并實(shí)現(xiàn)了系統(tǒng)的自啟動(dòng);FPGA實(shí)現(xiàn)一些接口、時(shí)序控制等,簡化了外圍電路,提高了系統(tǒng)的可靠性。結(jié)果表明,在ADSP-BF535上實(shí)現(xiàn)小波算法,效果良好,而且滿足系統(tǒng)實(shí)時(shí)性的要求。最后,總結(jié)了系統(tǒng)的設(shè)計(jì)和調(diào)試經(jīng)驗(yàn),對(duì)調(diào)試時(shí)遇到的一些問題進(jìn)行了分析。

    標(biāo)簽: FPGA DSP 小波變換 實(shí)時(shí)圖像

    上傳時(shí)間: 2013-04-24

    上傳用戶:Kecpolo

  • 基于FPGA的模糊控制器的設(shè)計(jì)與實(shí)現(xiàn)

    模糊控制是智能控制的重要組成部分,它能對(duì)那些不能建立精確數(shù)學(xué)模型的場(chǎng)合進(jìn)行有效的控制;近年來,F(xiàn)PGA及EDA技術(shù)發(fā)展迅速。本論文就是要結(jié)合這兩種先進(jìn)技術(shù),在一塊FPGA芯片上實(shí)現(xiàn)一個(gè)雙輸入單輸出的模糊控制器,并嘗試將ADC和DAC集成在該芯片中,以簡化系統(tǒng)設(shè)計(jì)。 首先闡述了模糊控制的理論基礎(chǔ),重點(diǎn)介紹了雙輸入單輸出的模糊控制算法;然后在簡單介紹FPGA結(jié)構(gòu)和VHDL語言的基礎(chǔ)上,采用自項(xiàng)向下的設(shè)計(jì)方法,應(yīng)用主流EDA工具進(jìn)行模糊控制各模塊的設(shè)計(jì),并對(duì)每個(gè)模塊進(jìn)行仿真;最后將各模塊組成一完整的模糊控制器,在EDA工具上進(jìn)行仿真驗(yàn)證和編程下載,并用一個(gè)溫度控制實(shí)驗(yàn)驗(yàn)證了控制器的功能,證明該控制器滿足一般控制應(yīng)用的要求。 本論文是以VHDL和FPGA為代表的現(xiàn)代數(shù)字系統(tǒng)設(shè)計(jì)技術(shù)在智能控制領(lǐng)域應(yīng)用的一個(gè)嘗試,拓寬了模糊控制器的實(shí)現(xiàn)形式,相比于傳統(tǒng)的以單片機(jī)為載體的模糊控制器,在系統(tǒng)的簡單性、實(shí)時(shí)性和經(jīng)濟(jì)性方面都有顯著的增強(qiáng),是一種值得采用的方法。 由于在算法的處理上采取了一定的簡化,所以損失了一定的精度。今后可以在算法上進(jìn)行完善,設(shè)計(jì)出高精度的模糊控制器。

    標(biāo)簽: FPGA 模糊控制器

    上傳時(shí)間: 2013-06-07

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