使用硬體描述語言HDL 設(shè)計(jì)硬體電路,臺(tái)灣人寫的PPT講義,非常不錯(cuò)。VHDL硬件設(shè)計(jì)入門學(xué)習(xí)。VHDL基本語法架構(gòu),VHDL的零件庫(Library)及包裝(Package)等內(nèi)容。
標(biāo)簽: HDL
上傳時(shí)間: 2014-01-22
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介紹can總線協(xié)議的一本好書,可以好好學(xué)習(xí)下的
標(biāo)簽: can
上傳時(shí)間: 2014-08-13
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JavaScript 和Java 除了在名字上有一點(diǎn)類似之外,JavaScript 也支援部分Java 的語法及基本的流程控制結(jié)構(gòu)。不過,除此之外, 這兩者有結(jié)構(gòu)性的差異。
標(biāo)簽: JavaScript Java
上傳時(shí)間: 2016-05-28
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這個(gè)檔案裡面的matlab的m函數(shù),產(chǎn)生有效的都普勒fd隨機(jī)相關(guān)的瑞利衰減包絡(luò),可以輸入你想要的doppler ferquecy和sampling ferquecy
標(biāo)簽: matlab
上傳時(shí)間: 2013-12-21
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產(chǎn)生頻率選擇性衰落的雷利通道,參數(shù)由天線結(jié)構(gòu)、OFDM系統(tǒng)的結(jié)構(gòu)與功率延時(shí)結(jié)構(gòu)來決定。
標(biāo)簽:
上傳時(shí)間: 2014-12-20
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GenDriver即簡(jiǎn)單的資料流驅(qū)動(dòng)程式,雖未跟硬體溝通,但匯出10個(gè)進(jìn)入點(diǎn),可被任何Windows CE系統(tǒng)所載入。為讓系統(tǒng)載入GenDriver可在系統(tǒng)啟動(dòng)時(shí),加入任何[HKEY_LOCAL_MACHINE]\Drivers\Builtin下的項(xiàng)目,讓驅(qū)動(dòng)程式載入,或撰寫一個(gè)應(yīng)用程式,在別處建立驅(qū)動(dòng)程式機(jī)碥並呼叫ActivateDevice
標(biāo)簽: GenDriver 驅(qū)動(dòng) 程式
上傳時(shí)間: 2016-06-24
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asterisk 計(jì)費(fèi)模塊,提供軟交換機(jī)計(jì)費(fèi)之用。
標(biāo)簽: asterisk 模
上傳時(shí)間: 2014-01-08
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實(shí)現(xiàn)髮送信息,簡(jiǎn)單 初學(xué)
上傳時(shí)間: 2013-12-01
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目前網(wǎng)路流行的網(wǎng)頁遊戲(travian),配合firefox排程外掛,可以協(xié)助玩家計(jì)算建築物排程,本程式為javascript+xml方式,適合ajax初學(xué)者使用學(xué)習(xí),請(qǐng)務(wù)必掛於伺服器中才能穩(wěn)定執(zhí)行
標(biāo)簽: travian firefox
上傳時(shí)間: 2016-08-05
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OPEN-JTAG ARM JTAG 測(cè)試原理 1 前言 本篇報(bào)告主要介紹ARM JTAG測(cè)試的基本原理。基本的內(nèi)容包括了TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的介紹,在此基礎(chǔ)上,結(jié)合ARM7TDMI詳細(xì)介紹了的JTAG測(cè)試原理。 2 IEEE Standard 1149.1 - Test Access Port and Boundary-Scan Architecture 從IEEE的JTAG測(cè)試標(biāo)準(zhǔn)開始,JTAG是JOINT TEST ACTION GROUP的簡(jiǎn)稱。IEEE 1149.1標(biāo)準(zhǔn)最初是由JTAG這個(gè)組織提出,最終由IEEE批準(zhǔn)並且標(biāo)準(zhǔn)化,所以,IEEE 1149.1這個(gè)標(biāo)準(zhǔn)一般也俗稱JTAG測(cè)試標(biāo)準(zhǔn)。 接下來介紹TAP (TEST ACCESS PORT) 和BOUNDARY-SCAN ARCHITECTURE的基本架構(gòu)。
標(biāo)簽: JTAG BOUNDARY-SCAN OPEN-JTAG ARM
上傳時(shí)間: 2016-08-16
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