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正弦振動

在C5000系列DSP上實現正弦波發生器

在C5000系列DSP上實現正弦波發生器

標簽： C5000 DSP 正弦波發生器

上傳時間： 2013-12-20

上傳用戶：417313137
在中斷4中采集數據并進行fir濾波；源數據中有兩個頻率的正弦波；濾除其中的一個；

在中斷4中采集數據并進行fir濾波；源數據中有兩個頻率的正弦波；濾除其中的一個；

標簽： fir 中斷采集數據濾波

上傳時間： 2015-08-31

上傳用戶：qilin
在MAGE128中使用完整漢字庫使用液晶為12264使用內部8M晶振

在MAGE128中使用完整漢字庫使用液晶為12264使用內部8M晶振

標簽： 12264 MAGE 128 漢字庫

上傳時間： 2013-12-29

上傳用戶：離殤
摘要：本文件是C8051單片機AD測試實驗；使用外部22.1184MHz晶振,將跳線器JP3短接功能：采樣AIN0

摘要：本文件是C8051單片機AD測試實驗；使用外部22.1184MHz晶振,將跳線器JP3短接功能：采樣AIN0，1和溫度通道信號，并在LCD上顯示其電壓和溫度值，也可以應用Uart0顯示其電壓和溫度值。

標簽： 22.1184 C8051 AIN0 MHz

上傳時間： 2013-12-16

上傳用戶：frank1234
摘要：本文件是C8051單片機延時測試程序；LED燈每隔1秒亮1秒使用外部22.1184MHz晶振.

摘要：本文件是C8051單片機延時測試程序；LED燈每隔1秒亮1秒使用外部22.1184MHz晶振.

標簽： 22.1184 C8051 LED MHz

上傳時間： 2014-01-04

上傳用戶：tzl1975
摘要：本文件是C8051單片機FLASH讀寫測試實驗；使用外部22.1184MHz晶振. 利用PC機控制FLASH讀寫文件

摘要：本文件是C8051單片機FLASH讀寫測試實驗；使用外部22.1184MHz晶振. 利用PC機控制FLASH讀寫文件，擦除芯片等功能。使用外部22.1184MHz晶振。必須使用光盤中附帶的字庫文件和Fsend.exe字庫下載專用應用程序。flash地址范圍：0x00000--0x3ffff 燒寫字庫方法：先下載該FALSH讀寫程序，在打開GB2312字庫下栽程序FSend.exe，選擇字庫文件GB2312_NEW.dat 并發送，這時候開發板上D7 LED會快速閃爍，等下載完成后，此燈會間隔1秒閃爍。再下載flash_gb目錄的測試程序，讀取字庫并顯示。

標簽： FLASH 22.1184 C8051 MHz

上傳時間： 2013-12-19

上傳用戶：陽光少年2016
摘要：本文件是C8051單片機字庫（GB2312）測試實驗程序；使用外部22.1184MHz晶振. 功能：定義 0 ~ 3 、 A 、 F 為功能鍵。按"A" 鍵顯示輸入位碼界面

摘要：本文件是C8051單片機字庫（GB2312）測試實驗程序；使用外部22.1184MHz晶振. 功能：定義 0 ~ 3 、 A 、 F 為功能鍵。按"A" 鍵顯示輸入位碼界面，按 0 鍵頁位置加1，按 1 鍵字位置加1，按 2 鍵頁位置減1，按 3 鍵字位置減1，并在LCD上顯示該漢字。按"F"返回顯示待機界面。

標簽： 22.1184 C8051 2312 MHz

上傳時間： 2015-09-02

上傳用戶：rocketrevenge
摘要：本文件是C8051單片機字庫（GB2312）測試實驗程序；使用外部22.1184MHz晶振. 調用Flash字庫

摘要：本文件是C8051單片機字庫（GB2312）測試實驗程序；使用外部22.1184MHz晶振. 調用Flash字庫，不用區位碼連續寫漢字.

標簽： 22.1184 C8051 Flash 2312

上傳時間： 2014-01-01

上傳用戶：lo25643
摘要：本文件是C8051單片機LED燈閃碩實驗程序；LED燈每隔1秒亮1秒使用外部22.1184MHz晶振。

摘要：本文件是C8051單片機LED燈閃碩實驗程序；LED燈每隔1秒亮1秒使用外部22.1184MHz晶振。

標簽： LED 22.1184 C8051 MHz

上傳時間： 2014-11-23

上傳用戶：zhangyigenius
2006altera大賽－基于軟核Nios的寬譜正弦信號發生器設計：摘要：本設計運用了基于 Nios II 嵌入式處理器的 SOPC 技術。系統以 ALTERA公司的 Cyclone 系列 FPGA

2006altera大賽－基于軟核Nios的寬譜正弦信號發生器設計：摘要：本設計運用了基于 Nios II 嵌入式處理器的 SOPC 技術。系統以 ALTERA公司的 Cyclone 系列 FPGA 為數字平臺，將微處理器、總線、數字頻率合成器、存儲器和 I/O 接口等硬件設備集中在一片 FPGA 上，利用直接數字頻率合成技術、數字調制技術實現所要求波形的產生，用 FPGA 中的 ROM 儲存 DDS 所需的波形表，充分利用片上資源，提高了系統的精確度、穩定性和抗干擾性能。使用新的數字信號處理（DSP）技術，通過在 Nios 中軟件編程解決不同的調制方式的實現和選擇。系統頻率實現 1Hz～20MHz 可調，步進達到了1Hz；完成了調幅、調頻、二進制 PSK、二進制 ASK、二進制 FSK 調制和掃頻輸出的功能。

標簽： Nios Cyclone altera ALTERA

上傳時間： 2015-09-02

上傳用戶：coeus

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