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汽車報(bào)(bào)警

  • 基于ARM的雷達(dá)信號(hào)處理系統(tǒng)的研究

    隨著信息技術(shù)的飛速發(fā)展,人們對(duì)數(shù)據(jù)采集、信號(hào)處理的要求越來(lái)越高:不僅要求高速、高精度和高實(shí)時(shí),還要求數(shù)據(jù)采集,處理設(shè)備便攜化、網(wǎng)絡(luò)化和智能化,并具有友好的人機(jī)界面。傳統(tǒng)的8/16位單片機(jī)因資源極度受限,難以滿足上述要求;而傳統(tǒng)的信號(hào)處理過(guò)程都是依賴于PC完成,則存在著安裝麻煩、價(jià)格昂貴且電磁兼容性差等缺點(diǎn)。 嵌入式系統(tǒng)是一個(gè)快速發(fā)展的領(lǐng)域,嵌入式系統(tǒng)的研究?jī)?nèi)容涉及到計(jì)算機(jī)學(xué)科的各個(gè)方面。將嵌入式系統(tǒng)引入雷達(dá)信號(hào)處理系統(tǒng),能極大的提高系統(tǒng)的實(shí)時(shí)性和靈活性。本文的研究正是基于ARM的雷達(dá)信號(hào)處理系統(tǒng)。 本文在對(duì)線性調(diào)頻連續(xù)波雷達(dá)測(cè)速測(cè)距研究的基礎(chǔ)上,討論了一種軟硬件配置靈活、結(jié)構(gòu)精簡(jiǎn)的雷達(dá)信號(hào)處理系統(tǒng),其硬件平臺(tái)以ARM處理器,可編程邏輯器件FPGA,和DSP為核心,擴(kuò)展了UART、LCD、網(wǎng)口、IDE、觸摸屏、PS/2和USB等外圍接口,可實(shí)現(xiàn)對(duì)線性調(diào)頻連續(xù)波雷達(dá)回波信號(hào)進(jìn)行數(shù)據(jù)采集、脈沖壓縮、恒虛警檢測(cè)、航跡相關(guān),航跡顯示等處理,相關(guān)數(shù)據(jù)的存儲(chǔ)。在軟件設(shè)計(jì)方面,完成Bootloader,Linux2.4操作系統(tǒng)在系統(tǒng)上的移植,在此基礎(chǔ)上對(duì)實(shí)現(xiàn)了對(duì)網(wǎng)口、IDE、LCD等模塊的驅(qū)動(dòng)程序編寫,并在MiniGUI上進(jìn)行基于顯示終端需求的圖形用戶界面開發(fā)。

    標(biāo)簽: ARM 雷達(dá)信號(hào) 處理系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:Shoen

  • 基于FPGA實(shí)現(xiàn)雷達(dá)信號(hào)處理和圖像顯示

    在船舶交管系統(tǒng)中,雷達(dá)信息處理是最重要的組成部分。視頻回波處理中的雜波處理要求實(shí)時(shí)性很高,大約要在一個(gè)距離單元的時(shí)間(0.05-0.1us)內(nèi)完成。雜波處理如恒虛警處理本身比較復(fù)雜,這類處理過(guò)程又要求快速,圖像顯示系統(tǒng)要求及時(shí)的把接收到的雷達(dá)方位數(shù)據(jù)從極坐標(biāo)轉(zhuǎn)換成直角坐標(biāo)。在軟件上實(shí)現(xiàn)這些算法雖然精度可以達(dá)到,但是實(shí)時(shí)性問(wèn)題不能滿足。因此這類問(wèn)題多采用高速專用數(shù)字設(shè)備來(lái)實(shí)現(xiàn)。FPGA在數(shù)字信號(hào)處理領(lǐng)域有非常廣闊的應(yīng)用前景,以其優(yōu)良的性能在數(shù)字信號(hào)處理中發(fā)揮了重大的作用。CORDIC算法可以在硬件上以很高的精度實(shí)現(xiàn)一些函數(shù)和運(yùn)算。針對(duì)以上幾點(diǎn),本文提出了利用CORDIC算法,基于FPGA來(lái)實(shí)現(xiàn)雷達(dá)信號(hào)處理和圖像顯示的算法研究,用硬件來(lái)實(shí)現(xiàn)正弦、余弦、正切、乘法、除法、指數(shù)和對(duì)數(shù)等基本函數(shù)和運(yùn)算,把他們?cè)O(shè)計(jì)成為可重用的IP core,這樣可以滿足實(shí)時(shí)性和精度的問(wèn)題。從而在將來(lái)的算法研究中方便的調(diào)用,這樣在算法研究中可以節(jié)約大量的時(shí)間,在一定程度上降低研究的難度。 圍繞雷達(dá)信號(hào)處理和圖像顯示,本次課題設(shè)計(jì)主要做了如下工作: 1.對(duì)CORDIC算法進(jìn)行分析和研究,以及它在雷達(dá)信號(hào)處理和圖像顯示中的影響。 2.成功用硬件描述語(yǔ)言在Xilinx公司軟件ISE的環(huán)境下編寫代碼,在Synplify和Modelsim上做了綜合和仿真。 3.對(duì)實(shí)驗(yàn)結(jié)果進(jìn)行精度和速度分析。 4.對(duì)雷達(dá)信號(hào)處理和圖像顯示的相關(guān)算法進(jìn)行分析和研究。 5.從實(shí)例分析IP core的特點(diǎn),對(duì)算法研究的影響和IP core在雷達(dá)信號(hào)處理和圖像顯示中的應(yīng)用。 最終在實(shí)踐環(huán)節(jié),成功利用CORDIC算法,在FPGA上實(shí)現(xiàn)可重用的IP core,這些IP core能夠以很高的精度實(shí)現(xiàn)一些基本函數(shù)和運(yùn)算,在雷達(dá)信號(hào)處理與圖像顯示中起到很大的作用。

    標(biāo)簽: FPGA 雷達(dá)信號(hào)處理 圖像顯示

    上傳時(shí)間: 2013-07-16

    上傳用戶:steele

  • 基于FPGA的雷達(dá)信號(hào)偵察數(shù)字接收機(jī)

    隨著信號(hào)處理技術(shù)的進(jìn)步和電子技術(shù)的發(fā)展,雷達(dá)信號(hào)偵察接收機(jī)逐漸從模擬體制向數(shù)字體制轉(zhuǎn)變。軟件無(wú)線電概念的提出,促使雷達(dá)偵察接收機(jī)朝大帶寬、全截獲方向發(fā)展,現(xiàn)有的串行信號(hào)處理體制已經(jīng)很難滿足系統(tǒng)要求。FPGA器件的出現(xiàn),為實(shí)現(xiàn)寬帶雷達(dá)信號(hào)偵察數(shù)字接收機(jī)提供了硬件支持。 本文結(jié)合FPGA芯片特點(diǎn),在前人研究基礎(chǔ)上,從算法和硬件實(shí)現(xiàn)兩方面,對(duì)雷達(dá)信號(hào)偵察數(shù)字接收機(jī)若干關(guān)鍵技術(shù)進(jìn)行了研究和創(chuàng)新,主要研究?jī)?nèi)容包括以下幾個(gè)方面。 1)給出了基于QuartusII/Matlab和ISE/ModelSim/Matlab的兩種FPGA設(shè)計(jì)聯(lián)合仿真技術(shù)。這種聯(lián)合仿真技術(shù),大大提高了基于FPGA的雷達(dá)信號(hào)偵察數(shù)字接收機(jī)的設(shè)計(jì)效率。 2)給出了一種基于FFT/IFFT的寬帶數(shù)字正交變換算法,并將該算法在FPGA中進(jìn)行了硬件實(shí)現(xiàn),設(shè)計(jì)可對(duì)600MHz帶寬內(nèi)的輸入信號(hào)進(jìn)行實(shí)時(shí)正交變換。 3)提出了一種全并行結(jié)構(gòu)FFT的FPGA實(shí)現(xiàn)方案,并將其在FPGA芯片中進(jìn)行了硬件實(shí)現(xiàn),設(shè)計(jì)能夠在一個(gè)時(shí)鐘周期內(nèi)完成32點(diǎn)并行FFT運(yùn)算,滿足了數(shù)字信道化接收機(jī)對(duì)數(shù)據(jù)處理速度的要求。 4)提出了一種自相關(guān)信號(hào)檢測(cè)FPGA實(shí)現(xiàn)方案,通過(guò)改變FIFO長(zhǎng)度改變自相關(guān)運(yùn)算點(diǎn)數(shù),實(shí)現(xiàn)了弱信號(hào)檢測(cè)。提出通過(guò)二次門限處理來(lái)消除檢測(cè)脈沖中的毛刺和凹陷,降低了虛警概率,提高了檢測(cè)結(jié)果的可靠性。 5)在單通道自相關(guān)信號(hào)檢測(cè)算法基礎(chǔ)上,提出采用三路并行檢測(cè),每路采用不同的相關(guān)點(diǎn)數(shù)和檢測(cè)門限,再綜合考慮三路檢測(cè)結(jié)果,得到最終檢測(cè)結(jié)果。給出了算法FPGA實(shí)現(xiàn)過(guò)程,并對(duì)設(shè)計(jì)進(jìn)行了聯(lián)合時(shí)序仿真,提高了檢測(cè)性能。 6)給出了一種利用FFT變換后的兩根最大譜線進(jìn)行插值的快速高精度頻率估計(jì)方法,并將該算法在FPGA硬件中進(jìn)行了實(shí)現(xiàn)。通過(guò)利用FFT運(yùn)算后的實(shí)/虛部最大值進(jìn)行插值,降低了硬件資源消耗、縮短了運(yùn)算延遲。 7)結(jié)合4)、5)、6)中的研究成果,完成了對(duì)雷達(dá)脈沖信號(hào)到達(dá)時(shí)間、終止時(shí)間、脈沖寬度和脈沖頻率的估計(jì),最終在一塊FPGA芯片內(nèi)實(shí)現(xiàn)了一個(gè)精簡(jiǎn)的雷達(dá)信號(hào)偵察數(shù)字接收機(jī),并在微波暗室中進(jìn)行了測(cè)試。

    標(biāo)簽: FPGA 雷達(dá)信號(hào) 數(shù)字接收機(jī)

    上傳時(shí)間: 2013-06-13

    上傳用戶:Divine

  • 雷達(dá)信號(hào)處理系統(tǒng)的設(shè)計(jì)與FPGA實(shí)現(xiàn)

    雷達(dá)信號(hào)處理是雷達(dá)系統(tǒng)的重要組成部分。在數(shù)字信號(hào)處理技術(shù)飛速發(fā)展的今天,雷達(dá)信號(hào)處理中也普遍使用數(shù)字信號(hào)處理技術(shù)。而現(xiàn)場(chǎng)可編程門陣列(FPGA)在數(shù)字信號(hào)處理中的廣泛應(yīng)用,使得FPGA在雷達(dá)信號(hào)處理中也占據(jù)了重要地位。 針對(duì)雷達(dá)信號(hào)處理的設(shè)計(jì)與實(shí)現(xiàn),本文在以下兩個(gè)方面展開研究: 一方面以線性調(diào)頻信號(hào)(LFM)為例,分別對(duì)幾種基本的雷達(dá)信號(hào)處理,如正交相干檢波、脈沖壓縮、動(dòng)目標(biāo)顯示(MTI)/動(dòng)目標(biāo)檢測(cè)(MTD)和恒虛警(CFAR)詳細(xì)地闡述了其原理,在此基礎(chǔ)上給出了其經(jīng)常采用的實(shí)現(xiàn)方法,并在MATLAB環(huán)境中對(duì)各個(gè)環(huán)節(jié)進(jìn)行了參數(shù)化仿真,詳盡地給出了各環(huán)節(jié)的仿真波形圖。針對(duì)仿真結(jié)果,直觀形象地說(shuō)明了不同實(shí)現(xiàn)方法的優(yōu)劣。 另一方面結(jié)合MATLAB仿真結(jié)果,給出利用FPGA實(shí)現(xiàn)雷達(dá)信號(hào)處理的方案。在Xilinx ISE6.3i軟件集成環(huán)境下,通過(guò)對(duì)Xilinx提供的IP核的調(diào)用,并與VHDL語(yǔ)言相結(jié)合,完成雷達(dá)信號(hào)處理的FPGA實(shí)現(xiàn)。

    標(biāo)簽: FPGA 雷達(dá)信號(hào) 處理系統(tǒng)

    上傳時(shí)間: 2013-04-24

    上傳用戶:ylwleon

  • 基于FPGA模型化設(shè)計(jì)的雷達(dá)信號(hào)

    隨著現(xiàn)場(chǎng)可編程門陣列(FPGA)在工業(yè)中的廣泛應(yīng)用,使得基于FPGA數(shù)字信號(hào)處理的實(shí)現(xiàn)在雷達(dá)信號(hào)處理中有著重要地位。模型化設(shè)計(jì)是一種自頂向下的面向FPGA的快速原型驗(yàn)證法,它不僅降低了FPGA設(shè)計(jì)門檻,而且縮短了開發(fā)周期,提高了設(shè)計(jì)效率。這使得FPGA模型化設(shè)計(jì)成為了FPGA系統(tǒng)設(shè)計(jì)的發(fā)展趨勢(shì)。本文針對(duì)常見雷達(dá)信號(hào)處理模塊的FPGA模型化實(shí)現(xiàn),在以下幾個(gè)方面展開研究:首先對(duì)基于FPGA的模型化設(shè)計(jì)方法進(jìn)行了研究,給出了模型化設(shè)計(jì)方法的發(fā)展現(xiàn)狀和趨勢(shì),并對(duì)本文中使用的模型化設(shè)計(jì)方法的軟件工具System Generator和AccelDSP進(jìn)行了介紹。其次使用這兩種軟件工具對(duì)FIR濾波器進(jìn)行了模型化設(shè)計(jì)并同RTL(寄存器傳輸級(jí))設(shè)計(jì)方法進(jìn)行對(duì)比,全面分析了模型化設(shè)計(jì)方法和RTL設(shè)計(jì)方法的優(yōu)缺點(diǎn)。然后在簡(jiǎn)明闡述雷達(dá)信號(hào)處理原理的基礎(chǔ)上,使用System Generator對(duì)數(shù)字下變頻(DDC)、脈沖壓縮、動(dòng)目標(biāo)顯示(MTI)及恒虛警(CFAR)處理等雷達(dá)信號(hào)處理模塊進(jìn)行了自頂向下的模型化設(shè)計(jì)。在Simulink中進(jìn)行了功能仿真驗(yàn)證,生成了HDL代碼,并在Xilinx FPGA中進(jìn)行了RTL的時(shí)序仿真分析。關(guān)鍵詞:雷達(dá)信號(hào)處理 FPGA 模型化設(shè)計(jì) System Generator AccelDSP

    標(biāo)簽: FPGA 模型 雷達(dá)信號(hào)

    上傳時(shí)間: 2013-07-25

    上傳用戶:zhangsan123

  • 將立體雜波圖應(yīng)用于氣象雜波的CFAR處理

    將立體雜波圖應(yīng)用于氣象雜波的CFAR處理,根據(jù)當(dāng)前雜波環(huán)境的變化實(shí)時(shí)地產(chǎn)生雜內(nèi)雜外標(biāo)志,從而選擇不同的信號(hào)處理支路處理當(dāng)前氣象雜波,提高了雷達(dá)的檢測(cè)性能,降低了虛警概率。

    標(biāo)簽: CFAR 雜波 應(yīng)用于

    上傳時(shí)間: 2013-08-11

    上傳用戶:ccclll

  • 基于能量檢測(cè)的頻譜感知方法研究

    認(rèn)知無(wú)線電是一種用于提高無(wú)線通信頻譜利用率的新的智能技術(shù),檢測(cè)頻譜空穴是否存在是實(shí)現(xiàn)認(rèn)知無(wú)線電的前提和關(guān)鍵技術(shù)之一。首先簡(jiǎn)述認(rèn)知無(wú)線電的背景和概念, 針對(duì)認(rèn)知無(wú)線電的頻譜感知功能,介紹了基于能量檢測(cè)的頻譜檢測(cè)方法,并在Matlab環(huán)境下進(jìn)行了仿真實(shí)驗(yàn), 比較在相同的虛警概率情況下的檢測(cè)概率與信噪比的關(guān)系。仿真實(shí)驗(yàn)結(jié)果表明,在相同的虛警概率時(shí),當(dāng)信噪比大的時(shí)候,檢測(cè)概率越大。

    標(biāo)簽: 能量檢測(cè) 方法研究 頻譜感知

    上傳時(shí)間: 2014-12-23

    上傳用戶:2728460838

  • QL310多功能識(shí)別主人電話遙控報(bào)警芯片用戶手冊(cè)

    □基于來(lái)電顯示技術(shù),識(shí)別主人,利用手機(jī)或固定電話實(shí)現(xiàn)免接通,免費(fèi)用的絕密遙控關(guān)及撤防。□單芯片多功能可編程設(shè)計(jì),MCU內(nèi)核,有著十分靈活廣泛的應(yīng)用(可定制特殊功能)。自動(dòng)撥號(hào)的電話報(bào)警器方面:室內(nèi)手動(dòng)延時(shí)布防,手機(jī)或固定電話免接通遙控撤防;撥號(hào)報(bào)警+現(xiàn)場(chǎng)報(bào)警(可選)。電話遙控開關(guān)方面:用于開啟電控門鎖,保險(xiǎn)柜電控鎖,車庫(kù)電動(dòng)門,電器開關(guān)...等。更多應(yīng)用......。□單芯片最多可存入6組電話號(hào)碼(6個(gè)主人)不重碼,最后一組號(hào)碼可刷新,掉電不丟失,可保100年。□非主人撥入無(wú)效,主人需20秒內(nèi)連續(xù)撥通兩次遙控才有效(撤防或開關(guān)),操縱成功后會(huì)自動(dòng)回?fù)苓b控者電話一次,以表示遙控成功。絕不影響電話的正常使用。□循環(huán)撥打1-6組主人電話號(hào)碼報(bào)警15次,接聽報(bào)警時(shí)警聲提示,可同時(shí)選擇現(xiàn)場(chǎng)報(bào)警。無(wú)注冊(cè)用戶時(shí),觸發(fā)報(bào)警將自動(dòng)轉(zhuǎn)入連續(xù)現(xiàn)場(chǎng)報(bào)警1分鐘。□接警處理功能,接聽報(bào)警期間,手機(jī)或固定電話按"#"鍵退出報(bào)警。未接警的號(hào)碼繼續(xù)打報(bào)警。□僅設(shè)計(jì)兩按鈕實(shí)現(xiàn)用戶注冊(cè)、信息刪除、室那手動(dòng)布防撤防、輸出開關(guān)控制、報(bào)警模式設(shè)定,報(bào)警期間無(wú)法手動(dòng)撤防。□兩種反復(fù)可編程報(bào)警模式。掉電不丟失。模式1:報(bào)警完畢自動(dòng)撤防;模式2:報(bào)警完畢保持布防。□兩種自適應(yīng)電路模式:DTMF解碼器接入模式和DTMF解碼器不接入模式。自動(dòng)實(shí)現(xiàn)不同的電路設(shè)計(jì)實(shí)現(xiàn)不同的輸出控制功能。同一電路設(shè)計(jì),通過(guò)增減硬部件即可實(shí)現(xiàn)不同的輸出功能,QL310上電時(shí)自動(dòng)識(shí)別DTMF解碼器是否存在。□兩路警聲輸出:其中一路輸出用于操作音提示及報(bào)警時(shí)加載到電話線路中供監(jiān)聽用。另一路為現(xiàn)場(chǎng)報(bào)警使用(可根據(jù)需要選用,這路只有在報(bào)警時(shí)才有輸出,設(shè)計(jì)時(shí)可通過(guò)加大功率提高警聲)。□狀態(tài)記憶功能:布撤防狀態(tài)都有記憶功能(掉電不丟失)。可避免布撤防期間的偶然的停電再上電是狀態(tài)發(fā)生變化。比如,當(dāng)前為布防狀態(tài),掉電再上電后還是保持布防狀態(tài)。□手動(dòng)布撤防提示音,布撤防LED指示燈。□上電開機(jī)報(bào)警模式提示音,模式1發(fā)一聲提示音;模式2發(fā)兩聲提示音。□觸發(fā)端的信號(hào)智能檢測(cè),因此可適應(yīng)任何觸發(fā)信號(hào):或高電平,或低電平,或高/低脈沖信號(hào);無(wú)源的開關(guān)信號(hào),如繼電器,干簧管或門磁開關(guān)等(由于觸發(fā)端內(nèi)部有上拉電阻)。標(biāo)準(zhǔn)的TTL電平,通過(guò)外接簡(jiǎn)單的限幅電路可實(shí)現(xiàn)更高電平或脈沖的輸入(紅外探頭,防火探頭等)。特強(qiáng)抗干擾處理,長(zhǎng)距離布線可抗強(qiáng)電磁干擾。□20腳PDIP封裝及20腳SOP封裝。□5V低功耗。使用3.58M晶振。□工業(yè)級(jí)設(shè)計(jì),工作溫度:-40℃~+85℃

    標(biāo)簽: 310 QL 多功能 識(shí)別

    上傳時(shí)間: 2013-11-13

    上傳用戶:lacsx

  • 基于一種智能遙控條形碼車鎖的研究

    最近汽車防盜成為了人們廣泛關(guān)注的問(wèn)題。一些不法分子利用設(shè)備干擾遙控鎖車,車鑰匙不能正常發(fā)射信號(hào),致使部分車主不能將汽車上鎖,從而進(jìn)行偷車。很多國(guó)際著名的汽車廠商大力研究的遙控車鑰匙在此時(shí)會(huì)出現(xiàn)問(wèn)題,于是有了本設(shè)計(jì)構(gòu)想。本設(shè)計(jì)利用了最經(jīng)濟(jì),實(shí)用的自動(dòng)識(shí)別技術(shù)—條形碼,充分利用了條形碼的輸入速度快,可靠性高等優(yōu)點(diǎn)。傳統(tǒng)的車鎖在一定方面上影響了整車的外觀,且安全性不高,本設(shè)計(jì)能在一定程度上解決以上問(wèn)題,而且成本較低,適用范圍廣。

    標(biāo)簽: 智能遙控 條形碼 車鎖

    上傳時(shí)間: 2014-01-22

    上傳用戶:cknck

  • 2THLxx可調(diào)恒流三極管系列產(chǎn)品

    2THLxx可調(diào)恒流三極管系列產(chǎn)品 可調(diào)恒流三極管2THLxx(CRT)作為第二代半導(dǎo)體恒流器件,是一種能為L(zhǎng)ED 或其他器件在電源電 壓變化時(shí)提供恒定電流的三端半導(dǎo)體器件,它和第一代產(chǎn)品CRD 的應(yīng)用是兼容的。它利用一個(gè)可調(diào)整端, 通過(guò)外部元件在一定范圍內(nèi)連續(xù)調(diào)節(jié)其輸出電流,實(shí)現(xiàn)簡(jiǎn)單可靠的恒流源或最大峰值電流限制電路,即 使出現(xiàn)電源電壓供應(yīng)不穩(wěn)定或是負(fù)載電阻變化很大的情況,都能確保供電電流恒定。該器件具有外圍電 路非常簡(jiǎn)單、輸出電流可調(diào)、使用及其方便等特點(diǎn),尤其適用于可調(diào)光LED 照明、動(dòng)態(tài)LCD 背光、汽 車電子、通信電路、手持設(shè)備、儀器儀表和微型機(jī)器等場(chǎng)合。如果不用可調(diào)整端(空),和第一代產(chǎn)品 CRD 的使用完全相同。 ■ 電氣特性

    標(biāo)簽: 2THLxx 恒流 三極管系列

    上傳時(shí)間: 2014-01-09

    上傳用戶:彭玖華

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