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波導芯片

  • OFDM信道估計模塊運算部件的FPGA設(shè)計

    正交頻分復用(OnIlogonaJ Frequency Division Multiplexing,OFDM)技術(shù)通過將整個信道分為多個帶寬相等并行傳輸?shù)淖有诺溃ㄟ^將信息經(jīng)過子信道獨立傳輸來實現(xiàn)通信,子信道的正交性可以保證最大限度的利用頻譜資源。OFDM系統(tǒng)通過循環(huán)前綴來消除符號間干擾(ISI),通過IDFT/DFT調(diào)制解調(diào)降低了系統(tǒng)實現(xiàn)的復雜度。由于其頻譜利用率高,抗多徑能力強,在多種通信場合中都得到了應用。雖然有著上述優(yōu)點,但為了準確的恢復信號,信道估計是OFDM系統(tǒng)中必須實現(xiàn)的一環(huán)。 本文正是針對OFDM接收機中的信道估計模塊的運算部件的實現(xiàn)進行了研究。首先,研究了OFDM信道估計的LS算法,一階線性插值算法,二次多項式插值算法,建立了適用于寬帶通信系統(tǒng)的信道估計模塊模型。其次研究了加法器電路和乘法器電路的實現(xiàn),包括進位行波加法器,曼徹斯特進位鏈,超前進位加法器和乘法原理,陣列乘法器,wallace樹乘法器及BOOTH編碼算法,并分析了各種電路的特性及優(yōu)缺點。接著研究了幾種主要的除法器設(shè)計算法,包括數(shù)字循環(huán)算法,基于函數(shù)迭代的算法,以及CORDIC算法,結(jié)合信道估計的特點選擇了函數(shù)迭代和CORDIC算法作為具體實現(xiàn)的方法。最后,在前面的設(shè)計的基礎(chǔ)上在FPGA芯片上實現(xiàn)了前面的設(shè)計方案。

    標簽: OFDM FPGA 信道估計 模塊

    上傳時間: 2013-06-06

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  • 小波分析與信號處理.pdf

    小波分析經(jīng)典,注重小波分析的基本理論。將一位小波理論和高維小波理論放在一起并行介紹。

    標簽: 小波分析 信號處理

    上傳時間: 2013-04-24

    上傳用戶:duoshen1989

  • 16QAM基帶Modem的FPGA芯片設(shè)計

    本文對16QAM基帶Modem的FPGA芯片設(shè)計進行了研究與論述.首先介紹了16QAM調(diào)制的原理和16QAM基帶Modem的FPGA芯片總體設(shè)計,以及一些FPGA設(shè)計的基本原則.接著介紹了高性能濾波器的FPGA設(shè)計方法,并采用多相結(jié)構(gòu)濾波器和分布式算法(DA)設(shè)計了發(fā)送端平方根升余弦滾降濾波器.然后介紹了自適應盲均衡器的設(shè)計,該均衡器是一個復數(shù)結(jié)構(gòu)的橫向濾波器,采用復用抽頭的結(jié)構(gòu)來節(jié)省資源,本文對自適應均衡器的核心運算單元-采用booth編碼算法設(shè)計的高性能乘累加(MAC)運算單元進行了詳細描述.接下來介紹了載波恢復環(huán)路的FPGA設(shè)計,這是一個數(shù)字二階鎖相環(huán),本文推導了數(shù)字二階鎖相環(huán)和模擬二階鎖相環(huán)的對應關(guān)系.DD相位檢測算法中的反正切函數(shù)tan

    標簽: Modem FPGA QAM 16

    上傳時間: 2013-04-24

    上傳用戶:dajin

  • JPEG2000基于位平面掃描的上下文編碼的研究和FPGA實現(xiàn)

    JPEG2000是新一代的靜態(tài)圖像壓縮標準,它相比JPEG有很多新的特性,如漸進傳輸和感興趣區(qū)域編碼等,因而它具有廣闊的應用前景,特別是在數(shù)碼相機、PDA等便攜式設(shè)備中。 JPEG2000的核心主要包括小波變換和基于最優(yōu)化截斷點的嵌入式塊編碼(EBCOT)算法,其計算復雜度遠遠高于JPEG,完全采用軟件方案實現(xiàn)將會占用大量的處理器時間和內(nèi)存開銷,而且速度較慢,實時處理的能力較差。為了推廣JPEG2000在便攜式產(chǎn)品、消費類電子產(chǎn)品中的應用,打開巨大的潛在市場,研究硬件實現(xiàn)的算法實時處理方案具有重要的應用價值。 EBCOT算法是一個兩層的編碼引擎,其中的上下文編碼的運算量約占到總運算量的50%,是提高編碼速度的關(guān)鍵算法之一。由于上下文編碼大部分都是邏輯運算,沒有復雜的數(shù)學運算,但邏輯控制流程復雜繁瑣,對存儲器訪問頻繁,采用DSP或者其他的通用處理器通過指令控制實現(xiàn)該算法,未能顯著提高編碼速度。本文采用FPGA芯片,以電路邏輯的方式來實現(xiàn)該算法并進行優(yōu)化,在研究和分析了上下文編碼算法運算特點的基礎(chǔ)上,設(shè)計了列判斷和交錯存儲相結(jié)合的硬件實現(xiàn)方案,并采用硬件描述語言Verilog在寄存器傳輸級描述了相應的硬件電路。通過功能仿真和邏輯綜合后,所獲得的上下文編碼模塊最大時鐘頻率為101MHz,且能在130ms內(nèi)完成對一幅512×512灰度圖像的編碼,性能比Jasper軟件中的實現(xiàn)方案提高了75%。 JPEG2000的一個重要特性是其具有漸進傳輸?shù)哪芰Γa流組織是獲得漸進傳輸特性的技術(shù)關(guān)鍵。碼流組織通過在輸出碼流中安排數(shù)據(jù)包的先后順序來實現(xiàn)漸進傳輸?shù)哪康摹1疚膶PEG2000中實現(xiàn)漸進傳輸?shù)臋C制進行了分析,并研究了碼流組織的算法實現(xiàn)。 為了對JPEG2000算法實現(xiàn)進行驗證,本文設(shè)計了基于FPGA和ARM的驗證實驗平臺,其中FPGA主要完成算法中運算量較大的小波變換、上下文編碼和算術(shù)編碼,而ARM處理器則完成碼流組織、數(shù)據(jù)打包以及和PC機的通信。本文在該平臺上對所設(shè)計的上下文編碼算法和碼流組織模塊的設(shè)計進行了驗證,實驗結(jié)果表明本文設(shè)計的算法模塊功能正確,并在一定程度上提高了編碼速度。

    標簽: JPEG 2000 FPGA 編碼

    上傳時間: 2013-04-24

    上傳用戶:獨孤求源

  • JPEG2000中小波變換的研究與FPGA實現(xiàn)

    JPEG2000是新一代圖像壓縮標準,JPEG2000與傳統(tǒng)JPEG最大的不同,在于它放棄了JPEG所采用的以離散余弦變換(Discrete Cosine Transform)為主的區(qū)塊編碼方式,而采用以小波轉(zhuǎn)換(Wavelet Transform)為主的多解析編碼方式.離散小波變換算法是現(xiàn)代譜分析工具,在圖像處理與圖像分析領(lǐng)域正得到越來越廣泛的應用.由于JPEG2000標準具有復雜的算法,全部用軟件來實現(xiàn)將會占用很大的處理器時間開銷和內(nèi)存開銷,尤其對于實時圖像傳輸和處理系統(tǒng),因而用硬件電路來實現(xiàn)JPEG2000標準的部分或全部,就具有重要的意義,本課題的目的就是用硬件電路來實現(xiàn)JPEG2000標準中的離散小波變換部分,論文研究的主要工作就是設(shè)計了一個符合JPEG2000標準的、高性能的多級二維離散小波變換的硬件電路.論文研究的內(nèi)容主要分為兩部分,第一部分首先分析了JPEG2000標準和離散小波變換的原理,重點研究了離散小波變換的快速算法,包括第一代小波變換所采用的卷積算法和第二代小波變換所采用的提升算法,然后具體分析了離散小波變換在JPEG2000中的具體實現(xiàn).論文第二部分對兩種離散小波變換快速算法的硬件實現(xiàn)進行了比較,并選擇卷積濾波算法作為硬件實現(xiàn)的對象,并采用Daubechies9/7小波基.然后具體設(shè)計了離散小波變換的各個模塊,所有的模塊都是有硬件描述語言(Verilog HDL)來實現(xiàn),經(jīng)過仿真和邏輯綜合,在一塊自行設(shè)計的FPGA開發(fā)板上進行了驗證.仿真和驗證的結(jié)果表明了該小波變換的硬件電路符合JPEG2000標準,具有較高的速度和信噪比.

    標簽: JPEG 2000 FPGA 小波變換

    上傳時間: 2013-04-24

    上傳用戶:h886166

  • AD9850 程序

    次程序基于89c51單片機和AD 9850芯片,產(chǎn)生正弦波

    標簽: 9850 AD 程序

    上傳時間: 2013-06-25

    上傳用戶:kr770906

  • 過零檢測專用芯片

    非常不錯的過零檢測芯片,DIP8封裝,外圍器件極少

    標簽: 過零檢測 專用芯片

    上傳時間: 2013-04-24

    上傳用戶:WANGXIAN001

  • NEC芯片資料79F8513

    NEC芯片資料79F8513,芯片學習資料,共閱參考!

    標簽: 79F8513 NEC 芯片資料

    上傳時間: 2013-04-24

    上傳用戶:leehom61

  • FPGA芯片關(guān)鍵電路設(shè)計

    現(xiàn)場可編程門陣列(FPGA)器件是能通過對其進行編程實現(xiàn)具有用戶規(guī)定功能的電路,特別適合集成電路的新品開發(fā)和小批量ASIC電路的生產(chǎn)。近幾年來,F(xiàn)PGA的發(fā)展非常迅速,但目前國內(nèi)廠商所使用的FPGA芯片主要還是從國外進口,這種狀況除了給生產(chǎn)廠家?guī)砗艽蟮某杀緣毫σ酝猓瑫r也影響到國家信息產(chǎn)業(yè)的保密和安全問題,因此在國內(nèi)自主研發(fā)FPGA便成為一種必然的趨勢。 基于上述現(xiàn)實狀況及國內(nèi)市場的巨大需求,中國電子科技集團公司第58研究所近年來對FPGA進行了專項研究,本論文正是作為58所專項的一部分研究工作的總結(jié)。本文深入研究了FPGA的相關(guān)設(shè)計技術(shù),并進行了實際的FPGA器件設(shè)計,研究工作的重點是在華潤上華(CSMC)0.5μm標準CMOS工藝基礎(chǔ)上進行具有6000有效門的FPGA的電路設(shè)計與仿真。 論文首先闡述了可編程邏輯器件的基本結(jié)構(gòu),就可編程邏輯器件的發(fā)展過程及其器件分類,對可編程只讀存儲器、現(xiàn)場可編程邏輯陣列、可編程陣列邏輯、通用邏輯陣列和復雜PLD等的基本結(jié)構(gòu)特點進行了討論。接著討論了FPGA的基本結(jié)構(gòu)與分類及它的編程技術(shù),另外還闡述了FPGA的集成度和速率等相關(guān)問題。并根據(jù)實際指標要求確定本文研究目標FPGA的基本結(jié)構(gòu)和它的編程技術(shù),在華潤上華0.5μm標準CMOS工藝的基礎(chǔ)上,進行一款FPGA芯片的設(shè)計研究工作。進行了可編程邏輯單元的基本結(jié)構(gòu)的設(shè)計,并用CMOS邏輯和NMOS傳輸管邏輯實現(xiàn)了函數(shù)發(fā)生器、快速進位鏈和觸發(fā)器的電路設(shè)計,并對其進行了仿真,達到了預期的目標。

    標簽: FPGA 芯片 電路設(shè)計

    上傳時間: 2013-07-18

    上傳用戶:zaizaibang

  • 基于FPGA的JPEG編解碼芯片設(shè)計

    近年來,隨著微電子技術(shù)的高速發(fā)展,數(shù)字圖像壓縮編碼技術(shù)的逐漸成熟,實時圖象處理在多媒體、HDTV、圖像通信等領(lǐng)域有著越來越廣泛的應用,圖像壓縮/解壓的IC芯片也已成為多媒體技術(shù)的核心,實現(xiàn)這些算法芯片的研究成為信息產(chǎn)業(yè)的新熱點.該文基于FPGA設(shè)計了JPEG圖像壓縮編解碼芯片,通過改進算法優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性.在JPEG編碼器設(shè)計中,改進了JEONG的DCT變換算法,采用流水線優(yōu)化算法解決時間并行性問題,提高了DCT/IDCT模塊的運算速度;設(shè)計了基于查找表結(jié)構(gòu)的定點乘法器,便于在設(shè)計中共享乘法單元,以適應流水線設(shè)計的要求;依據(jù)Huffman編碼表的規(guī)律性,采用并行查找表結(jié)構(gòu),用較少的存儲單元完成Huffman編解碼的運算,同時也提高了編解碼速度.在JPEG解碼器設(shè)計中,根據(jù)Huffman碼字本身的特點和JPEG標準,設(shè)計了一種Huffman碼字分組結(jié)構(gòu),基于該結(jié)構(gòu)提出分組Huffman查找表及地址編碼的設(shè)計方法,進而完成了新的快速Huffman解碼算法及其模塊設(shè)計.整個設(shè)計及其各個模塊都在ALTERA公司的EDA工具QUARTUSII平臺上進行了邏輯綜合及功能和時序仿真.綜合和仿真結(jié)果表明,基于FPGA的JPEG圖像編解碼芯片消耗很少的FPGA硬件資源,達到了較高的工作頻率,在速度和資源利用率方面均達到了較優(yōu)的狀態(tài),可滿足實時JPEG圖像編解碼的要求.在邏輯設(shè)計的基礎(chǔ)上,該設(shè)計可以進一步作硬件仿真和實驗,將源代碼燒錄進FPGA芯片,作為獨立器件或有自主知識產(chǎn)權(quán)的JPEG IP模塊,應用于可視電話、手機和會議電視等低成本JPEG編解碼系統(tǒng)的實現(xiàn).

    標簽: FPGA JPEG 編解碼 芯片設(shè)計

    上傳時間: 2013-05-31

    上傳用戶:yuying4000

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