1.3 FPGA的設(shè)計(jì)流程。
標(biāo)簽： FPGA 1.3 設(shè)計(jì)流程
上傳時間： 2013-11-03
上傳用戶：xiehao13
信號完整性分析
標(biāo)簽： 黑魔 信號完整性 分
上傳時間： 2013-10-15
上傳用戶：baiom
PCB相關(guān)技術(shù)，信號完整性分析，EMI和熱設(shè)計(jì)
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上傳時間： 2013-10-27
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基于抽象狀態(tài)機(jī)的網(wǎng)格系統(tǒng)設(shè)計(jì)和分析
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上傳時間： 2013-10-13
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使用QUARTUS II做開發(fā)全流程,傻瓜式詳細(xì)教程
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上傳時間： 2013-10-16
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介紹Quartus中經(jīng)常遇到的錯誤的分析
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上傳時間： 2013-10-30
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VHDL代碼風(fēng)格和常見的語法錯誤分析
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上傳時間： 2013-10-18
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01_靜態(tài)時序分析基本原理和時序分析模型
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使用Quartus II Timequest時序分析器約束分析設(shè)計(jì)
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上傳時間： 2013-10-12
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在ISE中直接調(diào)用chipscope進(jìn)行在線邏輯分析
標(biāo)簽： chipscope ISE 邏輯分析
上傳時間： 2013-11-02
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