十六進制單精度浮點數轉十進制數的小工具
標簽： HexSingleToDecimal 十六進制 精度 浮點數
上傳時間： 2013-11-15
上傳用戶：bpgfl
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電子發燒友網核心提示：Altera公司昨日宣布，在業界率先在28 nm FPGA器件上成功測試了復數高性能浮點數字信號處理（DSP）設計。獨立技術分析公司Berkeley設計技術有限公司（BDTI）驗證了能夠在 Altera Stratix V和Arria V 28 nm FPGA開發套件上簡單方便的高效實現Altera浮點DSP設計流程，同時驗證了要求較高的浮點DSP應用的性能。本文是BDTI完整的FPGA浮點DSP分析報告。 Altera的浮點DSP設計流程經過規劃，能夠快速適應可參數賦值接口的設計更改，其工作環境包括來自MathWorks的MATLAB和 Simulink，以及Altera的DSP Builder高級模塊庫，支持FPGA設計人員比傳統HDL設計更迅速的實現并驗證復數浮點算法。這一設計流程非常適合設計人員在應用中采用高性能 DSP，這些應用包括，雷達、無線基站、工業自動化、儀表和醫療圖像等。
標簽： Altera FPGA DSP 28
上傳時間： 2015-01-01
上傳用戶：sunshie
WP409利用Xilinx FPGA打造出高端比特精度和周期精度浮點DSP算法實現方案： High-Level Implementation of Bit- and Cycle-Accurate Floating-Point DSP Algorithms with Xilinx FPGAs
標簽： Xilinx FPGA 409 DSP
上傳時間： 2013-10-21
上傳用戶：huql11633
設計了一個基于FPGA的單精度浮點數乘法器.設計中采用改進的帶偏移量的冗余Booth3算法和跳躍式Wallace樹型結構,并提出對Wallace樹產生的2個偽和采用部分相加的方式,提高了乘法器的運算速度;加入對特殊值的處理模塊,完善了乘法器的功能.本設計在Altera DE2開發板上進行了驗證.
標簽： FPGA 精度 浮點數 乘法器設計
上傳時間： 2013-10-13
上傳用戶：yl1140vista
提出了一種基于BP神經網絡的浮選機液位穩定及液泡厚度的預測模型。預測模型主要以攪拌槽輸出的礦漿流量，掃選輸入流量，精選尾礦流量等為輸入量，以液泡厚度為輸出量，網絡隱含層單元個數與中心向量采用正交最小二乘法（OLS）。同時，在此基礎上在通過Matlab軟件來分析液泡厚度情況，并給出了預測及預警信息。從仿真的結果來看，符合預期的效果，對預防液位變化過大和保證液位穩定具有較大的參考價值和現實意義。
標簽： 浮選機 在線檢測 分 液位
上傳時間： 2013-10-22
上傳用戶：haoxiyizhong
C51編寫對SST 之FLASH操作源代碼,用單片機實現對SST39VF040的操作
標簽： SST FLASH C51 040
上傳時間： 2015-01-04
上傳用戶：84425894
MSP430浮點庫
標簽： MSP 430 浮點
上傳時間： 2015-01-08
上傳用戶：水口鴻勝電器
用於手機的BMP格式解析
標簽： BMP 格式解析
上傳時間： 2015-01-09
上傳用戶：thuyenvinh
這個函數是一段采用二分法計算正的浮點數開方的代碼，采用C語言編寫，在uClinux下編譯通過并能正常運行。
標簽： 函數 代碼 分 計算
上傳時間： 2015-01-10
上傳用戶：黃華強
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