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測(cè)試信道

  • 基于FPGA的Turbo碼編譯碼器設(shè)計.rar

    作為性能優(yōu)異的糾錯編碼,Turbo碼自誕生以來就一直受到理論界以及工程應(yīng)用界的關(guān)注。TD—SCDMA是我國擁有自主知識產(chǎn)權(quán)的3G通信標(biāo)準(zhǔn),該標(biāo)準(zhǔn)把Turbo碼是作為前向糾錯體制,但Turbo碼的譯碼算法比較復(fù)雜并且需要多次迭代,這造成Turbo碼譯碼延時大,譯碼速度慢,因此限制了Turbo碼的實際應(yīng)用。因此有必要研究如何將現(xiàn)有的Turbo碼譯碼算法進(jìn)行簡化,加速,使其轉(zhuǎn)化成為適合在硬件上實現(xiàn)的算法,將實驗室的理論研究成果轉(zhuǎn)化成為硬件產(chǎn)品。 論文主要的研究內(nèi)容有以下兩點: 其一,提出信道自適應(yīng)迭代譯碼方案。在事先設(shè)定最大迭代次數(shù)的情況下,自適應(yīng)Turbo碼譯碼算法能夠根據(jù)信道的變化自動調(diào)整迭代次數(shù)。 仿真結(jié)果表明:該自適應(yīng)迭代譯碼方案能夠根據(jù)信道的變化自動調(diào)整迭代次數(shù),在保證譯碼性能基本上沒有損失的情況下,有效減少譯碼時間,明顯提高譯碼速度。 其二,根據(jù)得到的信道自適應(yīng)迭代譯碼方案,借助Xilinx公司Spartan3 FPGA硬件平臺,使用Verilog硬件描述語言,將用C/C++語言寫成的信道自適應(yīng)迭代譯碼算法轉(zhuǎn)化成為硬件設(shè)計實現(xiàn),得到硬件電路,并對得到的譯碼器硬件電路進(jìn)行測試。 測試結(jié)果表明:隨著信道的變化,硬件電路的譯碼速度也隨之自動變化,信噪比越高譯碼速度越快,并且硬件譯碼器性能(誤比特率)與實驗仿真基本一致。

    標(biāo)簽: Turbo FPGA 編譯碼器

    上傳時間: 2013-05-31

    上傳用戶:huyiming139

  • 《單片機(jī)C語言程序設(shè)計實訓(xùn)100例——基于80.rar

    《單片機(jī)C語言程序設(shè)計實訓(xùn)100例——基于8051+Proteus仿真》,附有電路圖及hex文件

    標(biāo)簽: 100 80 單片機(jī)

    上傳時間: 2013-07-19

    上傳用戶:nanfeicui

  • μC-OS-Ⅱ中文手冊.rar

    μC-OS-Ⅱ中文手冊,共分為十二個章節(jié)。第1章:范例,第2章 實時系統(tǒng)概念,第3章 內(nèi)核結(jié)構(gòu),第4 章 任務(wù)管理,第5 章 時間管理,第6 章 任務(wù)之間的通訊與同步,第7 章 內(nèi)存管理,第8章 移植μC/OS-Ⅱ,第9章 μC/OS-II在80x86上的移植,第10章從 μC/OS 升級到 μC/OS-II,第11 章 參考手冊,第12章 配置手冊。

    標(biāo)簽: C-OS

    上傳時間: 2013-04-24

    上傳用戶:william345

  • 單片機(jī)C語言.rar

    單片機(jī)C語言的理論書籍,內(nèi)容比較豐富,涵蓋了單片機(jī)C語言的各種應(yīng)用。

    標(biāo)簽: 單片機(jī) C語言

    上傳時間: 2013-07-11

    上傳用戶:liangrb

  • 譚浩強(qiáng)C語言全書.rar

    這是我們實驗室培訓(xùn)C語言時用的課件,個人覺得很不錯

    標(biāo)簽: 譚浩強(qiáng) C語言

    上傳時間: 2013-06-25

    上傳用戶:zhengjian

  • ARM嵌入式系統(tǒng)C語言編程.rar

    ARM嵌入式系統(tǒng)C語言編程資料,歡迎各位朋友 下載

    標(biāo)簽: ARM 嵌入式系統(tǒng) C語言編程

    上傳時間: 2013-06-06

    上傳用戶:himbly

  • DVB系統(tǒng)信道編碼的研究與FPGA實現(xiàn).rar

    數(shù)字圖像通信的最廣泛的應(yīng)用就是數(shù)字電視廣播系統(tǒng),與以往的模擬電視業(yè)務(wù)相比,數(shù)字電視在節(jié)省頻譜資源、提高節(jié)目質(zhì)量方面帶來了一場新的革命,而與此對應(yīng)的DVB(Digital Video Broadcasting)標(biāo)準(zhǔn)的建立更是加速了數(shù)字電視廣播系統(tǒng)的大規(guī)模應(yīng)用。DVB標(biāo)準(zhǔn)選定MPEG—2標(biāo)準(zhǔn)作為音頻及視頻的編碼壓縮方式,隨后對MPEG—2碼流進(jìn)行打包形成TS流(transport stream),進(jìn)行多個傳輸流復(fù)用,最后通過不同媒介進(jìn)行傳輸。在DVB標(biāo)準(zhǔn)的傳輸系統(tǒng)中,無論是衛(wèi)星傳輸,電纜傳輸還是地面?zhèn)鬏敚瑸榱吮U蠄D像質(zhì)量,使數(shù)字節(jié)目在傳輸過程中避免出現(xiàn)因受到各種信道噪聲干擾而出現(xiàn)失真的現(xiàn)象,都采用了信道編碼的方式來保護(hù)傳輸數(shù)據(jù)。信道編碼是數(shù)字通信系統(tǒng)中一個必需的、重要的環(huán)節(jié)。 信道編碼設(shè)計方案的優(yōu)劣決定了DVB系統(tǒng)的成功與否,本文重點研究了DVB系統(tǒng)中的信道編碼算法及其FPGA實現(xiàn)方案,主要進(jìn)行了如下幾項工作: 1)介紹了DVB系統(tǒng)信道編碼的基本概念及特點,深入研究了DVB標(biāo)準(zhǔn)中信道編碼部分的關(guān)鍵技術(shù),并針對每個信道編碼模塊進(jìn)行工作原理分析、算法分析。 2)根據(jù)DVB信道編碼的特點,重點對信道編碼中四個模塊,包括擾碼、RS編碼、卷積交織編碼和卷積編碼的FPGA硬件實現(xiàn)算法進(jìn)行了比較詳細(xì)的分析,并闡述了每個模塊及QPSK調(diào)制的設(shè)計方案及實現(xiàn)模塊功能的程序流程。 3)在RS(204,188)編碼過程中,利用有限域常數(shù)乘法器的特點,對編碼器進(jìn)行了優(yōu)化,在很大程度上提高了編碼效率,卷積交織器部分采用RAM移位法,實現(xiàn)起來更為簡單且節(jié)省了FPGA器件內(nèi)部資源。 4)設(shè)計以Altera公司的QuartusⅡ為開發(fā)平臺,利用FPGA芯片EP1C6Q240C8完成了信道編碼各模塊及QPSK調(diào)制的硬件實現(xiàn),通過Verilog HDL描述和時序仿真來驗證算法的可行性,并給出系統(tǒng)設(shè)計中減少毛刺的方法,使系統(tǒng)更為穩(wěn)定。最終的系統(tǒng)仿真結(jié)果表明該系統(tǒng)工作穩(wěn)定,達(dá)到了DVB系統(tǒng)信道編碼設(shè)計的要求。

    標(biāo)簽: FPGA DVB

    上傳時間: 2013-06-26

    上傳用戶:allen-zhao123

  • 基于FPGA的RS255,223編解碼器的高速并行實現(xiàn).rar

    隨著信息時代的到來,用戶對數(shù)據(jù)保護(hù)和傳輸可靠性的要求也在不斷提高。由于信道衰落,信號經(jīng)信道傳輸后,到達(dá)接收端不可避免地會受到干擾而出現(xiàn)信號失真。因此需要采用差錯控制技術(shù)來檢測和糾正由信道失真引起的信息傳輸錯誤。RS(Reed—Solomon)碼是差錯控制領(lǐng)域中一類重要的線性分組碼,由于它編解碼結(jié)構(gòu)相對固定,性能強(qiáng),不但可以糾正隨機(jī)差錯,而且對突發(fā)錯誤的糾錯能力也很強(qiáng),被廣泛應(yīng)用在數(shù)字通信、數(shù)據(jù)存儲系統(tǒng)中,以滿足對數(shù)據(jù)傳輸通道可靠性的要求。因此設(shè)計一款高性能的RS編解碼器不但具有很大的應(yīng)用意義,而且具有相當(dāng)大的經(jīng)濟(jì)價值。 本文首先介紹了線形分組碼及其子碼循環(huán)碼、BCH碼的基礎(chǔ)理論知識,重點介紹了BCH碼的重要分支RS碼的常用編解碼算法。由于其算法在有限域上進(jìn)行,接著介紹了有限域的有關(guān)理論?;赗S碼傳統(tǒng)的單倍結(jié)構(gòu),本文提出了一種八倍并行編碼及九倍并行解碼方案,并用Verilog HDL語言實現(xiàn)。其中編碼器基于傳統(tǒng)的線性反饋移位寄存器除法電路并進(jìn)行八倍并行擴(kuò)展,譯碼器關(guān)鍵方程求解模塊基于修正的歐幾里德算法設(shè)計了一種便于硬件實現(xiàn)的脈動關(guān)鍵方程求解結(jié)構(gòu),其他模塊均采用九倍并行實現(xiàn)。由于進(jìn)行了超前運(yùn)算、流水線及并行處理,使編解碼的數(shù)據(jù)吞吐量大為提高,同時延時更小。 本論文設(shè)計了C++仿真平臺,并與HDL代碼結(jié)果進(jìn)行了對比驗證。Verilog HDL代碼經(jīng)過modelsim仿真驗證,并在ALTERA STRATIX3 EP3SL15OF1152C2 FPGA上進(jìn)行綜合驗證以及靜態(tài)時序分析,綜合軟件為QUATURSⅡ V8.0。驗證及測試表明,本設(shè)計在滿足編解碼基本功能的基礎(chǔ)上,能夠?qū)崿F(xiàn)數(shù)據(jù)的高吞吐量和低延時傳輸,達(dá)到性能指標(biāo)要求。本論文在基于FPGA的RS(255,223)編解碼器的高速并行實現(xiàn)方面的研究成果,具有通用性、可移植性,有一定的理論及經(jīng)濟(jì)價值。

    標(biāo)簽: FPGA 255 223

    上傳時間: 2013-04-24

    上傳用戶:思琦琦

  • C程序設(shè)計語言.rar

    C程序設(shè)計語言(第2版·新版)非掃描版&詳細(xì)書簽版.pdfC程序設(shè)計語言(第2版·新版)非掃描版&詳細(xì)書簽版.pdf

    標(biāo)簽: C程序設(shè)計 語言

    上傳時間: 2013-04-24

    上傳用戶:busterman

  • 移動無線信道特性及基于FPGA的信道仿真器實現(xiàn).rar

    移動無線信道特性對移動通信系統(tǒng)性能具有重要影響,移動信道建模和仿真對移動通信系統(tǒng)的研發(fā)具有重要意義。因此,對移動信道建模與仿真進(jìn)行研究,具有重要的理論意義和實際應(yīng)用價值。 本文從無線電波的傳播特點出發(fā),分析了無線電波的傳播模型和描述信道特性的主要參數(shù),重點分析了移動小尺度衰落模型;結(jié)合無線電波傳輸環(huán)境的特點,研究了平坦衰落信道和頻率選擇性信道的特點,設(shè)計了基于FPGA的移動無線信道仿真器,同時給予了軟硬件驗證。 本文從衰落的數(shù)學(xué)模型角度研究了信道傳輸特性,以及各項參數(shù)對信道特性的影響。主要做了以下幾個方面的工作: 1.簡要介紹了無線電通信的發(fā)展史及信道建模與仿真的意義;論述了信道對無線信號主要的三類影響:自由空間的路徑損失、陰影衰落、多徑衰落;分析了無線通信傳播環(huán)境,移動無線通信信道仿真的基本模型,同時介紹了用正弦波疊加法和成型濾波器法建立信道確定型仿真模型的具體實現(xiàn)方法。 2.對移動無線信道特性進(jìn)行了Matlab仿真,對仿真結(jié)果進(jìn)行了對比分析,對影響信道特性的主要參數(shù)設(shè)置進(jìn)行了分析仿真。 3.設(shè)計了一種基于FPGA的移動無線信道仿真器,并對實現(xiàn)該仿真器的關(guān)鍵技術(shù)和實現(xiàn)方法進(jìn)行了分析。該信道仿真器能夠?qū)崟r模擬窄帶信號條件下無線信道的主要特點,如多徑時延、多普勒頻移、瑞利衰落等,其主要的技術(shù)指標(biāo)達(dá)到了設(shè)計要求。該模擬器結(jié)構(gòu)簡單,參數(shù)可調(diào),易于擴(kuò)展,通用性強(qiáng),可以部分或全部集成到處于研制階段的接收機(jī)中,以便于性能測試,也可應(yīng)用于教學(xué)實踐。

    標(biāo)簽: FPGA 移動 無線信道

    上傳時間: 2013-04-24

    上傳用戶:suxuan110425

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