采用ANSYS軟件的APDL語(yǔ)言編寫(xiě)的兩個(gè)命令流文件，用于計(jì)算含缺陷管道的失效概率，將參數(shù)稍作改動(dòng)，可用于其它結(jié)構(gòu)的可靠性分析
標(biāo)簽： ANSYS APDL 軟件 語(yǔ)言
上傳時(shí)間： 2015-08-27
上傳用戶：watch100
工作流現(xiàn)狀，別人翻譯的文章，工作流的概述、發(fā)展方向
標(biāo)簽：
上傳時(shí)間： 2014-01-13
上傳用戶：rocketrevenge
某人自己開(kāi)發(fā)的工作流引擎，這里是相關(guān)文檔，介紹的很清楚哦
標(biāo)簽： 工作流引擎
上傳時(shí)間： 2014-01-07
上傳用戶：鳳臨西北
Pocket+PC流接口驅(qū)動(dòng)示例 一個(gè)好的代碼，很不錯(cuò)，大家學(xué)習(xí)
標(biāo)簽： Pocket PC 接口 代碼
上傳時(shí)間： 2013-12-21
上傳用戶：tianjinfan
用字符輸入輸出流，將一個(gè)文本文件從硬盤(pán)某個(gè)文件夾復(fù)制到另外一個(gè)文件夾中。
標(biāo)簽： 字符 輸入輸出
上傳時(shí)間： 2015-09-05
上傳用戶：ruixue198909
基于Linux的實(shí)時(shí)流媒體編程介紹以及實(shí)現(xiàn)
標(biāo)簽： Linux 實(shí)時(shí)流 媒體 編程
上傳時(shí)間： 2013-12-11
上傳用戶：frank1234
為了下載只好把 無(wú)聊的十進(jìn)位轉(zhuǎn)二進(jìn)位上傳
上傳時(shí)間： 2013-12-25
上傳用戶：1079836864
Verilog HDL硬件描述語(yǔ)言 01簡(jiǎn)介.PDF 02HDL指南.PDF 03語(yǔ)言要素.PDF 04表達(dá)式.PDF 05門(mén)電平模型化.PDF 06用戶定義原語(yǔ).PDF 07數(shù)據(jù)流模型化.PDF 08行為建模.PDF 09結(jié)構(gòu)建模.PDF 10其它論題.PDF 11驗(yàn)證.PDF 12建模實(shí)例.PDF 13語(yǔ)法參考.PDF
標(biāo)簽： HDL Verilog 模型
上傳時(shí)間： 2013-12-28
上傳用戶：Andy123456
一維噴管流場(chǎng)計(jì)算FORTRAN語(yǔ)言編寫(xiě)無(wú)解壓密碼
標(biāo)簽： FORTRAN 計(jì)算 編寫(xiě) 密碼
上傳用戶：熊少鋒
這是實(shí)現(xiàn)隨機(jī)信號(hào)模擬用戶數(shù)據(jù)流，值得一看哦
標(biāo)簽： 隨機(jī)信號(hào) 模擬 數(shù)據(jù)流 用戶
上傳時(shí)間： 2015-09-11
上傳用戶：lhw888
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