同步數字復接的設計及其FPGA實現
在簡要介紹同步數字復接基本原理的基礎上，采用VHDL語言對同步數字復接各組成模塊進行了設計，并在ISE集成環境下進行了設計描述、綜合、布局布線及時序仿真，取得了正確的設計結果，同時利用中小容量的FPGA實現了同步數字復接功能。
基群速率數字信號的合成設備和分接設備是電信網絡中使用較多的關鍵設備，在數字程控交換機的用戶模塊、小靈通基站控制器和集團電話中都需要使用這種同步數字復接設備。近年來，隨著需要自建內部通信系統的公司和企業不斷增多，同步數字復接設備的使用需求也在增加。FPGA(現場可編程門陣列)器件的高性能簡化了數字通信系統的設計與實現。本文基于FPGA的技術特點，結合數字復接技術的基本原理，實現了基群速率(2048kbps)數字信號的數字分接與復接。
標簽：
FPGA
數字復接
上傳時間：
2013-12-20
上傳用戶：ommshaggar
