CMOS 邏輯系統的功耗主要與時脈頻率、系統內各閘極輸入電容及電源電壓有關,裝置尺寸縮小後,電源電壓也隨之降低,使得閘極大幅降低功耗。這種低電壓裝置擁有更低的功耗和更高的運作速度,因此系統時脈頻率可升高至 Ghz 範圍。
標簽: DDR 記憶體 電源
上傳時間: 2013-10-14
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本文將探討微控制器與 PSoC (可編程系統單晶片)在數位電視應用上的設計挑戰,並比較微控制器和 PSoC 架構在處理這些挑戰時的不同處,以有效地建置執行。
標簽: PSoC MCU 比較 數位電視
上傳時間: 2013-11-22
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本技術文章將介紹如何運用 NI LabVIEW FPGA 來設計並客製化個人的 RF 儀器,同時探索軟體設計儀器可為測試系統所提供的優勢。
標簽: 軟體 RF儀器
上傳時間: 2013-11-24
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特點: 精確度±0.15%滿刻度 可同時測量交流相電壓,線電壓,電流,實功率,虛功率,功率因素,頻率,仟瓦小時 輸入配線系統可任意選擇(1f2W/1f3W/3f3W/3f4W) CT比與PT比可任意設定(1至9999) 手動與自動顯示模式可任意規劃 3組警報控制功能 數位RS-485界面
標簽: 多功能 電力電表
上傳時間: 2013-11-14
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Hopfield 網——擅長于聯想記憶與解迷路 實現H網聯想記憶的關鍵,是使被記憶的模式樣本對應網絡能量函數的極小值。 設有M個N維記憶模式,通過對網絡N個神經元之間連接權 wij 和N個輸出閾值θj的設計,使得: 這M個記憶模式所對應的網絡狀態正好是網絡能量函數的M個極小值。 比較困難,目前還沒有一個適應任意形式的記憶模式的有效、通用的設計方法。 H網的算法 1)學習模式——決定權重 想要記憶的模式,用-1和1的2值表示 模式:-1,-1,1,-1,1,1,... 一般表示: 則任意兩個神經元j、i間的權重: wij=∑ap(i)ap(j),p=1…p; P:模式的總數 ap(s):第p個模式的第s個要素(-1或1) wij:第j個神經元與第i個神經元間的權重 i = j時,wij=0,即各神經元的輸出不直接返回自身。 2)想起模式: 神經元輸出值的初始化 想起時,一般是未知的輸入。設xi(0)為未知模式的第i個要素(-1或1) 將xi(0)作為相對應的神經元的初始值,其中,0意味t=0。 反復部分:對各神經元,計算: xi (t+1) = f (∑wijxj(t)-θi), j=1…n, j≠i n—神經元總數 f()--Sgn() θi—神經元i發火閾值 反復進行,直到各個神經元的輸出不再變化。
標簽: Hopfield 聯想
上傳時間: 2015-03-16
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基於S3C44B0X上的各種範例,可以實驗IDE,PWM,USB,LED...etc。對於初學嵌入式系統者有很大助益。
標簽: S3C44B0X
上傳時間: 2014-01-19
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本文探討使用 Linux作為嵌入式作業系統的方法,透過如何對內核、守護程序、庫和應用程序等四個主要部份,進行縮減其大小后,以便配置在以閃存為存儲設備的嵌入式系統中。
標簽: Linux 嵌入式 內核 減
上傳時間: 2014-10-11
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模擬退火算法來源于固體退火原理,將固體加溫至充分高,再讓其徐徐冷卻,加溫時,固體內部粒子隨溫升變為無序狀,內能增大,而徐徐冷卻時粒子漸趨有序,在每個溫度都達到平衡態,最后在常溫時達到基態,內能減為最小。根據Metropolis準則,粒子在溫度T時趨于平衡的概率為e-ΔE/(kT),其中E為溫度T時的內能,ΔE為其改變量,k為Boltzmann常數。用固體退火模擬組合優化問題,將內能E模擬為目標函數值f,溫度T演化成控制參數t,即得到解組合優化問題的模擬退火算法:由初始解i和控制參數初值t開始,對當前解重復“產生新解→計算目標函數差→接受或舍棄”的迭代,并逐步衰減t值,算法終止時的當前解即為所得近似最優解,這是基于蒙特卡羅迭代求解法的一種啟發式隨機搜索過程。退火過程由冷卻進度表(Cooling Schedule)控制,包括控制參數的初值t及其衰減因子Δt、每個t值時的迭代次數L和停止條件S。
標簽: 模擬退火算法
上傳時間: 2015-04-24
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上傳時間: 2014-12-19
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