機(jī)械五金類專輯 84冊 3.02G滑塊設(shè)計(jì) 15個 10.2M.rar
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上傳時間： 2014-05-05
上傳用戶：時代將軍
機(jī)械五金類專輯 84冊 3.02G包裝工程設(shè)計(jì)手冊 590頁 10.7M.pdf
實(shí)用電子技術(shù)專輯 385冊 3.609G電子連接器設(shè)計(jì)基礎(chǔ) 35頁 1.3M.ppt
開關(guān)電源相關(guān)專輯 119冊 749M開關(guān)電源基本原理與設(shè)計(jì)介紹 62頁 2.3M ppt.ppt
MP3 PCB布局設(shè)計(jì)指南.pdf 只供學(xué)習(xí)之用
標(biāo)簽： MP3 PCB pdf 布局
上傳時間： 2018-04-17
上傳用戶：yulin3192
58.8V7A.設(shè)計(jì)筆記 UCC38051D(SOIC-8) PFC 功率拓?fù)湓O(shè)計(jì)
標(biāo)簽： 58 8v7a
上傳時間： 2021-12-04
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開關(guān)電源的PCB設(shè)計(jì)規(guī)范.PDF
標(biāo)簽： pcb 開關(guān)電源
上傳時間： 2021-12-12
一篇來自臺灣中華大學(xué)的論文--《無線射頻系統(tǒng)標(biāo)簽晶片設(shè)計(jì)》，彩色版。其摘要為：本論文討論使用於無線射頻辨識系統(tǒng)(RFID)之標(biāo)籤晶片系統(tǒng)的電路設(shè)計(jì)和晶片製作，初步設(shè)計(jì)標(biāo)籤晶片的基本功能，設(shè)計(jì)流程包含數(shù)位軟體及功能的模擬、基本邏輯閘及類比電路的設(shè)計(jì)與晶片電路的佈局考量。 論文的第一部份是序論、射頻辨識系統(tǒng)的規(guī)劃、辨識系統(tǒng)的規(guī)格介紹及制定，而第二部份是標(biāo)籤晶片設(shè)計(jì)、晶片量測、結(jié)論。 電路的初步設(shè)計(jì)功能為:使用電容作頻率緩衝的Schmitt trigger Clock、CRC-16的錯誤偵測編碼、Manchester編碼及使用單一電路做到整流、振盪及調(diào)變的功能，最後完成晶片的實(shí)作。
標(biāo)簽： 大學(xué) 論文 無線射頻
上傳時間： 2016-08-27
上傳用戶：tb_6877751
PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計(jì)之零件腳PAD，不管是否鑽孔、電鍍。5. BOTTOM PAD：在銲錫面上所設(shè)計(jì)之零件腳PAD，不管是否鑽孔、電鍍。6. POSITIVE LAYER：單、雙層板之各層線路；多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER：通常指多層板之電源層。8. INNER PAD：多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD：多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍，不與零件腳相接。10. THERMAL PAD：多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD，一般稱為散熱孔或?qū)住?1. PAD (銲墊)：除了SMD PAD 外，其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點(diǎn)2. Test Point : ATE 測試點(diǎn)供工廠ICT 測試治具使用ICT 測試點(diǎn) LAYOUT 注意事項(xiàng):PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點(diǎn))，其原則如下：1. 一般測試點(diǎn)大小均為30-35mil，元件分布較密時，測試點(diǎn)最小可至30mil.測試點(diǎn)與元件PAD 的距離最小為40mil。2. 測試點(diǎn)與測試點(diǎn)間的間距最小為50-75mil，一般使用75mil。密度高時可使用50mil,3. 測試點(diǎn)必須均勻分佈於PCB 上，避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點(diǎn)留於錫爐著錫面上(Solder Side)。5. 測試點(diǎn)必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點(diǎn)設(shè)置處:Setuppadsstacks
標(biāo)簽： layout design pcb 硬件工程師
上傳時間： 2013-10-22
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本設(shè)計(jì)要點(diǎn)介紹了兩款能夠增加太陽能電池板接收能量的簡單電路。在這兩款電路中，均由太陽能電池板給電池充電，再由電池在沒有陽光照射的情況下提供應(yīng)用電路運(yùn)作所需的電源。
標(biāo)簽： 性能 減 太陽能電池板 尺寸
上傳時間： 2013-11-16
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