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用八塊8*8LED點陣顯示小時

  • 用FPGA實現的ADC采樣器

    用FPGA實現的ADC采樣器,用VHDL編寫,8個模擬信號通道地址,8位數據輸出

    標簽: FPGA ADC 采樣

    上傳時間: 2014-01-10

    上傳用戶:星仔

  • 用AT89S51單片機的P0.0/AD0-P0.7/AD7端口接數碼管的a-h端

    用AT89S51單片機的P0.0/AD0-P0.7/AD7端口接數碼管的a-h端,8位數碼管的S1-S8通過74LS138譯碼器的Y0-Y7來控制選通每個數碼管的位選端。AT89S51單片機的P1.0-P1.2控制74LS138的A,B,C端子。在8位數碼管上從右向左循環顯示“12345678”。能夠比較平滑地看到拉幕的效果。

    標簽: AD 0.0 0.7 89S

    上傳時間: 2016-06-17

    上傳用戶:wanghui2438

  • 有關八國皇后問題的求解

    有關八國皇后問題的求解,用C語言寫的,在TC下編譯成功。

    標簽:

    上傳時間: 2016-06-17

    上傳用戶:gundan

  • 此程序用VHDL語言編寫

    此程序用VHDL語言編寫,在四位加法器基礎上完成8位二進制加法,輸出是BCD碼

    標簽: VHDL 程序 語言 編寫

    上傳時間: 2014-11-03

    上傳用戶:努力努力再努力

  • 用VHDL編寫的一個出租車計費器

    用VHDL編寫的一個出租車計費器,起步6元計2公里,此后每半公里計0.8元,停車等待每2.5分計0.8元。通過仿真,但未下載到CPLD測試

    標簽: VHDL 編寫 出租車計費器

    上傳時間: 2016-06-18

    上傳用戶:asddsd

  • 用verilog語言編寫

    用verilog語言編寫,一個8-bit ALU,可以完成按字節的+、-和與、或、非操作

    標簽: verilog 語言 編寫

    上傳時間: 2013-12-06

    上傳用戶:妄想演繹師

  • 1. 搶答器同時供8名選手或8個代表隊比賽

    1. 搶答器同時供8名選手或8個代表隊比賽,分別用8個按鈕S0 ~ S7表示。 2. 設置一個系統清除和搶答控制開關S,該開關由主持人控制。 3. 搶答器具有鎖存與顯示功能。即選手按動按鈕,鎖存相應的編號,并在LED數碼管上顯示,同時揚聲器發出報警聲響提示。選手搶答實行優先鎖存,優先搶答選手的編號一直保持到主持人將系統清除為止。 4. 搶答器具有定時搶答功能,且一次搶答的時間由主持人設定(如30秒)。當主持人啟動"開始"鍵后,定時器進行減計時,同時揚聲器發出短暫的聲響,聲響持續的時間0.5秒左右。 5. 參賽選手在設定的時間內進行搶答,搶答有效,定時器停止工作,顯示器上顯示選手的編號和搶答的時間,并保持到主持人將系統清除為止。 6. 如果定時時間已到,無人搶答,本次搶答無效,系統報警并禁止搶答,定時顯示器上顯示00。

    標簽: 搶答器

    上傳時間: 2016-06-20

    上傳用戶:ccclll

  • 用51單片機實現

    用51單片機實現,8*8點陣顯示功能,源代碼提供。

    標簽: 51單片機

    上傳時間: 2014-12-09

    上傳用戶:cc1915

  • 用GA求函數的極小值群體大小為15

    用GA求函數的極小值群體大小為15,交叉概率為0.8, 變異概率取0.01

    標簽: 函數

    上傳時間: 2016-06-26

    上傳用戶:rocketrevenge

  • 輸入為八位十進制數

    輸入為八位十進制數,用bcd碼表示,還有平率技術函數

    標簽: 輸入 十進制數

    上傳時間: 2014-01-24

    上傳用戶:trepb001

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