MA1讀出器RS232兼容輸出16個ASCII字符每個ASCII字符代表4個2進制位的16進制數,因此整個輸出相當于64個二進制位。
標簽: ASCII MA1 232 字符
上傳時間: 2013-12-23
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數控調頻臺控制器 26H-29H放顯示小數位、個位、十位、百位BCD碼數,24H-25H放頻率控制數據(十六進制)
標簽: BCD 26 29 數控
上傳時間: 2013-12-20
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幾種排序算法的動畫演示,包括冒泡排序,選擇排序,插入排序,快速排序,堆排序,支持單步演示,
標簽: 排序 排序算法 動畫 快速排序
上傳時間: 2015-03-26
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華恒32位嵌入式LINUX平臺開發網絡稅控收款機的成功經典案例. 華
標簽: LINUX 嵌入式 平臺開發 網絡
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關于將電路制版的圖8X8的鍵盤加4位顯示器的8051實現多種功能(交通燈,順序控制器的電路圖)
標簽: 8051 8X8 電路 顯示器
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//浮點異常的控制位 #define FPUEM_INVALIDOP 0x01 #define FPUEM_DENORMALOP 0x02 #define FPUEM_ZERODIVIDE 0x04 #define FPUEM_OVERFLOW 0x08 #define FPUEM_UNDERFLOW 0x10 #define FPUEM_PRECISON 0x20 #define __FORCE_INLINE__ __inline /*---------------------------------------------------------- 打開指定的浮點異常 關閉指定的浮點異常
標簽: define FPUEM_DENORMALOP FPUEM_ZERODIVIDE FPUEM_INVALIDOP
上傳時間: 2013-11-27
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八位2進制相加 就是2進制數的加法 是8位的
標簽: 進制 加法 進制數
上傳時間: 2013-12-18
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用回溯法求馬周游問題,馬在棋盤上走字步,從馬開始的位置開始周游棋盤,遍歷全棋盤后回到起點,是否可行,可行的就輸出路徑,路徑并輸入嘗試過的路徑數,跳過的路徑數
標簽: 路徑 回溯法 輸出 輸入
上傳時間: 2015-03-28
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減1計數器 一、設計要求 用Verilog HDL語言設計一個計數器。 要求計數器具有異步置位/復位功能,可以進行自增和自減計數,其計數周期為2^N(N為二進制位數)。 二、設計原理 輸入/輸出說明: d:異步置數數據輸入; q:當前計數器數據輸出; clock:時鐘脈沖; count_en:計數器計數使能控制(1:計數/0:停止計數); updown:計數器進行自加/自減運算控制(1:自加/0:自減); load_d
標簽: Verilog 計數器 HDL 減
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SIGMA-DELTA 原理 實現的用LPC900系列單片機的比較器實現16位A/D。 有詳細的說明和源代碼(匯編格式,但是可以在KEIL下的C中調用)。
標簽: SIGMA-DELTA LPC 900 單片機
上傳時間: 2014-01-16
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