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異步通信

  • 步進(jìn)電機(jī)高分辨率細(xì)分控制函數(shù).rar

    本文首先介紹了步進(jìn)電機(jī)的細(xì)分電流控制策略(實(shí)質(zhì)是細(xì)分控制函數(shù)發(fā)生器),然后討論了圓弧插 補(bǔ)產(chǎn)生步進(jìn)電機(jī)細(xì)分電流的控制方法。最后介紹一 個(gè)行之有效的優(yōu)化修正方法—— 加權(quán)補(bǔ)償法。

    標(biāo)簽: 步進(jìn)電機(jī) 函數(shù)

    上傳時(shí)間: 2013-07-28

    上傳用戶:lgs12321

  • 基于FPGA的步進(jìn)電機(jī)正弦波細(xì)分驅(qū)動(dòng)器設(shè)計(jì).rar

    本文提出了一種基于SOPC 片上可編程的全數(shù)字化步進(jìn)電機(jī)控制系統(tǒng),本系統(tǒng)是以 FPGA 為核心控制器件,將驅(qū)動(dòng)邏輯功能模塊和控制器成功地集成在FPGA 上實(shí)現(xiàn),充分 發(fā)揮了硬件邏輯電路對數(shù)字信號高速的并行處理能力,可以使步進(jìn)電機(jī)繞組電流細(xì)分達(dá)到 4096,且細(xì)分?jǐn)?shù)可以自動(dòng)調(diào)節(jié),極大地提高了控制精度和驅(qū)動(dòng)器的集成度,減小了驅(qū)動(dòng)器 體積。

    標(biāo)簽: FPGA 步進(jìn)電機(jī) 正弦波

    上傳時(shí)間: 2013-05-21

    上傳用戶:pei5

  • 步進(jìn)電機(jī)的細(xì)分驅(qū)動(dòng)技術(shù)研究.rar

    本文論述了以電流矢量恒幅均勻旋轉(zhuǎn)原理為基礎(chǔ)的步進(jìn)電機(jī)細(xì)分技術(shù), 設(shè)計(jì)了基于單片機(jī)的SPWM控 制的電流矢量恒幅均勻旋的細(xì)分驅(qū)動(dòng)模式, 并通過對軟件數(shù)據(jù)的設(shè)置可以實(shí)現(xiàn)多種細(xì)分級數(shù)驅(qū)動(dòng)控制。并在 此基礎(chǔ)上為修正誤差引入電流反饋環(huán)節(jié), 實(shí)現(xiàn)了對混合式步進(jìn)電機(jī)精確運(yùn)行控制。

    標(biāo)簽: 步進(jìn)電機(jī) 技術(shù)研究

    上傳時(shí)間: 2013-06-05

    上傳用戶:cceezzpp

  • 用SPI總線實(shí)現(xiàn)DSP和MCU之間的高速通信.rar

    簡述了SPI總線協(xié)議工作時(shí)序和配置要求,通過一個(gè)成功的實(shí)例詳細(xì)介紹了使用SPI 總線實(shí)現(xiàn)DSP與MCU之間的高速通信方法,并參考實(shí)例給出了SPI接口的硬件連接、初始化、 以及傳輸測試程序的編寫方法。 關(guān)鍵詞:SPI接口;McBSP;總線;高速通信

    標(biāo)簽: SPI DSP MCU

    上傳時(shí)間: 2013-04-24

    上傳用戶:jhksyghr

  • TMS320系列DSP與C51單片機(jī)之間一種全新串行通信模式.rar

    單片機(jī)與DSP之間通信問題一直是大家關(guān)注得焦點(diǎn),目前已出現(xiàn)的不少解決方案但大多針對于5V工作電壓的DSP系 統(tǒng),筆者對諸方案進(jìn)行詳細(xì)比較分析,發(fā)現(xiàn)多數(shù)并未從根本上解決不同系統(tǒng)之間通信的電平轉(zhuǎn)換問題,面對工作電壓并不唯一的 DSP芯片系列,在此提出一種全新的串行通信模式,經(jīng)濟(jì)有效地解決了通信中電平轉(zhuǎn)換問題可靠地實(shí)現(xiàn)數(shù)據(jù)交換,并且在實(shí)際開發(fā) 的直流無刷電機(jī)變頻器人機(jī)界面與控制核心TMS320LF2407 DSP之間串行通信中驗(yàn)證了其可行性。

    標(biāo)簽: TMS 320 DSP C51

    上傳時(shí)間: 2013-07-18

    上傳用戶:abc123456.

  • 步進(jìn)電機(jī)基本知識(shí).rar

    步進(jìn)電機(jī)基本知識(shí).rar,介紹步進(jìn)電機(jī)基本知識(shí)、參數(shù)、使用

    標(biāo)簽: 步進(jìn)電機(jī) 基本知識(shí)

    上傳時(shí)間: 2013-06-14

    上傳用戶:zwei41

  • Systemview動(dòng)態(tài)系統(tǒng)分析及通信系統(tǒng)仿真設(shè)計(jì).rar

    Systemview動(dòng)態(tài)系統(tǒng)分析 及 通信系統(tǒng) 仿真設(shè)計(jì)

    標(biāo)簽: Systemview 動(dòng)態(tài) 仿真設(shè)計(jì)

    上傳時(shí)間: 2013-06-10

    上傳用戶:chens000

  • 基于DSP與FPGA的兩相混合式步進(jìn)電機(jī)細(xì)分驅(qū)動(dòng)的實(shí)現(xiàn).rar

    在步進(jìn)電機(jī)驅(qū)動(dòng)方式中,效果最好的是細(xì)分驅(qū)動(dòng),當(dāng)今高端的步進(jìn)電機(jī)驅(qū)動(dòng)器基本都采用這種技術(shù)。步進(jìn)電機(jī)的細(xì)分驅(qū)動(dòng)技術(shù)是一門綜合了數(shù)字化技術(shù)、集成控制技術(shù)和計(jì)算機(jī)技術(shù)的新技術(shù),被廣泛應(yīng)用于工業(yè)、科研、通訊、天文等領(lǐng)域。 本文設(shè)計(jì)了一種基于DSP以及FPGA的兩相混合式步進(jìn)電機(jī)SPWM(正弦脈寬調(diào)制)波細(xì)分驅(qū)動(dòng)系統(tǒng)。在DSP系統(tǒng)中采用TMS320I.F2407A微控制器作為核心控制器件,用軟件產(chǎn)生SPWM波;在FPGA系統(tǒng)中采用FPGA芯片,通過VerilogHDL語言,實(shí)現(xiàn)了SPWM波;在功率驅(qū)動(dòng)級電路上采用雙極性H橋的驅(qū)動(dòng)方式。最終實(shí)現(xiàn)了對兩相混合式步進(jìn)電機(jī)SPWM波細(xì)分驅(qū)動(dòng),大大提高了步進(jìn)電機(jī)的運(yùn)轉(zhuǎn)性能。 本文介紹了兩相混合式步進(jìn)電機(jī)的工作原理、控制原理以及細(xì)分驅(qū)動(dòng)的基本原理。通過對恒轉(zhuǎn)矩細(xì)分驅(qū)動(dòng)的分析,提出了兩相混合式步進(jìn)電機(jī)SPWM波細(xì)分驅(qū)動(dòng)的方案,并給出了SPWM波產(chǎn)生的數(shù)學(xué)模型。最后,對步進(jìn)電機(jī)的SPWM波細(xì)分驅(qū)動(dòng)系統(tǒng)進(jìn)行了實(shí)驗(yàn)測量,給出了實(shí)驗(yàn)結(jié)果。 實(shí)驗(yàn)的結(jié)果表明,設(shè)計(jì)的基于DSP與FPGA的SPWM波細(xì)分驅(qū)動(dòng)系統(tǒng)可以很好地克服電機(jī)低頻振蕩的問題,提高電機(jī)在中、低速運(yùn)行的性能。電機(jī)的掃描范圍與理論值基本接近;微步距在誤差允許的范圍內(nèi)也基本可以滿足要求。

    標(biāo)簽: FPGA DSP 步進(jìn)電機(jī)

    上傳時(shí)間: 2013-04-24

    上傳用戶:WANGLIANPO

  • 采用FPGA的步進(jìn)電機(jī)控制系統(tǒng)研究.rar

    論文以反應(yīng)式步進(jìn)電機(jī)為研究對象,應(yīng)用了先進(jìn)的FPGA/CPLD技術(shù),設(shè)計(jì)了一種全數(shù)字的步進(jìn)電機(jī)控制系統(tǒng),通過了仿真、綜合和下載的各個(gè)程序測試環(huán)節(jié),并在實(shí)驗(yàn)中得到了良好的應(yīng)用。 本論文分析了反應(yīng)式步進(jìn)電機(jī)工作原理以及其具體的控制過程,然后闡述了FPGA的設(shè)計(jì)原理以及所涉及到的相關(guān)芯片,接著對所要應(yīng)用的硬件語言VerilogHDL方面的知識(shí)進(jìn)行了簡要地介紹,這些為論文的具體設(shè)計(jì)部分提供了理論基礎(chǔ)。 本系統(tǒng)針對需要實(shí)現(xiàn)對步進(jìn)電機(jī)的調(diào)速,設(shè)計(jì)出了一種符合要求的連續(xù)可調(diào)的脈沖信號發(fā)生器,整個(gè)脈沖信號發(fā)生器有兩個(gè)大的模塊組成,最后用一個(gè)頂層的模塊將二者連接起來,并且每個(gè)子模塊以及頂層的模塊都通過了仿真測試。系統(tǒng)采用了模塊化的設(shè)計(jì)思路,為系統(tǒng)的設(shè)計(jì)和維護(hù)提供了方便,同時(shí)也提高了系統(tǒng)性能的可擴(kuò)展性。系統(tǒng)采用一種軟件硬化的設(shè)計(jì)思路,應(yīng)用了VerilogHDL硬件語言,該語言較容易理解。軟件也是采用了目前應(yīng)用比較廣泛的幾種。在最后的實(shí)物實(shí)驗(yàn)中也取得了良好的效果,從而證明了設(shè)計(jì)的正確性。論文針對VerilogHDL硬件語言的應(yīng)用技巧以及實(shí)際編寫程序中經(jīng)常遇到的問題都做了詳細(xì)的解釋,并提出了幾個(gè)解決問題的方法;對于如何合理的選擇芯片,文章也做了仔細(xì)說明。 FPGA+VerilogHDL+EDA工具構(gòu)成的數(shù)字系統(tǒng)現(xiàn)場集成技術(shù),是本系統(tǒng)設(shè)計(jì)的核心部分,該門技術(shù)具有操作靈活、利用廣泛以及價(jià)廉等特點(diǎn)。該門技術(shù)具有旺盛的生命力和廣闊的前景,必然推動(dòng)著整個(gè)集成電路產(chǎn)業(yè)系統(tǒng)集成的進(jìn)一步發(fā)展。整個(gè)系統(tǒng)設(shè)計(jì)采用了全數(shù)字化的控制方案,使系統(tǒng)更加緊湊、更加合理以及經(jīng)濟(jì)節(jié)約。由于系統(tǒng)的全數(shù)字化,使得整個(gè)系統(tǒng)運(yùn)行變得十分可靠,調(diào)試也極為方便。作為一種先進(jìn)技術(shù)的應(yīng)用,論文在很多方面做了新的嘗試。

    標(biāo)簽: FPGA 步進(jìn)電機(jī)控制 系統(tǒng)研究

    上傳時(shí)間: 2013-05-20

    上傳用戶:zoushuiqi

  • 基于FPGA DSP架構(gòu)的高速通信接口設(shè)計(jì)與實(shí)現(xiàn)

    本文采用 altera 公司cyclone 系列芯片ep1c12 實(shí)現(xiàn)了與ts101/ts201 兩種芯片的鏈路口的雙工通信,并給出了具體的設(shè)計(jì)實(shí)現(xiàn)方法。其中ts101 的設(shè)計(jì)已經(jīng)成功應(yīng)用于某

    標(biāo)簽: FPGA DSP 架構(gòu) 接口設(shè)計(jì)

    上傳時(shí)間: 2013-06-15

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