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發(fā)與設(shè)計

  • CAN原理與應用

    ?CAN BUS: Controller area network(ISO-11898) 是起緣於80年代,由國際標準化組織(ISO)所 發佈,是一種應用於極嚴苛環境下的傳輸匯流排

    標簽: CAN

    上傳時間: 2016-11-24

    上傳用戶:test1111

  • 設有二元函數 f(x,y) = f(x) + f(y)

    設有二元函數 f(x,y) = f(x) + f(y) 其中: f(x) = f(x-1) * x (x >1) f(x)=1  (x=1) f(y) = f(y-1) + f(y-2)  (y> 2) f(y)=1  (y=1,2) 請編程建立 3 個并發協作進程,它們分別完成 f(x,y)、f(x)、f(y)

    標簽: 二元 函數

    上傳時間: 2017-04-21

    上傳用戶:WWSAE

  • 超級兔子魔法設定 v5.88

    超級兔子魔法設定 v5.88 繁體中文版 含序號

    標簽: v5 88

    上傳時間: 2017-05-05

    上傳用戶:kiili2

  • ESD Protection in CMOS ICs

    在互補式金氧半(CMOS)積體電路中,隨著量產製程的演進,元件的尺寸已縮減到深次微 米(deep-submicron)階段,以增進積體電路(IC)的性能及運算速度,以及降低每顆晶片的製造 成本。但隨著元件尺寸的縮減,卻出現一些可靠度的問題。 在次微米技術中,為了克服所謂熱載子(Hot-Carrier)問題而發展出 LDD(Lightly-Doped Drain) 製程與結構; 為了降低 CMOS 元件汲極(drain)與源極(source)的寄生電阻(sheet resistance) Rs 與 Rd,而發展出 Silicide 製程; 為了降低 CMOS 元件閘級的寄生電阻 Rg,而發展出 Polycide 製 程 ; 在更進步的製程中把 Silicide 與 Polycide 一起製造,而發展出所謂 Salicide 製程

    標簽: Protection CMOS ESD ICs in

    上傳時間: 2020-06-05

    上傳用戶:shancjb

  • 華為開關電源電感器設計.pdf

    華為開關電源電感器設計 正激式開關電源變壓器設計步驟

    標簽: 華為 開關電源

    上傳時間: 2021-12-03

    上傳用戶:fliang

  • The Cathode-Ray Tube at Work by John F. Rider

    The Cathode-Ray Tube at Work by John F. Rider (z-lib.org).pdf

    標簽: 陰極射線管

    上傳時間: 2022-01-16

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  • 基于F-P光纖干涉儀的壓力傳感器

    基于F-P光纖干涉儀的壓力傳感器

    標簽: 壓力傳感器 光纖干涉儀

    上傳時間: 2022-01-18

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  • 5G系統中F-OFDM算法設計

    5G系統中F-OFDM算法設計5G 系統中 F-OFDM 算法設計 摘 要: 將 F ( filter ) - OFDM 的框架應用在傳統的 LTE 系統上 。 利用該新的波形技術 , LTE 系統可以支持更加靈活的 參數配置, 滿足未來 5G 豐富的業務需求。 通過發射機子帶濾波器的設計, 相鄰子帶間的帶外泄漏 (OOB ) 可以被大幅度抑 制。 接收機采用匹配濾波機制實現各個子帶的解耦。 最后通過實驗仿真, 比較 OFDM 系統和 F- OFDM 系統的誤塊率 (BLER ) 性能, 可以看到當存在鄰帶干擾時, 后者通過子帶濾波器對干擾的抑制, 系統性能明顯優于前者。 關鍵詞: F- OFDM ; 帶外泄漏 (OOB ) ;

    標簽: 5G

    上傳時間: 2022-02-25

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  • cadence-allegro16.6高級教程

    主要內容介紹 Allegro 如何載入 Netlist,進而認識新式轉法和舊式轉法有何不同及優缺點的分析,透過本章學習可以對 Allegro 和 Capture 之間的互動關係,同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉入動作只是針對由 Capture(線路圖部分)產生的 Netlist 轉入 Allegro(Layout部分)1. 在 OrCAD Capture 中設計好線路圖。2. 然後由 OrCAD Capture 產生 Netlist(annotate 是在進行線路圖根據第五步產生的資料進行編改)。 3. 把產生的 Netlist 轉入 Allegro(layout 工作系統)。 4. 在 Allegro 中進行 PCB 的 layout。 5. 把在 Allegro 中產生的 back annotate(Logic)轉出(在實際 layout 時可能對原有的 Netlist 有改動過),並轉入 OrCAD Capture 裏進行回編。

    標簽: cadence allegro

    上傳時間: 2022-04-28

    上傳用戶:kingwide

  • MT9P001-5100-Rev-F圖像傳感器手冊

    MT9P001-5100-Rev-F圖像傳感器手冊

    標簽: 圖像傳感器

    上傳時間: 2022-06-12

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