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監(jiān)聽(tīng)器

  • 一、實驗目的 了解數/模轉換器的基本原理

    一、實驗目的 了解數/模轉換器的基本原理,掌握DAC0832芯片的使用方法。 二、實驗內容 1、實驗電路原理如圖36,DAC0832采用單緩沖方式,具有單雙極性輸入端(圖中的Ua、Ub),利用debug輸出命令(Out 290 數據)輸出數據給DAC0832,用萬用表測量單極性輸出端Ua及雙極性輸出端Ub的電壓,驗證數字與電壓之間的線性關系。 2、編程產生以下波形(從Ub輸出,用示波器觀察) (1)鋸齒波 三、編程提示 1、8位D/A轉換器DAC0832的口地址為290H,輸入數據與輸出電壓的關系為: (UREF表示參考電壓,N表示數數據),這里的參考電壓為PC機的+5V電源。 2、產生鋸齒波只須將輸出到DAC0832的數據由0循環遞增。

    標簽: 實驗 模轉換器

    上傳時間: 2016-03-12

    上傳用戶:ywqaxiwang

  • 分頻器是FPGA設計中使用頻率非常高的基本單元之一。盡管目前在大部分設計中還廣泛使用集成鎖相環(如altera的PLL

    分頻器是FPGA設計中使用頻率非常高的基本單元之一。盡管目前在大部分設計中還廣泛使用集成鎖相環(如altera的PLL,Xilinx的DLL)來進行時鐘的分頻、倍頻以及相移設計,但是,對于時鐘要求不太嚴格的設計,通過自主設計進行時鐘分頻的實現方法仍然非常流行。首先這種方法可以節省鎖相環資源,再者,這種方式只消耗不多的邏輯單元就可以達到對時鐘操作的目的。 偶數倍分頻:偶數倍分頻應該是大家都比較熟悉的分頻,通過計數器計數是完全可以實現的。如進行N倍偶數分頻,那么可以通過由待分頻的時鐘觸發計數器計數,當計數器從0計數到N/2-1時,輸出時鐘進行翻轉,并給計數器一個復位信號,使得下一個時鐘從零開始計數。以此循環下去。這種方法可以實現任意的偶數分頻。

    標簽: altera FPGA PLL 分頻器

    上傳時間: 2016-06-14

    上傳用戶:wpwpwlxwlx

  • J T AG 接口插座與DSP芯片的距離:為了保證JTAG信號不受干擾

    J T AG 接口插座與DSP芯片的距離:為了保證JTAG信號不受干擾,需 要注意兩者之間的距離不超過六英寸(15甲24厘米),超過這個距離,就需要在中 間加緩沖芯片。本設計中使用了244作為緩沖芯片,但其原因不是由于器件之間 距離過長,而是考慮到仿真器工作在5V電壓,DSP引腳為3.3V,為了電平兼容 性而進行的電壓轉換功能。

    標簽: JTAG DSP AG 接口

    上傳時間: 2013-12-18

    上傳用戶:fnhhs

  • Program main BIOS image | | /B - Program Boot Block | | /N - Program NVRAM | | /C - Destroy CM

    Program main BIOS image | | /B - Program Boot Block | | /N - Program NVRAM | | /C - Destroy CMOS checksum | | /E - Program Embedded Controller Block | | /K - Program all non-critical blocks | | /Kn - Program n th non-critical block only(n=0-7) | | /Q - Silent execution | | /REBOOT - Reboot after programming | | /X - Don t Check ROM ID | | /S - Display current system s ROMID | | /Ln - Load CMOS defaults

    標簽: Program Destroy Block NVRAM

    上傳時間: 2016-07-26

    上傳用戶:wfl_yy

  • 問題描述 設有n種不同面值的硬幣

    問題描述 設有n種不同面值的硬幣,各硬幣的面值存于數組T[1:n]中。現要用這些面值的硬幣來找錢,可以實用的各種面值的硬幣個數不限。當只用硬幣面值T[1],T[2],…,T[i]時,可找出錢數j的最少硬幣個數記為C(i,j)。若只用這些硬幣面值,找不出錢數j時,記C(i,j)=∞。  編程任務 設計一個動態規劃算法,對1≤j≤L,計算出所有的C( n,j )。算法中只允許實用一個長度為L的數組。用L和n作為變量來表示算法的計算時間復雜性  數據輸入 由文件input.txt提供輸入數據。文件的第1行中有1個正整數n(n<=13),表示有n種硬幣可選。接下來的一行是每種硬幣的面值。由用戶輸入待找錢數j。  結果輸出 程序運行結束時,將計算出的所需最少硬幣個數輸出到文件output.txt中。

    標簽:

    上傳時間: 2016-07-28

    上傳用戶:yangbo69

  • 七號信令解碼器

    七號信令解碼器,N多人多年心血,奉獻給需要的人,有問題請email:leafboyman@tom.com

    標簽: 七號信令 解碼器

    上傳時間: 2016-08-02

    上傳用戶:love_stanford

  • Target:89S51 程序描述:網絡遠端溫度感測器

    Target:89S51 程序描述:網絡遠端溫度感測器,這個范例中使用到  (1)8051 的Port 1連接到LCD顯示器,PORT 3的P3.3、P3.4和P3.5分別連接到LCD顯示器的控制線,程序執行時可以讓LCD顯示器顯示出時間和日期。 (2)溫度感測組件AD590經由ADC0804將感測到的溫度,轉換成數位數據,然后經由PORT 0輸入8051。 (3)igangcai 8051的第10和第11只腳RXD和TXD分別連線到MAX232,然后連接到PC的COM埠。  (4) 當PC端經由RS232傳送S時,接下來PC送出的下 個byte就用來設定PORT 3的輸出。  (5) 當PC端經由RS232傳送T時,接下來PC連續送出五個bytes,這五個bytes是 "年月日時分",這是 PC 用來設定實驗板的時間日期。  (6) 8051每 分鐘就讀入ADC0804轉換的數字溫度數據,然后通過RS232傳送給PC端,再由PC端通過網絡傳送到遠端的電腦。*/

    標簽: Target 89S51 程序 溫度

    上傳時間: 2016-08-06

    上傳用戶:shizhanincc

  • 微軟宏匯編器masm的四本書MASM DOCUMENTION《getting Start》《Reference Guide》《Programmer s Guide》《Environment and T

    微軟宏匯編器masm的四本書MASM DOCUMENTION《getting Start》《Reference Guide》《Programmer s Guide》《Environment and Tools》附INTEL處理器結構手冊(三卷)

    標簽: Guide DOCUMENTION Environment Programmer

    上傳時間: 2013-12-23

    上傳用戶:懶龍1988

  • 本文使用實例描述了在 FPGA/CPLD 上使用 VHDL 進行分頻器設 計

    本文使用實例描述了在 FPGA/CPLD 上使用 VHDL 進行分頻器設 計,包括偶數分頻、非 50%占空比和 50%占空比的奇數分頻、半整數 (N+0.5)分頻、小數分頻、分數分頻以及積分分頻。所有實現均可 通過 Synplify Pro 或 FPGA 生產廠商的綜合器進行綜合,形成可使 用的電路,并在 ModelSim 上進行驗證。

    標簽: FPGA CPLD VHDL 分頻器

    上傳時間: 2013-12-15

    上傳用戶:從此走出陰霾

  • 該模塊為分頻器

    該模塊為分頻器,將1KHZ的時鐘頻率分頻成每分鐘一次的時鐘頻率 事實上,該源碼可以實現任意整數的分頻,主要讓N的值設置好相應的數字

    標簽: 模塊 分頻器

    上傳時間: 2013-12-30

    上傳用戶:xlcky

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