我國電網無功補償容量不足和配備不合理，特別是可調節的無功容量不足，快速響應的無功調節設備更少。沖擊性負荷更會使得電網無功功率不平衡，將導致系統電壓的巨大波動、善變，嚴重時會導致用電設備的損壞，出現系統電壓崩潰和穩定性被破壞事故。 FC+TCR型靜止無功補償裝置響應速度快，可以動態補償無功功率，提高系統功率因數，抑制系統電壓波動和閃變，因此在電氣化鐵路、電弧爐、軋機等的負荷無功補償上得到廣泛應用。中小用戶由于成本高較少使用，但中小用戶無功補償容量及市場巨大，研制適合中小用戶的FC+TCR型靜止無功補償裝置很有必要。基于此目的，本文研制一臺10kV FC+TCR型靜止無功補償裝置，并以此為研究對象進行設計理論研究工作。 本文根據負荷無功功率的變化情況，計算了靜止無功補償裝置的主電路參數，設計配備了高電位取能觸發板和BOD過電壓保護板。選擇以TMS320F2812為核心的嵌入式控制板為主要部件，設計信號接入電路和晶閘管觸發脈沖形成電路，構成最基本的靜止無功補償控制器。 基于瞬時無功補償理論和不平衡負荷的平衡化原理（Steinmetz原理），建立補償電納計算模型，通過電壓電流瞬時值采樣計算需要補償的瞬時無功功率和電納，根據補償電納通過查表方法求得晶閘管的控制角，并將其應用到靜止無功補償裝置樣機中。仿真結果表明，算法是快速有效和準確的，主電路的參數是合理的，具有實際工程應用價值。
上傳時間： 2013-08-02
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近年來，近距離無線傳輸技術是發展最快、最引入注目的技術，而ZigBee恰恰是填補了低速率無線通信技術的空缺，與其他標準在應用上相得益彰。它專注于近距離傳輸，成本低、同時入門檻也低，雖然其出現較晚，但目前已經得到人們越來越多的關注，成為無線技術研究的一個新熱點。 本文在詳細分析了傳統的抄表方式和無線抄表系統的發展狀況以及相關的無線數據傳輸技術的基礎上，提出了基于ZigBee技術的無線抄表系統的方案。論文在研究ZigBee組網技術的基礎上，設計了基于ZigBee開發平臺的無線嵌入式抄表系統，編寫了相應的軟件，完成了相應的調試和分析，并進行了系統的可靠性、實時性和安全性等問題分析。為了減少系統由于節點路由而造成的功耗損耗過大的問題，本文在組網應用過程中采用Tree+AODVjr的路由算法，從而保持系統能夠保持較小功耗的情況下進行數據的多跳路由，同時以ARM S3C2410為核心實現了基站設計，實現小區電表數據的集中采集，并通過GPRS/GSM模塊實現基站和抄表中心的數據傳輸和實時控制，在此基礎上，對抄表系統軟件也進行了相應的設計。 通過單點對單點、星形網絡數據傳輸實驗，取得了相應的實驗數據，對于協議的特點、系統可靠性和功耗情況有了整體把握，為今后ZigBee技術的進一步研究和應用打下了堅實基礎。 實驗結果顯示，本文提出的方案切實可行，并且采用ZigBee技術具有節約資源、操作方便、可靠性高而且易于管理等特點，基站和系統利用較為成熟的GPRS/GSM網絡技術進行通訊，既滿足了實時性要求，又降低了成本。
上傳時間： 2013-06-27
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隨著網絡技術的飛速發展，辦公樓宇或住宅小區的用電管理也正逐步走向智能化、網絡化。論文針對傳統的電表系統具有抗干擾能力差、計量不精確、人工抄表費時費力、功能單一等缺點，提出了一套基于以太網傳輸的三相電量采集系統。該系統采用電能計量芯片CS5460A負責采集電量，AT89S53單片機作為數據處理的核心部件，通過SPI總線傳送電流、電壓、有功、無功等實時測量值，并用以太網控制器ENC28J60，實現以太網通信，配合上位機顯示，對電能進行集中管理。 本系統采用電子計量芯片代替傳統的機械脈沖式電能表，并結合用電特性，使得電能計量精度大大提高，電量統計也更加精確。電能表輸出的脈沖信號經過網絡模塊的統計換算之后，通過以太網傳輸給管理計算機，使得傳輸距離大大增加。用電量信息經過統計計算存入數據庫，可以生成一個用戶用電報表并可打印出來，這樣可有效的把電能計量、收費管理、用電過程管理等功能集于一體。采用以太網總線控制，不僅減少了布線的成本和難度，且利于數據在局域網內的共享。 本文首先對當前電子式電能表的發展情況、技術特點作了一個簡單的概述。其次闡述了系統的硬件電路設計及系統軟件設計，并對以太網通信的重要依據-TCP/IP協議作了全面的分析，介紹了TCP/IP協議的四個協議層：鏈路層、網絡層、傳輸層和應用層及其具體實現方法，精簡了TCP/IP協議。最后簡單介紹了上位機上的管理軟件設計。
上傳時間： 2013-06-09
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基于M S P 430單片機的數字電壓表的設計設計電路圖
上傳時間： 2013-06-02
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基于AT89C51單片機的數字電壓表的設計
上傳時間： 2013-07-10
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單片機課程設計：采用51系列單片機和ADC設計一個數字電壓表，輸入為0～5V線性模擬信號，輸出通過LED顯示，要求顯示兩位小數。
標簽： 數字電壓表
上傳時間： 2013-04-24
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完整的紅外抄表系統 自己做過的項目 包括完整的程序和電路圖,PCB板圖 使用偉福編譯器編譯
上傳時間： 2013-07-14
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調整視頻圖像的分辨率需要視頻縮放技術。如果圖像縮放技術的處理速度達到實時性要求就可以應用于視頻縮放。 傳統圖像縮放技術利用插值核函數對已有像素點進行插值重建還原圖像。本文介紹了圖像插值的理論基礎一采樣定理，并對理想重建函數Sinc函數進行了討論。本文介紹了常用的線性圖像插值技術及像素填充、自適應插值和小波域圖像縮放等技術。然后，本文討論了分級線性插值算法的思想，設計并實現了FPGA上的分級雙三次算法。最后本文對各種算法的縮放效果進行了分析和討論。 本文在分析現有視頻縮放算法基礎之上，提出了分級線性插值算法，并應用在簡化線性插值算法中。分級線性插值算法以犧牲一定的計算精度為代價，用查找表代替乘法計算，降低了算法復雜度。本文設計并實現了分級雙三次插值算法，詳細說明了板上系統的模塊結構。最后本文將分級線性插值算法與原線性插值算法效果圖進行比較，比較結果顯示分級插值算法與原算法誤差較小，在放大比例較小時可以取代原算法。結果證明分級雙三次線性插值算法的FPGA實現能夠滿足額定幀頻，可以進行實時視頻縮放。
上傳時間： 2013-04-24
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MPEG-2是MPEG組織在1994年為了高級工業標準的圖象質量以及更高的傳輸率所提出的視頻編碼標準，其優秀性使之成為過去十年應用最為廣泛的標準，也是未來十年影響力最為廣泛的標準之一。 本文以MPEG-2視頻標準為研究內容，建立系統級設計方案，設計FPGA原型芯片，并在FPGA系統中驗證視頻解碼芯片的功能。最后在0.18微米工藝下實現ASIC的前端設計。完成的主要工作包括以下幾個方面： 1.完成解碼系統的體系結構的設計，采用了自頂而下的設計方法，實現系統的功能單元的劃分；根據其視頻解碼的特點，確定解碼器的控制方式；把視頻數據分文幀內數據和幀間數據，實現兩種數據的并行解碼。 2.實現了具體模塊的設計：根據本文研究的要求，在比特流格式器模塊設計中提出了特有的解碼方式；在可變長模塊中的變長數據解碼采用組合邏輯外加查找表的方式實現，大大減少了變長數據解碼的時間；IQ、IDCT模塊采用流水的設計方法，減少數據計算的時間：運動補償模塊，針對模塊數據運算量大和訪問幀存儲器頻繁的特點，采用四個插值單元同時處理，增加像素緩沖器，充分利用并行性結構等方法來加快運動補償速度。 3.根據視頻解碼的參考軟件，通過解碼系統的仿真結果和軟件結果的比較來驗證模塊的功能正確性。最后用FPGA開發板實現了解碼系統的原型芯片驗證，取得了良好的解碼效果。 整個設計采用Verilog HDL語言描述，通過了現場可編程門陣列(FPGA)的原型驗證，并采用SIMC0.18μm工藝單元庫完成了該電路的邏輯綜合。經過實際視頻碼流測試，本文設計可以達到MPEG-2視頻主類主級的實時解碼的技術要求。
上傳時間： 2013-07-27
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MP3音樂是目前最為流行的音樂格式，因其音質、復雜度與壓縮比的完美折中，占據著廣闊的市場，不僅在互聯網上廣為流傳，而且在便攜式設備領域深受人們喜愛。本文以MPEG-1的MP3音頻解碼器為研究對象，在實時性、面積等約束條件下，研究MP3解碼電路的設計方法，實現FPGA原型芯片，研究MP3原型芯片的驗證方法。 論文的主要貢獻如下： (1)使用算法融合方法合并MP3解碼過程的相關步驟，以減少緩沖區存儲單元的容量和訪存次數。如把重排序步驟融合到反量化模塊，可以減少一半的讀寫RAM操作；把IMDCT模塊內部的三個算法步驟融合在一起進行設計，可以省去存儲中間計算結果的緩存區單元。 (2)反量化、立體聲處理等模塊中，采用流水線設計技術，設置寄存器把較長的組合邏輯路徑隔開，提高了電路的性能和可靠性；使用連續訪問公共緩存技術，合理規劃各計算子模塊的工作時序，將數據計算的時間隱藏在訪存過程中；充分利用頻率線的零值區特性，有效地減少數據計算量，加快了數據處理的速度。 (3)設計了MP3硬件解碼器的FPGA原型芯片。采用Verilog HDL硬件描述語言設計RTL級電路，完成功能仿真，以Altera公司Stratix II系列的EP2S180 FPGA開發板為平臺，實現MP3解碼器的FPGA原型芯片。MP3硬件解碼器在Stratix II EP2S180器件內的資源利用率約為5％，其中組合邏輯查找表ALUT為7189個，寄存器共有4024個，系統頻率可達69.6MHz，充分滿足了MP3解碼過程的實時性要求。實驗結果表明，MP3音頻解碼FPGA原型芯片可正常播放聲音，解碼音質良好。
上傳時間： 2013-07-01
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