偽隨機(jī)序列產(chǎn)生器－線性反饋移位寄存器，Verilog HDL 原代碼。
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上傳時(shí)間： 2016-12-04
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偽隨機(jī)序列產(chǎn)生器－代進(jìn)位反饋移位寄存器，verilog hdl 原代碼。
標(biāo)簽： 偽隨機(jī)序列 產(chǎn)生器 進(jìn)位 反饋移位寄存器
上傳時(shí)間： 2014-09-05
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偽隨機(jī)序列產(chǎn)生器－filtered 代進(jìn)位反饋移位寄存器，verilog hdl 原代碼。
標(biāo)簽： filtered 偽隨機(jī)序列 產(chǎn)生器 進(jìn)位
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偽隨機(jī)序列產(chǎn)生器－代進(jìn)位反饋移位寄存器，matlab 原代碼。
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偽隨機(jī)序列產(chǎn)生器－filtered 代進(jìn)位反饋移位寄存器，matlab 原代碼。
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8位雙向移位寄存器: 實(shí)現(xiàn)串行數(shù)據(jù)與并行數(shù)據(jù)的轉(zhuǎn)換,移位寄存數(shù)據(jù)功能的
標(biāo)簽： 8位 移位寄存器 串行數(shù)據(jù) 并行數(shù)據(jù)
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雙向移位寄存器的原理設(shè)計(jì)程序，對(duì)于初學(xué)者將會(huì)有很大幫助，尤其在設(shè)計(jì)功能比較復(fù)雜的FPGA時(shí)，有些問(wèn)題其實(shí)用這個(gè)就很簡(jiǎn)單
標(biāo)簽： 移位寄存器 設(shè)計(jì)程序
上傳時(shí)間： 2014-12-07
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移位寄存器和9人表決器電路的VHDL設(shè)計(jì)方案
標(biāo)簽： VHDL 移位寄存器 電路 表決器
上傳時(shí)間： 2014-01-10
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vhdl編程 實(shí)現(xiàn)移位寄存器 左移動(dòng)和右移動(dòng)
標(biāo)簽： vhdl 移動(dòng) 編程 移位寄存器
上傳時(shí)間： 2017-01-21
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vhdl編程 實(shí)現(xiàn)移位寄存器。左移和右移
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