信號發生器是控制系統的重要組成部分。研制出較高精度、可靠性、可調參數的數字量信號發生器，對于促進我國航空、航天、國防以及工業自動化等領域的發展均有重要意義。本文以直接頻率合成和偽隨機碼的設計與實現為中心，對擴頻通信的基本理論、信號源的結構、載波調制等問題進行了深入的分析和研究，并給出了模塊的硬件實現方案。 現場可編程門陣列(FPGA)設計靈活、速度快，在數字專用集成電路的設計中得到了廣泛的應用。論文介紹了FPGA技術的發展和應用，包括VHDL語言的基本語法結構和FPGA器件的開發設計流程等等。詳細地分析了各類頻率合成器的基礎上提出采用直接數字式頻率合成原理(DDS)實現低相位噪聲、高分辨率、高精度和高穩定度的信號源。研究了測距偽隨機碼的原理，確定選用移位序列作為系統的擴頻碼序列，并選取了符合本系統使用的移位序列擴頻碼。分別給出并分析了相應的FPGA硬件實現電路。 對于載波調制這一關鍵技術，提出了采用二進制相移鍵控相位選擇法并相應作了硬件實現。最后給出具體設計實現了的信號發生器的輸出波形。經實驗室測試，設計的信號發生器滿足要求，且結構簡單、工作可靠、重量輕、體積小，具有良好的應用前景。
上傳時間： 2013-04-24
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本文以直接頻率合成和偽隨機碼的設計與實現為中心，對擴頻通信的基本理論、信號源的總體結構、載波調制、濾波器設計等問題進行了深入的分析和研究，并給出了模塊的硬件實現方案。 首先介紹了FPGA技術的發展和應用，包括VHDL語言的基本語法結構和FPGA器件的開發設計流程等等。詳細地分析了各類頻率合成器的基礎上提出采用直接數字式頻率合成器(DDS)實現低相位噪聲、高分辨率、高精度和高穩定度的信號源。研究了測距偽隨機碼的原理，確定選用移位序列作為系統的擴頻碼序列，并選取了符合本系統使用的移位序列擴頻碼。分別給出并分析了相應的FPGA硬件實現電路。 對于載波調制這一關鍵技術，提出了采用二進制相移鍵控相位選擇法并相應作了硬件實現。分析與研究了射頻寬帶濾波器應具有的傳輸特性，通過分析巴特沃思濾波器、切比雪夫濾波器、橢圓濾波器和貝塞爾濾波器這幾種濾波器的頻譜特性，設計了發生器射頻寬帶濾波器。最后給出具體設計實現了的信號發生器的輸出波形。
上傳時間： 2013-04-24
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軟件無線電(SDR，Software Defined Radio)由于具備傳統無線電技術無可比擬的優越性，已成為業界公認的現代無線電通信技術的發展方向。理想的軟件無線電系統強調體系結構的開放性和可編程性，減少靈活性著的硬件電路，把數字化處理(ADC和DAC)盡可能靠近天線，通過軟件的更新改變硬件的配置、結構和功能。目前，直接對射頻(RF)進行采樣的技術尚未實現普及的產品化，而用數字變頻器在中頻進行數字化是普遍采用的方法，其主要思想是，數字混頻器用離散化的單頻本振信號與輸入采樣信號在乘法器中相乘，再經插值或抽取濾波，其結果是，輸入信號頻譜搬移到所需頻帶，數據速率也相應改變，以供后續模塊做進一步處理。數字變頻器在發射設備和接收設備中分別稱為數字上變頻器(DUC，Digital Upper Converter)和數字下變頻器(DDC，Digital Down Converter)，它們是軟件無線電通信設備的關鍵部什。大規模可編程邏輯器件的應用為現代通信系統的設計帶來極大的靈活性。基于FPGA的數字變頻器設計是深受廣大設計人員歡迎的設計手段。本文的重點研究是數字下變頻器(DDC)，然而將它與數字上變頻器(DUC)完全割裂后進行研究顯然是不妥的，因此，本文對數字上變頻器也作適當介紹。 第一章簡要闡述了軟件無線電及數字下變頻的基本概念，介紹了研究背景及所完成的主要研究工作。 第二章介紹了數控振蕩器(NCO)，介紹了兩種實現方法，即基于查找表和基于CORDIC算法的實現。對CORDIc算法作了重點介紹，給出了傳統算法和改進算法，并對基于傳統CORDIC算法的NCO的FPGA實現進行了EDA仿真。 第三章介紹了變速率采樣技術，重點介紹了軟件無線電中廣泛采用的級聯積分梳狀濾波器 (cascaded integratot comb， CIC)和ISOP(Interpolated Second Order Polynomial)補償法，對前者進行了基于Matlab的理論仿真和FPGA實現的EDA仿真，后者只進行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無線電中廣泛采用的半帶(half-band，HB)濾波器，對基于分布式算法的半帶濾波器的FPGA實現進行了EDA仿真，最后簡要介紹了FIR的多相結構。 第五章對數字下變頻器系統進行了噪聲綜合分析，給出了一個噪聲模型。 第六章介紹了數字下變頻器在短波電臺中頻數字化應用中的一個實例，給出了測試結果，重點介紹了下變頻器的：FPGA實現，其對應的VHDL程序收錄在本文最后的附錄中，希望對從事該領域設計的技術人員具有一定參考價值。
上傳時間： 2013-06-09
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在過去的十幾年間，FPGA取得了驚人的發展：集成度已達到1000萬等效門、速度可達到400～500MHz。隨著FPGA的集成度不斷增大，在高密度FPGA中，芯片上時鐘的分布質量就變得越來越重要。時鐘延時和時鐘相位偏移已成為影響系統性能的重要因素。現在，解決時鐘延時問題主要使用時鐘延時補償電路。 為了消除FPGA芯片內的時鐘延時，減小時鐘偏差，本文設計了內置于FPGA芯片中的延遲鎖相環，采用一種全數字的電路結構，將傳統DLL中的用模擬方式實現的環路濾波器和壓控延遲鏈改進為數字方式實現的時鐘延遲測量電路，和延時補償調整電路，配合特定的控制邏輯電路，完成時鐘延時補償。在輸入時鐘頻率不變的情況下，只需一次調節過程即可完成輸入輸出時鐘的同步，鎖定時間較短，噪聲不會積累，抗干擾性好。 在Smic0.18um工藝下，設計出的時鐘延時補償電路工作頻率范圍從25MHz到300MHz，最大抖動時間為35ps，鎖定時間為13個輸入時鐘周期。另外，完成了時鐘相移電路的設計，實現可編程相移，為用戶提供與輸入時鐘同頻的相位差為90度，180度，270度的相移時鐘；時鐘占空比調節電路的設計，實現可編程占空比，可以提供占空比為50/50的時鐘信號；時鐘分頻電路的設計，實現頻率分頻，提供1.5，2，2.5，3，4，5，8，16分頻時鐘。
上傳時間： 2013-07-06
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針對目前成品鎖相放大器價格昂貴且體積大，傳統窄帶濾波法性能和靈活性差的特點，設計了基于鎖相放大器原理的微弱信號檢測電路。本電路采用單片機作為激勵信號和參考信號的發生器，利用帶關斷引腳的運放實現相敏檢波器，整個電路僅使用了5個運算放大器和一些阻容元件。實驗表明，本電路能實現了從信噪比為0.1的被測信號中提取有用信號幅值的功能，測量誤差控制在5%以內。由于本電路有實現簡單和成本低的特點，稍加修改后可作為模塊電路用到其他測量系統當中。
上傳時間： 2014-12-23
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針對傳統過壓/欠壓、過頻/欠頻、相位突變、主動頻率偏移孤島檢測方法的不足，提出了一種改進方法。將相位偏移量作為輔助量加入主動移頻孤島檢測方法中，使檢測容性負載的孤島現象具有與感性負載同樣的快速性，并能有效降低主動頻率偏移法對電網電能的影響。該方法實現簡單，檢測快速，仿真結果驗證了其快速性和有效性。
上傳時間： 2013-11-09
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“均勻設計”是我國統計學家中國科學院應用數學研究所方開泰教授和中科院院士王元教授將數論與多元統計相結合創立的一種供多因素、多水平實驗用、可減少實驗次數的全新的最優試驗設計方法。其特點是將試驗點均勻地分布在試驗范圍內，用較少的試驗點來獲得最多的信息。這一方法結合統計調優把所得的數據進行整理、分析、判斷，用逐步回歸法建立回歸方程，并進行方差分析和顯著性檢驗，通過方程預報、等值線圖、曲線圖等數學方法，揭示出隱含于數據中的信息，找出試驗條件間的最佳組合，可實現用最少的試驗次數和最短的試驗時間，達到尋找最佳效果的目的。由于均勻設計不再具有整齊可比的特點，因而不能象正交試驗那樣，通過簡單的方差分析方法來處理所得的數據，而必須借助計算機來進行數據處理。 我所在均勻設計推廣應用到化學電源研究過程方面做了一些工作，在應用過程中均勻設計明顯地促進了我所相關項目的研究工作。下面是我所在相關項目工作中的情況介紹。
上傳時間： 2013-12-24
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載波相移正弦脈寬調制（SPWM）技術是一種適用于大功率電力開關變換裝置的高性能開關調制策略，在有源電力濾波器中有良好的應用前景。本文介紹了如何利用高性能數字信號處理器TMS320F28335的片內外設事件管理器（EV）模塊產生三相SPWM波，給出了程序流程圖及關鍵程序源碼。該方法采用不對稱規則采樣算法，參數計算主要采用查表法，計算量小，實時性高。在工程實踐中表明，該方法既能滿足控制精度要求，又能滿足實時性要求，可以很好地控制逆變電源的輸出。
上傳時間： 2013-11-05
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陣列信號處理是當前信號處理的熱門方向，為信號處理帶來極大的方便，陣列信號處理中的各通道不一致問題將會給陣列信號處理帶來影響，很多文獻中介紹過關于自適應幅相誤差校正的理論及方法，但實現起來都比較耗費資源和時間，且效果有待實踐驗證。提出一種工程上可實現且計算量較小的通道校正方法-查表法。通過仿真，結果表明此方法可以對特定來向的有用信號進行較為準確的校正。
上傳時間： 2014-01-12
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通過對二次相差法測距性能進行了仿真分析,仿真結果表明,基于雙頻比相測距的二次相差法多篇連續波雷達,只能求解速度不同的目標的距離值,無法求解同速度不同距離目標的距離值。
上傳時間： 2013-11-18
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