本軟件用VC++實現了與USB設備驅動程序的通信。包括打開一個USB設備，寫入數據，讀取數據和清空數據。
標簽： USB VC 軟件 設備驅動
上傳時間： 2016-01-12
上傳用戶：vodssv
上窮碧落下黃泉 - 源碼追蹤經驗談 (PDF 繁體中文 26頁) 侯捷觀點 剖析名家源碼，是讓自己技術躍升的捷徑。但是大系統的源碼非常龐大（Unix, Linux, Java, STL, MFC, VCL, Qt...），閱讀要有閱讀的方法。本文從動機、對象、前提、書籍、態度、工具、方法、瓶頸、價值、附加價值等方向加以討論。
標簽： 繁體 家 頁
上傳時間： 2016-01-13
上傳用戶：cooran
雜湊法(Hashing)的搜尋與一般的搜尋法(searching)是不一樣的。在雜湊法中，鍵值(key value)或識別字(identifier)在記憶體的位址是經由函數(function)轉換而得的。此種函數，一般稱之為雜湊函數(Hashing function)或鍵值對應位址轉換(key to address transformation)。對於有限的儲存空間，能夠有效使用且在加入或刪除時也能快的完成，利用雜湊法是最適當不過了。因為雜湊表搜尋在沒有碰撞(collision)及溢位(overflow)的情況下，只要一次就可擷取到。
標簽： searching Hashing
上傳時間： 2016-01-14
上傳用戶：dancnc
背包問題是關於最佳化的問題，要解最佳化問題可以使用「動態規劃」（Dynamic programming），從空集合開始，每增加一個元素就先求出該階段的最佳解，直到所有的元素加入至集合中，最後得到的就是最佳解。 以背包問題為例，我們使用兩個陣列value與item，value表示目前的最佳解所得之總價，item表示最後一個放至背包的水果，假設有負重量 1～8的背包8個，並對每個背包求其最佳解
標簽：
上傳時間： 2014-01-22
上傳用戶：aix008
用單片機實現方搏輸出，可以進行占空比調節
標簽： 用單片機 輸出
上傳時間： 2014-12-02
上傳用戶：cainaifa
占用資源少的verilog HDL uart接口；采用固定波特率115200，可以修改程序中的分頻來修改波特率，模式為1個啟始位，8位數據位，1個停止位；帶1字節緩存；當緩存空時輸出空信號
標簽： verilog 115200 uart HDL
上傳時間： 2013-12-28
上傳用戶：kikye
單向鏈表的升序建立，降序建立，刪除，插入，計數，清空（輸入是以文件的形式，請下載者自行寫輸入文件并與此程序放在同一個文件夾下．）
上傳時間： 2014-01-12
上傳用戶：問題問題
通過對單片機的編程，使P0.0輸出占空比可變的PWM波（占空比在代碼中調整）。
標簽： 單片機 編程
上傳時間： 2016-01-23
上傳用戶：妄想演繹師
有一群生產者進程在生產消息，并將此消息提供給消費者進程去消費，為使生產者進程和消費者進程能并發執行，生產者與消費者可以通過一個環形緩沖池聯系起來，環形緩沖池由n個大小相等的緩沖區組成，每個緩沖區容納一個消息。每個生產者可不斷地每次往緩沖池中送一個消息，而每個消費者則可不斷地每次從緩沖池中取出一個消息消費。盡管所有的生產者進程和消費者進程，都是以異步方式運行的，但它們之間必須保持同步，即不允許消費者進程到一個空緩沖區去取消息，也不允許生產者進程向一個已裝有消息且尚未被取走消息的緩沖區中投放消息。請用信號量及PV操作實現這一組進程的工作過程。
標簽： 進程
上傳時間： 2014-01-18
上傳用戶：caozhizhi
設計一個按優先數調度算法實現處理器調度的程序。 [提示]： (1) 假定系統有5個進程，每個進程用一個PCB來代表。PCB的格式為： 進程名、指針、要求運行時間、優先數、狀態。 進程名——P1~P5。 指針——按優先數的大小把5個進程連成隊列，用指針指出下一個進程PCB的首地址。 要求運行時間——假設進程需要運行的單位時間數。 優先數——賦予進程的優先數，調度時總是選取優先數大的進程先執行。 狀態——假設兩種狀態，就緒，用R表示，和結束，用E表示。初始狀態都為就緒狀態。 (2) 每次運行之前，為每個進程任意確定它的“優先數”和“要求運行時間”。 (3) 處理器總是選隊首進程運行。采用動態改變優先數的辦法，進程每運行1次，優先數減1，要求運行時間減1。 (4) 進程運行一次后，若要求運行時間不等于0，則將它加入隊列，否則，將狀態改為“結束”，退出隊列。 (5) 若就緒隊列為空，結束，否則，重復(3)。 用c語言實現的模擬操作系統處理機調度過程的程序
標簽： 優先數 調度算法 處理器 調度
上傳時間： 2016-02-03
上傳用戶：龍飛艇
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