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符號同步

  • OFDM系統幀檢測及同步算法FPGA設計與實現

    正交頻分復用(OFDM)技術是一種多載波數字調制技術,它具有頻譜利用率高、抗多徑能力強等特點,在寬帶無線多媒體通信領域中受到了廣泛的關注。 OFDM系統可分為連續工作模式和突發工作模式。在IEEE802.11a、HiperLANType2等無線局域網標準中采用了OFDM的突發工作模式,該模式下的接收機首先對符合某種特定格式的幀做出檢測。本文介紹了一種基于最小錯誤概率準則的幀檢測算法,提出了該算法的FPGA實現方案。 同步技術是OFDM最關鍵的技術之一,它包括載波頻率同步和符號同步。載波頻率同步是為了糾正接收端相對于發送端的載波頻率偏移,以保證子載波間的正交性;符號同步確定OFDM符號有用數據信息的開始時刻,也就是確定FFT窗的開始時刻。本文首先介紹了一種基于自相關的載波頻率同步算法,給出了它的FPGA實現方案,重點講述了其中用到的Cordic算法及其實現;然后介紹了分別基于互相關和自相關的兩種符號同步算法,給出了各自的FPGA實現方案,從實現的角度比較了兩種算法的優缺點,并且在FPGA設計中體現了面積復用和流水線操作的設計思想。 文章最后介紹了系統調試的情況,總結出一種ChipScopePro與Matlab相結合的調試方法,該方法在FPGA調試方面具有一定的通用性。

    標簽: OFDM FPGA

    上傳時間: 2013-07-16

    上傳用戶:Killerboo

  • 基于FPGA的全彩色LED同步顯示屏

    LED顯示屏作為一項高新科技產品正引起人們的高度重視,它以其動態范圍廣,亮度高,壽命長,工作性能穩定而日漸成為顯示媒體中的佼佼者,現已廣泛應用于廣告、證券、交通、信息發布等各方面,且隨著全彩屏顯示技術的日益完善,LED顯示屏有著廣闊的市場前景。 本文主要研究的對象為全彩色LED同步顯示屏控制系統,提出了一個系統實現方案,整個系統分三部分組成:DVI解碼電路、發送系統以及接收系統。DVI解碼模塊用于從顯卡的DVI口獲取視頻源數據,經過T.D.M.S.解碼恢復出可供LED屏顯示的紅、綠、藍共24位像素數據和一些控制信號。發送系統用于將收到的數據流進行緩存,經處理后發送至以太網芯片進行以太網傳輸。接收系統接收以太網上傳來的視頻數據流,經過位分離操作后存入SRAM進行緩存,再串行輸入至LED顯示屏進行掃描顯示。然后,從多方面論述了該方案的可行性,仔細推導了LED顯示屏各技術參數之間的聯系及約束關系。 本課題采用可編程邏輯器件來完成系統功能,可編程邏輯器件具有高集成度、高速度、在線可編程等特點,不僅可以滿足高速圖像數據處理對速度的要求,而且增加了設計的靈活性,不需修改電路硬件設計,縮短了設計周期,還可以進行在線升級。

    標簽: FPGA LED 全彩色 同步顯示

    上傳時間: 2013-06-22

    上傳用戶:jennyzai

  • 基于數據符號同步的FPGA仿真實現

    近年來,人們對無線數據和多媒體業務的需求迅猛增加,促進了寬帶無線通信新技術的發展和應用。正交頻分復用 (Orthogonal Frequency Division Multiolexing,OFDM)技術已經廣泛應用于各種高速寬帶無線通信系統中。然而 OFDM 系統相比單載波系統更容易受到頻偏和時偏的影響,因此如何有效地消除頻偏和時偏,實現系統的時頻同步是 OFDM 系統中非常關鍵的技術。 本文討論了非同步對 OFDM 系統的影響,分析了當前用于 OFDM 系統中基于數據符號的同步算法,并簡單介紹非基于數據符號同步技術。基于數據符號的同步技術通過加入訓練符號或導頻等附加信息,并利用導頻或訓練符號的相關性實現時頻同步。此算法由于加入了附加信息,降低了帶寬利用率,但同步精度相對較高,同步捕獲時間較短。 隨著電子芯片技術的快速發展,電子設計自動化 (Electronic DesignAutomation,EDA) 技術和可編程邏輯芯片 (FPGA/CPLD) 的應用越來越受到大家的重視,為此文中對 EDA 技術和 Altera 公司制造的 FPGA 芯片的原理和結構特點進行了闡述,還介紹了在相關軟件平臺進行開發的系統流程。 論文在對基于數據符號三種算法進行較詳細的分析和研究的基礎上,尤其改進了基于導頻符號的同步算法之后,利用 Altera 公司的 FPGA 芯片EP1S25F102015 在 OuartusⅡ5.0 工具平臺上實現了 OFDM 同步的硬件設計,然后進行了軟件仿真。其中對基于導頻符號同步的改進算法硬件設計過程了進行了詳細闡述。不僅如此,對于基于 PN 序列幀的同步算法和基于循環前綴 (Cycle Prefix,CP) 的極大似然 (Maximam Likelihood,ML)估計同步算法也有具體的仿真實現。 最后,文章還對它們進行了比較,基于導頻符號同步設計的同步精度比較高,但是耗費芯片的資源多,另一個缺點是沒有頻偏估計,因此運用受到一定限制。基于 PN 序列幀的同步設計使用了最少的芯片資源,但要提取 PN 序列中的信號數據有一定困難。基于循環前綴的同步設計占用了芯片 I/O 腳稍顯多。這幾種同步算法各有優缺點,但可以根據不同的信道環境選用它們。

    標簽: FPGA 數據 同步的 仿真實現

    上傳時間: 2013-04-24

    上傳用戶:斷點PPpp

  • OFDM系統的定時和頻率同步的實現

    正交頻分復用技術(OFDM)是未來寬帶無線通信中的關鍵技術。隨著用戶對實時多媒體業務,高速移動業務需求的迅速增加,OFDM由于其頻譜效率高,抗多徑效應能力強,抗干擾性能好等特點,該技術正得到了廣泛的應用。 OFDM系統的子載波之間必須保持嚴格的正交性,因此對符號定時和載波頻偏非常敏感。本課題的主要任務是分析各種算法的性能的優劣,選取合適的算法進行FPGA的實現。 本文首先簡要介紹了無線信道的傳輸特性和OFDM系統的基本原理,進而對符號同步和載波同步對接收信號的影響做了分析。然后對比了非數據輔助式同步算法和數據輔助式同步算法的不同特點,決定采用數據輔助式同步算法來解決基于IEEE 802.16-2004協議的突發傳輸系統的同步問題。最后部分進行了算法的實現和仿真,所有實現的仿真均在QuartusⅡ下按照IEEE 802.16-2004協議的符號和前導字的結構進行。 本文的主要工作:(1)采用自相關和互相關聯合檢測算法同時完成幀到達檢測和符號同步估計,只用接收數據的符號位做相關運算,有效地解決了判決門限需要變化的問題,同時也減少了資源的消耗;(2)在時域分數倍頻偏估計時,利用基于流水線結構的Cordic模塊計算長前導字共軛相乘后的相角,求出分數倍頻偏的估計值;(3)采用滑動窗口相關求和的方法估計整數倍頻偏值,在此只用頻域數據的符號位做相關運算,有效地解決了傳統算法估計速度慢的缺點,同時也減少了資源的消耗。

    標簽: OFDM 定時 同步的

    上傳時間: 2013-05-23

    上傳用戶:宋桃子

  • 海事衛星突發信號位同步檢測

    碼元定時恢復(位同步)技術是數字通信中的關鍵技術。位同步信號本身的抖動、錯位會直接降低通信設備的抗干擾性能,使誤碼率上升,甚至會使傳輸遭到完全破壞。尤其對于突發傳輸系統,快速、精確的定時同步算法是近年來研究的一個焦點。本文就是以Inmarsat GES/AES數據接收系統為背景,研究了突發通信傳輸模式下的全數字接收機中位同步方法,并予以實現。 本文系統地論述了位同步原理,在此基礎上著重研究了位同步的系統結構、碼元定時恢復算法以及衡量系統性能的各項指標,為后續工作奠定了基礎。 首先根據衛星系統突發信道傳輸的特點分析了傳統位同步方法在突發系統中的不足,接下來對Inmarsat系統的短突發R信道和長突發T信道的調制方式和幀結構做了細致的分析,并在Agilent ADS中進行了仿真。 在此基礎上提出了一種充分利用報頭前導比特信息的,由滑動平均、閾值判斷和累加求極值組成的快速報頭時鐘捕獲方法,此方法可快速精準地完成短突發形式下的位同步,并在FPGA上予以實現,效果良好。 在長突發形式下的報頭時鐘捕獲后還需要對后續數據進行位同步跟蹤,在跟蹤過程中本論文首先用DSP Builder實現了插值環路的位同步算法,進行了Matlab仿真和FPGA實現。并在插值環路的基礎上做出改進,提出了一種新的高效的基于移位算法的位同步方案并予以FPGA實現。最后將移位算法與插值算法進行了性能比較,證明該算法更適合于本項目中Inmarsat的長突發信道位同步跟蹤。 論文對兩個突發信道的位同步系統進行了理論研究、算法設計以及硬件實現的全過程,滿足系統要求。

    標簽: 海事衛星 信號 位同步 檢測

    上傳時間: 2013-04-24

    上傳用戶:zukfu

  • 基于FPGA的精確時鐘同步方法研究

    在工業控制領域,多種現場總線標準共存的局面從客觀上促進了工業以太網技術的迅速發展,國際上已經出現了HSE、Profinet、Modbus TCP/IP、Ethernet/IP、Ethernet Powerlink、EtherCAT等多種工業以太網協議。將傳統的商用以太網應用于工業控制系統的現場設備層的最大障礙是以太網的非實時性,而實現現場設備間的高精度時鐘同步是保證以太網高實時性的前提和基礎。 IEEE 1588定義了一個能夠在測量和控制系統中實現高精度時鐘同步的協議——精確時間協議(Precision Time Protocol)。PTP協議集成了網絡通訊、局部計算和分布式對象等多項技術,適用于所有通過支持多播的局域網進行通訊的分布式系統,特別適合于以太網,但不局限于以太網。PTP協議能夠使異質系統中各類不同精確度、分辨率和穩定性的時鐘同步起來,占用最少的網絡和局部計算資源,在最好情況下能達到系統級的亞微級的同步精度。 基于PC機軟件的時鐘同步方法,如NTP協議,由于其實現機理的限制,其同步精度最好只能達到毫秒級;基于嵌入式軟件的時鐘同步方法,將時鐘同步模塊放在操作系統的驅動層,其同步精度能夠達到微秒級。現場設備間微秒級的同步精度雖然已經能滿足大多數工業控制系統對設備時鐘同步的要求,但是對于運動控制等需求高精度定時的系統來說,這仍然不夠。基于嵌入式軟件的時鐘同步方法受限于操作系統中斷響應延遲時間不一致、晶振頻率漂移等因素,很難達到亞微秒級的同步精度。 本文設計并實現了一種基于FPGA的時鐘同步方法,以IEEE 1588作為時鐘同步協議,以Ethernet作為底層通訊網絡,以嵌入式軟件形式實現TCP/IP通訊,以數字電路形式實現時鐘同步模塊。這種方法充分利用了FPGA的特點,通過準確捕獲報文時間戳和動態補償晶振頻率漂移等手段,相對于嵌入式軟件時鐘同步方法實現了更高精度的時鐘同步,并通過實驗驗證了在以集線器互連的10Mbps以太網上能夠達到亞微秒級的同步精度。

    標簽: FPGA 時鐘同步 方法研究

    上傳時間: 2013-07-28

    上傳用戶:heart520beat

  • 基于FPGA的全同步數字頻率計的設計

    頻率是電子技術領域內的一個基本參數,同時也是一個非常重要的參數。穩定的時鐘在高性能電子系統中有著舉足輕重的作用,直接決定系統性能的優劣。隨著電子技術的發展,測頻系統使用時鐘的提高,測頻技術有了相當大的發展,但不管是何種測頻方法,±1個計數誤差始終是限制測頻精度進一步提高的一個重要因素。 本設計闡述了各種數字測頻方法的優缺點。通過分析±1個計數誤差的來源得出了一種新的測頻方法:檢測被測信號,時基信號的相位,當相位同步時開始計數,相位再次同步時停止計數,通過相位同步來消除計數誤差,然后再通過運算得到實際頻率的大小。根據M/T法的測頻原理,已經出現了等精度的測頻方法,但是還存在±1的計數誤差。因此,本文根據等精度測頻原理中閘門時間只與被測信號同步,而不與標準信號同步的缺點,通過分析已有等精度澳孽頻方法所存在±1個計數誤差的來源,采用了全同步的測頻原理在FPGA器件上實現了全同步數字頻率計。根據全同步數字頻率計的測頻原理方框圖,采用VHDL語言,成功的編寫出了設計程序,并在MAX+PLUS Ⅱ軟件環境中,對編寫的VHDL程序進行了仿真,得到了很好的效果。最后,又討論了全同步頻率計的硬件設計并給出了電路原理圖和PCB圖。對構成全同步數字頻率計的每一個模塊,給出了較詳細的設計方法和完整的程序設計以及仿真結果。

    標簽: FPGA 數字頻率計

    上傳時間: 2013-04-24

    上傳用戶:qqoqoqo

  • 多功能車輛總線一類設備的FPGA實現

    多功能車輛總線一類設備是一個在列車通信網(TCN,TrainCommunication Network)中普遍使用的網絡接口單元。目前我國的新式列車大多采用列車通信網傳輸列車中大量的控制和服務信息。但使用的列車通信網產品主要為國外進口,因此迫切需要研制具有自主知識產權的列車通信網產品。 論文以一類設備控制器的設計為核心,采取自頂向下的模塊設計方法。將設備控制器分為同步層和數據處理層來分別實現對幀的發送與接收處理和對幀數據的提取與存儲處理。 同步層包含幀的識別模塊、曼徹斯特譯碼模塊、曼徹斯特編碼與幀封裝三個模塊。幀識別模塊檢測幀的起始位并對幀類型進行判斷。譯碼模塊根據采集的樣本值來判斷曼徹斯特編碼的值,采樣的難點在于非理想信號帶來的采樣誤差,論文使用結合位同步的多點采樣法來提高采樣質量。幀分界符中的非數據符不需要進行曼徹斯特編碼,編碼時在非數據符位關閉編碼電路使非數據符保持原來的編碼輸出。 數據處理層以主控單元(MCU,Main Control Unit)和通信存儲器為設計核心。MCU是控制器的核心,對接收的主幀進行分析,判斷是從通信存儲器相應端口取出應答從幀并發送,還是準備接收從幀并存入通信存儲器。通信存儲器存儲設備的通信數據,合適的地址分配能簡化MCU的控制程序,論文固定了通信存儲器端口大小使MCU可以根據一個固定的公式進行端口的遍歷從而簡化了MCU程序的復雜度。數據在傳輸中由于受到干擾和沖突等問題而出現錯誤,論文采用循環冗余檢驗碼結合偶檢驗擴展來對傳輸數據進行差錯控制。 最后,使用FPGA和硬件描述語言Verilog HDL開發出了MVB一類設備。目前該一類設備已運用在SS4G電力機車的制動控制單元(BCU.Brake Control Unit)中并在鐵道科學研究院通過了TCN通信測試。一類設備的成功研制為列車通信網中總線管理器等高類設備的開發奠定了堅實的基礎。

    標簽: FPGA 多功能 總線 設備

    上傳時間: 2013-07-27

    上傳用戶:qazxsw

  • 永磁同步伺服電機(PMSM) 驅動器設計原理

    ·永磁交流伺服系統的驅動器經歷了模擬式、模擬數字混合式的發展后,目前已經進入了全數字的時代。全數字伺服驅動器不僅克服了模擬式伺服的分散性大、零漂、低可靠性等缺點,還充分發揮了數字控制在控制精度上的優勢和控制方法的靈活,使伺服驅動器不僅結構簡單,而且性能更加可靠。現在,高性能的伺服系統大多數采用永磁交流伺服系統,其中包括永磁同步交流伺服電動機和全數字交流永磁同步伺服驅動器兩部分。后者由兩部分組成:驅動

    標簽: PMSM nbsp 永磁同步 伺服電機

    上傳時間: 2013-04-24

    上傳用戶:zhangyi99104144

  • 永磁同步電機伺服系統功率主回路的設計

    ·永磁同步電機伺服系統功率主回路的設計

    標簽: 永磁同步電機 伺服系統 主回路 功率

    上傳時間: 2013-06-03

    上傳用戶:glitter

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