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用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設計

用VerilogHDL實現(xiàn)基于FPGA的通用分頻器的設計

標簽： VerilogHDL FPGA 分頻器

上傳時間： 2015-01-02

上傳用戶：oooool

用對半分法計算f(x)=0

用對半分法計算f(x)=0

標簽： 分 計算

上傳時間： 2013-12-10

上傳用戶：小碼農(nóng)lz

利用雙層感知器神經(jīng)網(wǎng)絡處理線性不可分的分類問題

利用雙層感知器神經(jīng)網(wǎng)絡處理線性不可分的分類問題

標簽： 雙層 分 分類 神經(jīng)網(wǎng)絡

上傳時間： 2013-12-22

上傳用戶：zuozuo1215

動態(tài)聚類k-means演算 將輸入在程式中的數(shù)據(jù)資料 給予適當?shù)姆秩?/a>

標簽： k-means 程式 分

上傳時間： 2015-03-16

上傳用戶：離殤

一個曼徹斯特編碼解碼器以及差分曼徹斯特編碼解碼程序

一個曼徹斯特編碼解碼器以及差分曼徹斯特編碼解碼程序，Vc＋＋6下編譯通過

標簽： 曼徹斯特 差分 編碼解碼器 曼徹斯特編碼

上傳時間： 2015-03-19

上傳用戶：LIKE

自己編的一個分頻器的程序模版 雖然原理很簡單

自己編的一個分頻器的程序模版 雖然原理很簡單，經(jīng)過多次實踐很實用 被多次用在其它的程序中

標簽： 分頻器 程序 模版

上傳時間： 2015-03-20

上傳用戶：cjf0304

定時器程序 采用89c2051 SL存放秒的個位數(shù) SH存放秒的十位數(shù) ML存放分的個位數(shù) MH存放分的十位數(shù) HL存放時的個位數(shù) HH存放時的十位數(shù)

定時器程序 采用89c2051 SL存放秒的個位數(shù) SH存放秒的十位數(shù) ML存放分的個位數(shù) MH存放分的十位數(shù) HL存放時的個位數(shù) HH存放時的十位數(shù)

標簽： 89c2051 分 定時器 程序

上傳時間： 2014-01-25

上傳用戶：yxgi5

2051控制兩組LED交叉顯示的99分定時器源代碼。

2051控制兩組LED交叉顯示的99分定時器源代碼。

標簽： 2051 LED 控制 分

上傳時間： 2014-01-17

上傳用戶：luke5347

已知一個LTI系統(tǒng)的差分方程為： y[n]-1.143*y[n-1]+0.4128*y[n-2]=0.0675*x[n]+0.1349*x[n-1]+0.0675*x[n-2] 初始條件y(-1

已知一個LTI系統(tǒng)的差分方程為： y[n]-1.143*y[n-1]+0.4128*y[n-2]=0.0675*x[n]+0.1349*x[n-1]+0.0675*x[n-2] 初始條件y(-1)=1,y(-2)=2，輸入x(n)=u(n)，計算系統(tǒng)的零輸入響應

標簽： 0.0675 0.4128 0.1349 1.143

上傳時間： 2013-11-27

上傳用戶：zhengzg

基于CPLD-FPGA的半整數(shù)分頻器的設計

基于CPLD-FPGA的半整數(shù)分頻器的設計，用于設計EDA

標簽： CPLD-FPGA 整數(shù) 分頻器

上傳時間： 2015-04-09

上傳用戶：凌云御清風