開關(guān)電源基本原理與設(shè)計(jì)介紹,臺(tái)達(dá)的資料,很好的
標(biāo)簽: 開關(guān) 電源基本
上傳時(shí)間: 2013-04-24
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異步FIFO是用來(lái)適配不同時(shí)鐘域之間的相位差和頻率飄移的重要模塊。本文設(shè)計(jì)的異步FIFO采用了格雷(GRAY)變換技術(shù)和雙端口RAM實(shí)現(xiàn)了不同時(shí)鐘域之間的數(shù)據(jù)無(wú)損傳輸。該結(jié)構(gòu)利用了GRAY變換的特點(diǎn),使得整個(gè)系統(tǒng)可靠性高和抗干擾能力強(qiáng),系統(tǒng)可以工作在讀寫時(shí)鐘頻率漂移達(dá)到正負(fù)300PPM的惡劣環(huán)境。并且由于采用了模塊化結(jié)構(gòu),使得系統(tǒng)具有良好的可擴(kuò)充性。
標(biāo)簽: FIFO GRAY RAM 適配
上傳時(shí)間: 2013-08-08
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FPGA中雙向端口IO的研究FPGA中雙向端口IO的研究.
標(biāo)簽: FPGA 雙向端口
上傳時(shí)間: 2013-08-09
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FPGA開發(fā)板上寫的Verilog代碼:\r\n功能是從電腦端發(fā)送一個(gè)字節(jié),然后把它接收回來(lái)。\r\n
標(biāo)簽: Verilog FPGA 開發(fā)板 代碼
上傳時(shí)間: 2013-08-15
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:針對(duì)現(xiàn)場(chǎng)可編程門陣列(FPGA)芯片的特點(diǎn),研究FPGA中雙向端口I/O的設(shè)計(jì),同時(shí)給出仿真初始化雙向端口I/O的方法。采用這種雙向端口的設(shè)計(jì)方法,選用Xilinx的Spartan2E芯片設(shè)計(jì)一個(gè)多通道圖像信號(hào)處理系統(tǒng)。
上傳時(shí)間: 2013-08-17
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_Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設(shè)計(jì)教學(xué)文件
標(biāo)簽: Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006
上傳時(shí)間: 2013-08-20
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真序擴(kuò)頻通信系統(tǒng)的SYSTEMVIEW信真及其FPGA實(shí)現(xiàn)發(fā)送端設(shè)計(jì)
標(biāo)簽: SYSTEMVIEW FPGA 發(fā)送
上傳時(shí)間: 2013-08-28
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cpld與單片機(jī)8051的通信的設(shè)計(jì)方法 以及cpld和單片機(jī)的端口對(duì)應(yīng)
標(biāo)簽: cpld 8051 單片機(jī) 通信
上傳時(shí)間: 2013-09-01
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FPGAadvantage61Crack.rar is for MentorGraphics高端設(shè)計(jì)工具FPGAAdvantage
標(biāo)簽: FPGAAdvantage 高端 設(shè)計(jì)工具
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Allegro 里面如何在端接匹配的情況下調(diào)等長(zhǎng)線
標(biāo)簽: Allegro 端接 等長(zhǎng)線
上傳時(shí)間: 2013-09-06
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