從實際應(yīng)用的角度出發(fā)介紹了內(nèi)置HD61202 圖形液晶顯示模塊的結(jié)構(gòu)特性，液晶顯示模塊的硬件接口電路及編程要點，并對其正常工作的條件、控制指令系統(tǒng)及編程思路進行了探討。
上傳時間： 2013-06-05
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CH452 是數(shù)碼管顯示驅(qū)動和鍵盤掃描控制芯片。CH452內(nèi)置時鐘振蕩電路，可以動態(tài)驅(qū)動8 位數(shù) 碼管或者64 只LED，具有BCD 譯碼、閃爍、移位、段位尋址、光柱譯碼等功能；同時還可以進行64
上傳時間： 2013-05-27
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隨著USB接口性能的不斷增強，USB接口被廣泛應(yīng)用到各種硬件設(shè)備上。如今在Linux操作系統(tǒng)中，針對USB設(shè)備的驅(qū)動編程工作越來越受到重視。本課題在以S3C2410處理器為基礎(chǔ)的硬件平臺上，對Linux操作系統(tǒng)環(huán)境下USB設(shè)備驅(qū)動工作原理進行了研究。在理解USB協(xié)議的基礎(chǔ)上完成了S3C2410處理器內(nèi)置USB設(shè)備控制器固件和驅(qū)動程序的編寫調(diào)試等方面的工作。 固件程序工作在硬件設(shè)備上，通過它控制設(shè)備的正常工作，負責與主機端的通信會話。由于本課題中的USB設(shè)備控制器是3C2410處理器的片內(nèi)外設(shè)，因此固件程序要管理整個S3C2410處理器的工作。在處理器開機工作時，固件程序首先完成包括USB設(shè)備控制器在內(nèi)的整個處理器的初始化，然后與主機共同進行USB設(shè)備的枚舉，最后進入循環(huán)等待主機端發(fā)起通信。當主機發(fā)起通信時，處理器產(chǎn)生USB中斷，固件程序調(diào)用中斷處理函數(shù)。 在Linux操作系統(tǒng)中，內(nèi)核通過調(diào)用驅(qū)動中提供的標準接口將應(yīng)用程序中對設(shè)備的操作映射到具體的硬件設(shè)備。驅(qū)動程序中包括向驅(qū)動注冊，驅(qū)動支持設(shè)備列表信息以及各種系統(tǒng)調(diào)用具體實現(xiàn)等方面。USB接口所支持的四種傳輸方式，根據(jù)S3C2410內(nèi)置USB設(shè)備控制器的功能屬性，在驅(qū)動中采用了塊傳輸?shù)膫鬏敺绞剑ㄟ^URB的方式實現(xiàn)對設(shè)備的讀寫操作。 最后設(shè)計一個簡單文件傳輸系統(tǒng)對固件和驅(qū)動程序進行了測試。測試系統(tǒng)中主機端通過USB接口傳輸一個wav格式的音頻文件，設(shè)備端接收到數(shù)據(jù)保存在內(nèi)存中。
標簽： Linux ARM USB 驅(qū)動實現(xiàn)
上傳時間： 2013-04-24
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VB從入門到實踐。很適合vb的入門者。一邊學一邊做，更快掌握。-VB from entry to practice. Vb is very suitable for beginners. Side w
上傳時間： 2013-05-29
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根據(jù)機械電子工程類專業(yè)測控實驗教學平臺數(shù)據(jù)采集的需要，在綜合考慮成本和性能基礎(chǔ)上，提出以為主處理芯片的數(shù)據(jù)采集卡設(shè)計方案。 該方案的主要特點是，使用基于ARM7TDMI內(nèi)核的，工作主頻最高可達44MHz；內(nèi)置高性能的ADC和DAC模塊，采樣速度最高可達1MSPS，采樣精度為12位；模擬信號輸入通道最多可達16路，模擬信號輸出通道最高可達4路；具有豐富的外設(shè)資源可以使用，GPIO口數(shù)目最高可達40個。 在設(shè)計中采用了模塊化思想，將系統(tǒng)分為四個功能模塊：主模塊的功能是控制ADC進行信號采集和DAC進行模擬信號輸出；模擬信號模塊的作用是對傳感器輸入信號和DAC輸出波形進行簡單的調(diào)理；數(shù)字信號模塊引出32路數(shù)字I/O口，可用于需要采集數(shù)字量的場合；JTAG模塊可進行程序的調(diào)試和下載，對于數(shù)據(jù)采集卡的二次開發(fā)有很大的作用。 在本數(shù)據(jù)采集卡上，嘗試進行了μC/OSⅡ操作系統(tǒng)的移植，成功實現(xiàn)了四個任務(wù)的管理。在實際應(yīng)用中，工作數(shù)小時仍可保持正常的運行。 為檢驗數(shù)據(jù)采集卡的串口通訊能力，利用LabVIEW程序讀取下位機串口發(fā)送的已采集到的數(shù)據(jù)，進行波形圖繪制。 為檢驗本數(shù)據(jù)采集卡的ADC和DAC精度，設(shè)計實驗利用DAC輸出波形，并利用ADC將采集到的波形通過LabVIEW顯示，測量結(jié)果顯示兩者電壓值誤差均在可允許的3LSB（Least Significant Bit）范圍內(nèi)，表明本數(shù)據(jù)采集卡已基本實現(xiàn)預(yù)期設(shè)計指標。
標簽： ARM 數(shù)據(jù)采集卡
上傳時間： 2013-04-24
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GPS以全天候、高精度、自動化、高效益等顯著特點，贏得廣大測繪工作者的信賴，而一體化GPS接收機更是具有全內(nèi)置、防水、耐寒以及操作方便、適用范圍廣等優(yōu)點，己經(jīng)廣泛應(yīng)用于控制測量和大地測量中。隨著全球定位系統(tǒng)的不斷改進，硬、軟件的不斷完善，應(yīng)用領(lǐng)域正在不斷地開拓，目前已遍及國民經(jīng)濟各種部門，并開始逐步深入人們的日常生活。 本文介紹了GPS系統(tǒng)的特點、工作原理、課題背景、國內(nèi)外相關(guān)產(chǎn)品的現(xiàn)狀以及發(fā)展趨勢，闡述了GPS接收機的設(shè)計原理。文章認為，GPS接收機中的微處理器的性能直接影響整機的性能，相比較其它微處理器，ARM微處理器具有一些獨特的優(yōu)勢。文章了ARM系列微處理器尤其是ARM7微處理器的性能特點，并給出了利用ARM7微處理器LPC2138芯片和xc3s1000型FPGA設(shè)計GPS接收機的實際設(shè)計和調(diào)試方案，并對此方案進行了論證，同時給出了各個功能模塊的軟硬件實現(xiàn)過程，并對樣機進行了性能指標測試。
上傳時間： 2013-04-24
上傳用戶：kakuki123
瑞芯Rknano主要技術(shù)參數(shù) ARM + Hardware Accelerator ，最大主頻120M 支持8/16位LCD，支持MCU屏，最大分辨率160x128 支持SD、I2S、I2C接口，內(nèi)置PWM控制器 8bit ECC NAND FLASH控制器，支持4片選，SLC/MCL
標簽： Rknano 瑞芯 技術(shù)參數(shù)
上傳時間： 2013-04-24
上傳用戶：christopher
FPGA器件在通信、消費類電子等領(lǐng)域應(yīng)用越來越廣泛，隨著FPGA規(guī)模的增大、功能的加強對時鐘的要求也越來越高。在FPGA中嵌入時鐘發(fā)生器對解決該問題是一個不錯的選擇。本論文首先，描述并分析了電荷泵鎖相環(huán)時鐘發(fā)生器的體系結(jié)構(gòu)、組成單元及各單元的非理想特性；然后討論并分析了電荷泵鎖相環(huán)的小信號特性和瞬態(tài)特性；并給出了電荷泵鎖相環(huán)器件參數(shù)的計算表達式。其次，研究了環(huán)形振蕩器和鎖相環(huán)的相位噪聲特性。由于噪聲性能是時鐘發(fā)生器設(shè)計中的關(guān)鍵指標，本工作對此進行了較為詳細的分析。相位噪聲和抖動是衡量時鐘信號的兩個主要指標。文中從理論上推導(dǎo)了一階鎖相環(huán)的噪聲特性，并建立了由噪聲分析抖動和由抖動分析噪聲的解析表達式關(guān)系，并討論了環(huán)路低噪聲設(shè)計的基本原則。在前面討論和分析的基礎(chǔ)上，利用Hynix0.35umCMOS工藝設(shè)計了200MHz電荷泵鎖相環(huán)時鐘發(fā)生器，并進行了仿真。設(shè)計中環(huán)形振蕩器的延遲單元采用replica偏置結(jié)構(gòu)，把延遲單元輸出擺幅限定在確定范圍，尾電流源采用cascode結(jié)構(gòu)，增強電路對電源和襯底噪聲的抑制作用。通過增加限流管，改善電荷泵中的開關(guān)的非理想特性。
上傳時間： 2013-04-24
上傳用戶：變形金剛
利用混沌的對初值和參數(shù)敏感、偽隨機以及遍歷等特性設(shè)計的加密方案,相對傳統(tǒng)加密方案而言,表現(xiàn)出許多優(yōu)越性能,尤其在快速置亂和擴散數(shù)據(jù)方面.目前,大多數(shù)混沌密碼傾向于軟件實現(xiàn),這些實現(xiàn)方案中數(shù)據(jù)串行處理且吞吐量有限,因而不適合硬件實現(xiàn).該論文分別介紹了適合FPGA(現(xiàn)場可編程門陣列)并行實現(xiàn)的序列密碼和分組密碼方案.序列密碼方案,對傳統(tǒng)LFSR(線性反饋移位寄存器)進行改進,采用非線性的混沌方程代替LFSR中的線性反饋方程,進而構(gòu)造出基于混沌偽隨機數(shù)發(fā)生器的加密算法.分組密碼方案,從圖像置亂的快速性考慮,將兩維混沌映射擴展到三維空間;同時,引入另一種混沌映射對圖像數(shù)據(jù)進行擴散操作,以有效地抵抗統(tǒng)計和差分攻擊.對于這兩種方案,文中給出了VHDL(硬件描述語言)編程、FPGA片內(nèi)功能模塊設(shè)計、加密效果以及硬件性能分析等.其中,序列密碼硬件實現(xiàn)方案,在不考慮通信延時的情況下,可以達到每秒61.622兆字節(jié)的加密速度.實驗結(jié)果表明,這兩種加密算法的FPGA實現(xiàn)方案是可行的,并且能夠得到較高的安全性和較快的加密速度.
上傳時間： 2013-04-24
上傳用戶：yx007699
隨著數(shù)字信號處理技術(shù)應(yīng)用的不斷深入，數(shù)字信號處理系統(tǒng)的實現(xiàn)面臨著很多挑戰(zhàn)，其中面臨的四個主要問題是：速度、設(shè)計規(guī)模、功耗和開發(fā)周期。因此許多數(shù)字信號處理的實現(xiàn)方法被提出，其中基于FPGA的實現(xiàn)技術(shù)就是其中的重要技術(shù)之一。 本文以數(shù)字信號處理系統(tǒng)的實現(xiàn)為應(yīng)用背景，著重研究了基于FPGA的數(shù)字濾波器實現(xiàn)技術(shù)。本文分為兩個主要部分： 第一部分以Xilinx公司的FPGA為例，總結(jié)了FPGA設(shè)計的基本方法及設(shè)計流程，并在此基礎(chǔ)上介紹了一種用于產(chǎn)品快速開發(fā)的設(shè)計方式—基于SystemGenerator的設(shè)計方式，這種設(shè)計方式向數(shù)字信號處理系統(tǒng)的設(shè)計者提供了自上而下的FPGA解決方案。 第二部分系統(tǒng)地研究了基于FPGA的數(shù)字濾波器實現(xiàn)技術(shù)。該部分首先研究了三種適合于FPGA的FIR濾波器實現(xiàn)方法，直接結(jié)構(gòu)、轉(zhuǎn)置結(jié)構(gòu)及分布式算法。其次，討論了針對直接結(jié)構(gòu)FIR濾波器的乘法器優(yōu)化技術(shù)，CSD編碼和系數(shù)分解，以及針對轉(zhuǎn)置結(jié)構(gòu)FIR濾波器的乘法器優(yōu)化技術(shù)，簡化加法器圖，并結(jié)合實例給出了它們的優(yōu)化效果。再次，介紹了直接結(jié)構(gòu)FIR濾波器中常用多操作數(shù)加法實現(xiàn)方法，二叉樹和Wallace樹，并在Wallace樹的基礎(chǔ)上提出了一種適合于FPGA的1比特多操作數(shù)加法結(jié)構(gòu)，這種實現(xiàn)結(jié)構(gòu)在實現(xiàn)采樣字長與系數(shù)字長均為l比特的FIR濾波器時，使FPGA的資源利用率得到明顯提高。最后還給出了三種FIR濾波器實現(xiàn)方法在FPGA中應(yīng)用的優(yōu)缺點及其適用性，并給出了一個帶通濾波器的設(shè)計實例。 論文的研究成果已應(yīng)用于“北斗一號”導(dǎo)航定位接收機中。
標簽： FPGA 數(shù)字濾波器 實現(xiàn)技術(shù)
上傳時間： 2013-08-01
上傳用戶：Andy123456
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