將Verilog設計轉成VHDL設計的程式
標簽： Verilog VHDL 程式
上傳時間： 2016-01-18
上傳用戶：lifangyuan12
將VHDL設計轉換成Verilog設計的程式
上傳用戶：wkchong
JPEG的硬體設計採用的是VHDL設計,有源碼
標簽： JPEG VHDL 有源
上傳用戶：agent
一個簡單的游戲設計...好好玩的
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上傳時間： 2013-12-31
上傳用戶：edisonfather
倒數(shù)計時器 提供時間到關機的功能 可自由設定是否關機或者提供警示
上傳時間： 2016-02-02
上傳用戶：lepoke
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標簽： 1.0 CSS 版本 英文
上傳時間： 2016-03-04
上傳用戶：15071087253
一個可以計算分壓電路的源碼。 可透過輸出與輸入電壓，計算電阻的大小；或透過輸入電壓與電阻，計算最後輸出之電壓
標簽： 分
上傳時間： 2014-12-09
上傳用戶：hoperingcong
由遠峰公司所設計的燒入flash軟體,歡迎使用2410/2440可用
標簽： flash 2410 2440
上傳時間： 2014-01-10
上傳用戶：dyctj
建立輸入文檔,輸出迷宮路線和迷宮的形象圖 (有實例)
上傳時間： 2016-03-27
上傳用戶：kiklkook
UML 2 for Dummies ( UML 理想設計方案 )
標簽： UML Dummies for 方案
上傳時間： 2014-01-17
上傳用戶：ommshaggar
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