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將Verilog設計轉成VHDL設計的程式

  • 資源大小:325 K
  • 上傳時間: 2016-01-18
  • 上傳用戶:yeshuqin
  • 資源積分:2 下載積分
  • 標      簽: Verilog VHDL 程式

資 源 簡 介

將Verilog設計轉成VHDL設計的程式

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