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編碼規范

  • BOSCH CAN規范V2.0 (中文版CAN協議)

    BOSCH CAN規范V2.0 (中文版CAN協議),介紹CAN Specification 2.0 pdf文件

    標簽: CAN BOSCH 2.0 協議

    上傳時間: 2013-04-24

    上傳用戶:zhuyibin

  • 中興設計部硬件電路設計規范

    硬件電路設計規范,中興通訊資料,非常有價值,適合硬件開發者

    標簽: 中興 硬件電路 設計規范

    上傳時間: 2013-04-24

    上傳用戶:busterman

  • PCI規范中文手冊

    PCI規范的中文手冊,是開發PCI總線的必備參考。

    標簽: PCI

    上傳時間: 2013-04-24

    上傳用戶:xwd2010

  • 基于單片機(7,4)循環碼編碼與譯碼的研究

    循環碼是實際差錯控制系統中常用的編碼方案,具有檢錯糾錯能力強、實現方便等特點。本文在理論分析循環碼編碼和譯碼基本原理的基礎上,提出了基于單片機系統的(7,4)循環碼軟件實現編碼、譯碼的方案。

    標簽: 單片機 循環碼 編碼 譯碼

    上傳時間: 2013-07-21

    上傳用戶:sc965382896

  • 華為軟件編程規范

    對華為軟件編程規范的簡要介紹。有意向進入華為的可以提高水平!

    標簽: 華為 軟件 編程規范

    上傳時間: 2013-08-04

    上傳用戶:腳趾頭

  • 一種面向無線視頻傳感器網絡的低復雜度視頻編碼算法及其在ARM平臺上的實現

    隨著21世紀的到來,計算機技術,信息處理技術,半導體技術和網絡技術不斷發展,人類社會進入了信息化時代。與此同時,無線視頻傳感器網絡也得到了突飛猛進的發展,成為當今國際上備受關注的熱點研究領域。無線視頻傳感器網絡有著很多的優點和十分廣泛的應用前景。在軍事,工業,城市管理和監控系統等重要領域都有潛在的使用價值。 無線視頻傳感器網絡有著顯著的特征,例如:網絡節點能源有限;網絡帶寬有限;對處理速度要求較高等。由此可見,傳統的視頻編碼標準無法應用于無線視頻傳感器網絡。MPEG-4,H.263,H.264等視頻編碼標準,全是基于運動估計補償實現的,計算量十分巨大,在能量,存儲空間和處理能力均有限的節點難以實現這類高復雜度的編碼算法。 本文針對無線視頻傳感器網絡對視頻編碼算法的具體需求,提出一種基于運動檢測的低復雜度視頻編碼算法。該算法只對當前編碼幀中的運動對象進行編碼,并且以面向對象的結構輸出碼流。實驗結果表明,與H.264全I幀編碼相比,本文提出的算法編碼速度提高了約3倍,編碼性能提高了約2dB。與H.264基本檔次相比,雖然編碼性能略有下降,但是編碼速度平均提高了8倍左右。因此,本文提出的算法可以在編碼效率和編碼速度之間獲得很好的折衷,在一定程度上可以滿足無線視頻傳感器網絡的需求。 本文選用ALDVK_270作為硬件實驗平臺。在分析算法結構的同時,結合嵌入式系統的特點,從算法,內存,高級語言和匯編語言等幾個方面提出優化方案,最終在ARM嵌入式平臺下實現了面向無線視頻傳感器網絡的低復雜度視頻編碼算法。測試結果表明,與優化前相比,優化后的編碼速度有了很大的提高,對于CIF格式的監控視頻序列能夠滿足實時處理的要求。

    標簽: ARM 無線視頻 傳感器網絡 復雜度

    上傳時間: 2013-07-26

    上傳用戶:小小小熊

  • 基于ARM的嵌入式數字視頻記錄系統研究

    隨著現代電子信息技術和我國汽車制造業的強勁增長,汽車已不再是簡單的交通工具,而是成為現代科技的載體。汽車的快速增長雖然使我們的出門更加便利,但同時也帶來了諸多社會問題。如:交通事故率上升、交通事故判別和車輛的規范化管理難度加大等。論文針對以上問題提出了使用視頻記錄的解決方法。 論文設計了一種基于ARM的嵌入式數字視頻記錄系統。該系統能夠將安裝在汽車中的攝像頭拍攝到的汽車前視景和儀表顯示畫面進行壓縮并以文件的形式存儲,事后通過回放系統將記錄的文件進行播放,可以以此來規范車輛管理、判斷交通事故原因和保障乘客安全。系統采用嵌入式技術并選用32位的ARM微控制器,使用先進的視頻解碼、編碼芯片,成功實現對實時視頻的采集、壓縮及儲存記錄。介紹目前數字視頻技術的發展及應用狀況、闡述視頻記錄系統所涉及的視頻壓縮和嵌入式系統設計基本理論,提出視頻記錄系統的設計方案。重點對基于ARM的嵌入式數字視頻記錄系統的系統硬件、軟件設計做了詳細的論述。硬件部分以ARM芯片LPC2210為核心控制器,以SAA7113H和Z1510為視頻壓縮核心硬件,完成ARM最小系統、視頻圖像信號的解碼和編碼壓縮電路、IDE儲存接口等電路設計;軟件部分采用穩定可靠的μC/OS-Ⅱ嵌入式實時操作系統,實現μC/OS-Ⅱ在LPC2210上的移植,完成系統的硬件初始化和IDE驅動的編寫調試,使整個系統的各個部分能夠協調的工作。 試驗表明,基于ARM的嵌入式數字視頻記錄系統能夠實現對數字視頻信號的長時間實時采集、壓縮記錄。壓縮后的數據符合MPEG-1標準。

    標簽: ARM 嵌入式 數字視頻 記錄

    上傳時間: 2013-07-07

    上傳用戶:萬有引力

  • H.264編碼解碼器源碼(c語言).zip

    可以用H.264編碼解碼器源碼(c語言)

    標簽: 264 zip 編碼解碼器 源碼

    上傳時間: 2013-07-08

    上傳用戶:wmwai1314

  • USB3.0–SATA橋接芯片MB86C30A的主要規范,pdf datasheet

    USB3.0–SATA橋接芯片MB86C30A的主要規范:*CBC (密碼段鏈接):一種適合加密模塊數據的AES 模式。*XTS (帶調整和密文竊取的XEX 加密模式):IEE

    標簽: datasheet SATA USB 3.0

    上傳時間: 2013-06-10

    上傳用戶:asdfasdfd

  • JPEG2000算術編碼的研究與FPGA實現

    JPEG2000是由ISO/ITU-T組織下的IEC JTC1/SC29/WG1小組制定的下一代靜止圖像壓縮標準.與JPEG(Joint Photographic Experts Group)相比,JPEG2000能夠提供更好的數據壓縮比,并且提供了一些JPEG所不具有的功能[1].JPEG2000具有的多種特性使得它具有廣泛的應用前景.但是,JPEG2000是一個復雜編碼系統,目前為止的軟件實現方案的執行時間和所需的存儲量較大,若想將JPEG2000應用于實際中,有著較大的困難,而用硬件電路實現JPEG2000或者其中的某些模塊,必然能夠減少JPEG200的執行時間,因而具有重要的意義.本文首先簡單介紹了JPEG2000這一新的靜止圖像壓縮標準,然后對算術編碼的原理及實現算法進行了深入的研究,并重點探討了JPEG2000中算術編碼的硬件實現問題,給出了一種硬件最優化的算術編碼實現方案.最后使用硬件描述語言(Very High Speed Integrated Circuit Hardware Description Language,VHDL)在寄存器傳輸級(Register Transfer Level,RTL描述了該硬件最優化的算術編碼實現方案,并以Altera 20K200E FPGA為基礎,在Active-HDL環境中進行了功能仿真,在Quartus Ⅱ集成開發環境下完成了綜合以及后仿真,綜合得到的最高工作時鐘頻率達45.81MHz.在相同的輸入條件下,輸出結果表明,本文設計的硬件算術編碼器與實現JPEG2000的軟件:Jasper[2]中的算術編碼模塊相比,處理時間縮短了30﹪左右.因而本文的研究對于JPEG2000應用于數字監控系統等實際應用有著重要的意義.

    標簽: JPEG 2000 FPGA 算術編碼

    上傳時間: 2013-05-16

    上傳用戶:671145514

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