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  • 基于FPGA的圖像增強(qiáng)技術(shù)研究

    圖像增強(qiáng)技術(shù)是數(shù)字圖像處理領(lǐng)域中的一項(xiàng)重要內(nèi)容,隨著數(shù)字圖像處理應(yīng)用領(lǐng)域的不斷擴(kuò)大,快速、實(shí)時圖像處理技術(shù)成為研究的熱點(diǎn)。超大規(guī)模集成電路技術(shù)的飛速發(fā)展為數(shù)字圖像實(shí)時處理技術(shù)提供了硬件基礎(chǔ),尤其是FPGA(Field Programmable Gate Array,現(xiàn)場可編程門陣列)憑借其高速并行、可重配置的架構(gòu)和基于查找表的獨(dú)特結(jié)構(gòu)等優(yōu)點(diǎn)使得在數(shù)字信號處理領(lǐng)域的應(yīng)用持續(xù)上升。國內(nèi)外,越來越多的實(shí)時圖像處理應(yīng)用逐漸轉(zhuǎn)向FPGA平臺。 本文基于FPGA的圖像增強(qiáng)技術(shù)研究主要是針對空間域方法,這種方法是指在空間域內(nèi)直接對像素灰度值進(jìn)行運(yùn)算處理,算法簡單并且存在并行性,非常適合于用硬件實(shí)現(xiàn)。FPGA可以靈活地實(shí)現(xiàn)并行、實(shí)時處理圖像數(shù)據(jù),正是利用這一特點(diǎn),本文提出了一種基于FPGA的圖像增強(qiáng)處理系統(tǒng)設(shè)計。該系統(tǒng)采用SOPC技術(shù),完成圖像增強(qiáng)處理。文中給出了系統(tǒng)設(shè)計思路,并分析了該系統(tǒng)的結(jié)構(gòu)及功能實(shí)現(xiàn),說明了系統(tǒng)實(shí)現(xiàn)過程。其硬件平臺的核心部分是Altera公司Stratix系列的.FPGA EPlS40芯片,采用自頂向下的設(shè)計方法構(gòu)造圖像增強(qiáng)處理功能模塊,利用硬件描述語言vHDL對圖像增強(qiáng)模塊進(jìn)行電路描述,并進(jìn)行設(shè)計優(yōu)化、仿真,在生成系統(tǒng)配置文件后加載到FPGA上進(jìn)行板級調(diào)試。完成了基于FPGA的圖像增強(qiáng)算法模塊的設(shè)計,重點(diǎn)設(shè)計實(shí)現(xiàn)了點(diǎn)運(yùn)算增強(qiáng)處理模塊、中值濾波器模塊,并對中值濾波器進(jìn)行了改進(jìn)設(shè)計實(shí)現(xiàn),采用FPGA完成了對圖像增強(qiáng)算法的硬件加速。

    標(biāo)簽: FPGA 圖像增強(qiáng) 技術(shù)研究

    上傳時間: 2013-06-16

    上傳用戶:songrui

  • 線性調(diào)頻信號的脈沖壓縮系統(tǒng)

    本文完成了一種高速高性能數(shù)字脈沖壓縮處理器的設(shè)計和FPGA實(shí)現(xiàn),包括系統(tǒng)架構(gòu)設(shè)計、方案論證及仿真、算法實(shí)現(xiàn)、結(jié)果的測試等。 緒論部分首先闡明了本課題研究的背景和意義,概述了雷達(dá)數(shù)字脈沖壓縮系統(tǒng)的主要研究內(nèi)容,關(guān)鍵技術(shù)及其發(fā)展趨勢,然后介紹了數(shù)字脈沖壓縮系統(tǒng)設(shè)計與實(shí)現(xiàn)的要求,最后給出了本文的主要研究內(nèi)容。 第二章敘述了線性調(diào)頻信號脈沖壓縮的基本原理,對系統(tǒng)設(shè)計的實(shí)現(xiàn)方法進(jìn)行了實(shí)時性方面的論證,并基于MATLAB做了仿真分析。 第三章從數(shù)字系統(tǒng)結(jié)構(gòu)化設(shè)計方面將本系統(tǒng)劃分為三個部分:輸入部分、脈壓計算部分、輸出部分,并在流程圖中對各部分所要實(shí)現(xiàn)的功能做了介紹。 第四章首先總結(jié)了數(shù)字脈沖壓縮的實(shí)現(xiàn)途徑;提出了基于自定制浮點(diǎn)數(shù)據(jù)格式和分時復(fù)用蝶型結(jié)構(gòu)的數(shù)字脈沖壓縮系統(tǒng)設(shè)計思想,對其關(guān)鍵技術(shù)進(jìn)行了深入的研究。 第五章對輸入輸出模塊的功能做了詳細(xì)的描述,設(shè)計了具體的結(jié)構(gòu)和電路。 第六章針對系統(tǒng)的測試驗(yàn)證,提出面向SOC的模塊驗(yàn)證和系統(tǒng)軟硬協(xié)同驗(yàn)證的驗(yàn)證策略。通過Link for Modelsim工具,實(shí)現(xiàn)MATAB與Modelsim之間對VHDL代碼的聯(lián)合仿真測試,通過在線邏輯分析工具ChipScope,完成系統(tǒng)的片上測試,并分析系統(tǒng)的性能,證明系統(tǒng)的可實(shí)用性。滿足設(shè)計的要求。 本文研制的數(shù)字脈沖壓縮處理器具有動態(tài)范圍大、處理精度高、處理能力強(qiáng)、體積小、重量輕、實(shí)時性好的優(yōu)點(diǎn),為設(shè)計高性能的現(xiàn)代雷達(dá)信號處理系統(tǒng)提供了可靠的保證。

    標(biāo)簽: 線性調(diào)頻信號 脈沖壓縮

    上傳時間: 2013-07-01

    上傳用戶:lingduhanya

  • 自適應(yīng)濾波器算法設(shè)計及其FPGA實(shí)現(xiàn)

    自適應(yīng)濾波器是智能天線技術(shù)中核心部分-自適應(yīng)波束成形器的關(guān)鍵技術(shù),算法的高效穩(wěn)定性及硬件時鐘速率的快慢是判斷波束成形器性能優(yōu)劣的主要標(biāo)準(zhǔn)。 首先選取工程領(lǐng)域最常用的自適應(yīng)橫向LMS濾波算法作為研究對象,提出了利用最小均方誤差意義下自適應(yīng)濾波器的輸出信號與主通道噪聲信號的等效關(guān)系,得到濾波器最佳自適應(yīng)參數(shù)的方法。并分析了在平穩(wěn)和非平穩(wěn)環(huán)境噪聲下,濾波器的收斂速度、權(quán)系數(shù)穩(wěn)定性、跟蹤輸入信號的能力和信噪比的改善等特性。 在分析梯度自適應(yīng)格型算法的基礎(chǔ)上,提出利用最佳反射系數(shù)的收斂性和穩(wěn)定性,得到了梯度自適應(yīng)格型濾波器的定步長改進(jìn)方法;并以改進(jìn)的梯度自適應(yīng)格型和線性組合器組成梯度自適應(yīng)格型聯(lián)合處理算法,在同樣環(huán)境噪聲下,相比自適應(yīng)橫向LMS算法,其各項(xiàng)性能指標(biāo)都得到了極大地改善,而且有利于節(jié)省硬件資源。 設(shè)計了自適應(yīng)橫向LMS濾波器和梯度自適應(yīng)格型聯(lián)合處理濾波器的電路模型,并用馳豫超前技術(shù)對兩類濾波器進(jìn)行了流水線優(yōu)化。利用Altera公司的CycloneⅡ系列EP2C5T144C6芯片和多種EDA工具,完成了濾波器的FPGA硬件設(shè)計與仿真實(shí)現(xiàn)。并以FPGA實(shí)現(xiàn)的3節(jié)梯度自適應(yīng)格型聯(lián)合處理器為核心,設(shè)計了一種TD-SCDMA系統(tǒng)的自適應(yīng)波束成形器,分析表明可以很好地利用系統(tǒng)提供的參考信號對下行波束進(jìn)行自適應(yīng)成形。

    標(biāo)簽: FPGA 自適應(yīng)濾波器 算法設(shè)計

    上傳時間: 2013-07-16

    上傳用戶:xyipie

  • 基于FPGA的雷達(dá)信號偵察數(shù)字接收機(jī)

    隨著信號處理技術(shù)的進(jìn)步和電子技術(shù)的發(fā)展,雷達(dá)信號偵察接收機(jī)逐漸從模擬體制向數(shù)字體制轉(zhuǎn)變。軟件無線電概念的提出,促使雷達(dá)偵察接收機(jī)朝大帶寬、全截獲方向發(fā)展,現(xiàn)有的串行信號處理體制已經(jīng)很難滿足系統(tǒng)要求。FPGA器件的出現(xiàn),為實(shí)現(xiàn)寬帶雷達(dá)信號偵察數(shù)字接收機(jī)提供了硬件支持。 本文結(jié)合FPGA芯片特點(diǎn),在前人研究基礎(chǔ)上,從算法和硬件實(shí)現(xiàn)兩方面,對雷達(dá)信號偵察數(shù)字接收機(jī)若干關(guān)鍵技術(shù)進(jìn)行了研究和創(chuàng)新,主要研究內(nèi)容包括以下幾個方面。 1)給出了基于QuartusII/Matlab和ISE/ModelSim/Matlab的兩種FPGA設(shè)計聯(lián)合仿真技術(shù)。這種聯(lián)合仿真技術(shù),大大提高了基于FPGA的雷達(dá)信號偵察數(shù)字接收機(jī)的設(shè)計效率。 2)給出了一種基于FFT/IFFT的寬帶數(shù)字正交變換算法,并將該算法在FPGA中進(jìn)行了硬件實(shí)現(xiàn),設(shè)計可對600MHz帶寬內(nèi)的輸入信號進(jìn)行實(shí)時正交變換。 3)提出了一種全并行結(jié)構(gòu)FFT的FPGA實(shí)現(xiàn)方案,并將其在FPGA芯片中進(jìn)行了硬件實(shí)現(xiàn),設(shè)計能夠在一個時鐘周期內(nèi)完成32點(diǎn)并行FFT運(yùn)算,滿足了數(shù)字信道化接收機(jī)對數(shù)據(jù)處理速度的要求。 4)提出了一種自相關(guān)信號檢測FPGA實(shí)現(xiàn)方案,通過改變FIFO長度改變自相關(guān)運(yùn)算點(diǎn)數(shù),實(shí)現(xiàn)了弱信號檢測。提出通過二次門限處理來消除檢測脈沖中的毛刺和凹陷,降低了虛警概率,提高了檢測結(jié)果的可靠性。 5)在單通道自相關(guān)信號檢測算法基礎(chǔ)上,提出采用三路并行檢測,每路采用不同的相關(guān)點(diǎn)數(shù)和檢測門限,再綜合考慮三路檢測結(jié)果,得到最終檢測結(jié)果。給出了算法FPGA實(shí)現(xiàn)過程,并對設(shè)計進(jìn)行了聯(lián)合時序仿真,提高了檢測性能。 6)給出了一種利用FFT變換后的兩根最大譜線進(jìn)行插值的快速高精度頻率估計方法,并將該算法在FPGA硬件中進(jìn)行了實(shí)現(xiàn)。通過利用FFT運(yùn)算后的實(shí)/虛部最大值進(jìn)行插值,降低了硬件資源消耗、縮短了運(yùn)算延遲。 7)結(jié)合4)、5)、6)中的研究成果,完成了對雷達(dá)脈沖信號到達(dá)時間、終止時間、脈沖寬度和脈沖頻率的估計,最終在一塊FPGA芯片內(nèi)實(shí)現(xiàn)了一個精簡的雷達(dá)信號偵察數(shù)字接收機(jī),并在微波暗室中進(jìn)行了測試。

    標(biāo)簽: FPGA 雷達(dá)信號 數(shù)字接收機(jī)

    上傳時間: 2013-06-13

    上傳用戶:Divine

  • 基于VB的凸輪機(jī)構(gòu)的參數(shù)化設(shè)計及其動畫仿真

    本文以VB 為主體開發(fā)語言,實(shí)現(xiàn)了參數(shù)化設(shè)計凸輪和凸輪輪廓設(shè)計過程的動畫仿真,既提高了凸輪設(shè)計效率,又益于計算機(jī)輔助教學(xué)。

    標(biāo)簽: 凸輪機(jī)構(gòu) 參數(shù) 動畫仿真

    上傳時間: 2013-06-13

    上傳用戶:www240697738

  • MCS-51單片機(jī)實(shí)現(xiàn)的功率因數(shù)表

    熱穩(wěn)定性好,工作電壓動態(tài)范圍寬,成本低的多用戶功率因數(shù)表,可在相同電壓下測量 16個支路的功率因數(shù), 并可隨時動態(tài)升級單片機(jī)的數(shù)據(jù)處理程序。本文介紹了這樣的多用戶功率因數(shù)表的設(shè)計方案。

    標(biāo)簽: MCS 51 單片機(jī) 功率因數(shù)

    上傳時間: 2013-06-13

    上傳用戶:a6697238

  • 基于FPGA的實(shí)時圖像融合處理系統(tǒng)

    隨著多媒體技術(shù)發(fā)展,數(shù)字圖像處理已經(jīng)成為眾多應(yīng)用系統(tǒng)的核心和基礎(chǔ)。圖像處理作為一種重要的現(xiàn)代技術(shù),已經(jīng)廣泛應(yīng)用于軍事指揮、大視場展覽、跟蹤雷達(dá)、電視會議、導(dǎo)航等眾多領(lǐng)域。因而,實(shí)現(xiàn)高分辨率高幀率圖像實(shí)時處理的技術(shù)不僅具有廣泛的應(yīng)用前景,而且對相關(guān)領(lǐng)域的發(fā)展也具有深遠(yuǎn)意義。 大視場可視化系統(tǒng)由于屏幕尺寸很大,只有在特制的曲面屏幕上才能使細(xì)節(jié)得到充分地展現(xiàn)。為了在曲面屏幕上正確的顯示圖像,需要在投影前實(shí)時地對圖像進(jìn)行幾何校正和邊緣融合。而現(xiàn)場可編程門陣列(FPGA)則是用硬件處理實(shí)時圖像數(shù)據(jù)的理想選擇,基于FPGA的圖像處理技術(shù)是世界范圍內(nèi)廣泛關(guān)注的研究領(lǐng)域。 本課題的主要工作就是設(shè)計一個以FPGA為核心的硬件系統(tǒng),該系統(tǒng)可對高分辨率高刷新率(1024*768@60Hz)的視頻圖像實(shí)時地進(jìn)行幾何校正和邊緣融合。 論文首先介紹了圖像處理的幾何原理,然后提出了基于FPGA的大視場實(shí)時圖像融合處理系統(tǒng)的設(shè)計方案和模塊功能劃分。系統(tǒng)分為算法與軟件設(shè)計,硬件電路設(shè)計和FPGA邏輯設(shè)計三個大的部分。本論文主要負(fù)責(zé)FPGA的邏輯設(shè)計。圍繞FPGA的邏輯設(shè)計,論文先介紹了系統(tǒng)涉及的關(guān)鍵技術(shù),以及使用Verilog語言進(jìn)行邏輯設(shè)計的基本原則。 論文重點(diǎn)對FPGA內(nèi)部模塊設(shè)計進(jìn)行了詳細(xì)的闡述。仲裁與控制模塊是頂模塊的主體部分,主要實(shí)現(xiàn)系統(tǒng)狀態(tài)機(jī)和時序控制;參數(shù)表模塊主要實(shí)現(xiàn)SDRAM存儲器的控制器接口,用于圖像處理時讀取參數(shù)信息。圖像處理模塊是整個系統(tǒng)的核心,通過調(diào)用FPGA內(nèi)嵌的XtremeDSP模塊,高速地完成對圖像數(shù)據(jù)的乘累加運(yùn)算。最后論文提出并實(shí)現(xiàn)了一種基于PicoBlaze核的12C總線接口用于配置FPGA外圍芯片。 經(jīng)過對寄存器傳輸級VerilogHDL代碼的綜合和仿真,結(jié)果表明,本文所設(shè)計的系統(tǒng)可以應(yīng)用在大視場可視化系統(tǒng)中完成對高分辨率高幀率圖像的實(shí)時處理。

    標(biāo)簽: FPGA 實(shí)時圖像 處理系統(tǒng)

    上傳時間: 2013-05-19

    上傳用戶:戀天使569

  • 基于FPGA的視頻圖像處理系統(tǒng)

    隨著電子技術(shù)和計算機(jī)技術(shù)的飛速發(fā)展,視頻圖像處理技術(shù)近年來得到極大的重視和長足的發(fā)展,其應(yīng)用范圍主要包括數(shù)字廣播、消費(fèi)類電子、視頻監(jiān)控、醫(yī)學(xué)成像及文檔影像處理等領(lǐng)域。當(dāng)前視頻圖像處理主要問題是當(dāng)處理的數(shù)據(jù)量很大時,處理速度慢,執(zhí)行效率低。而且視頻算法的軟件和硬件仿真和驗(yàn)證的靈活性低。 本論文首先根據(jù)視頻信號的處理過程和典型視頻圖像處理系統(tǒng)的構(gòu)成提出了基于FPGA的視頻圖像處理系統(tǒng)總體框圖;其次選擇視頻轉(zhuǎn)換芯片SAA7113,完成視頻圖像采集模塊的設(shè)計,主要分三步完成:1)配置視頻轉(zhuǎn)換芯片的工作模式,完成視頻轉(zhuǎn)化芯片SAA7113的初始化:2)通過分析輸出數(shù)據(jù)流的格式標(biāo)準(zhǔn),來識別奇偶場信號、場消隱信號和有效行數(shù)據(jù)的開始和結(jié)束信號三種控制信號,并根據(jù)控制信號,用Verilog硬件描述語言編程實(shí)現(xiàn)圖像數(shù)據(jù)的采集;3)分析SRAM的讀寫控制時序,采用兩塊SRAM完成圖像數(shù)據(jù)的存儲。然后編寫軟件測試文件,在ISE Simulator仿真環(huán)境進(jìn)行程序測試與運(yùn)行,并分析仿真結(jié)果,驗(yàn)證了數(shù)據(jù)采集和存儲的正確性;最后,對常用視頻圖像算法的MATLAB仿真,選擇適當(dāng)?shù)乃阕?,采用工具M(jìn)ATLAB、System Generator for DSP和ISE,利用模塊構(gòu)建方式,搭建視頻算法平臺,實(shí)現(xiàn)圖像平滑濾波、銳化濾波算法,在Simulink中仿真并自動生成硬件描述語言和網(wǎng)表,對資源的消耗做簡要分析。 本論文的創(chuàng)新點(diǎn)是采用新的開發(fā)環(huán)境System Generator for DSP實(shí)現(xiàn)視頻圖像算法。這種開發(fā)視頻圖像算法的方式靈活性強(qiáng)、設(shè)計周期短、驗(yàn)證方便、是視頻圖像處理發(fā)展的必然趨勢。

    標(biāo)簽: FPGA 視頻圖像 處理系統(tǒng)

    上傳時間: 2013-07-28

    上傳用戶:lingzhichao

  • 基于FPGA嵌入式指紋識別系統(tǒng)研究

    隨著科學(xué)技術(shù)的發(fā)展,指紋識別技術(shù)被廣泛應(yīng)用到各種不同的領(lǐng)域。對于一般的指紋識別系統(tǒng),其設(shè)計要求具有很高的實(shí)時性和易用性,因此識別算法應(yīng)該具有較低的復(fù)雜度,較快的運(yùn)算速度,從而滿足實(shí)時性的要求。所以有必要根據(jù)不同的識別算法采用不同的實(shí)現(xiàn)平臺,使得指紋識別系統(tǒng)具有較高的可靠性、實(shí)時性、有效性等性能要求。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計領(lǐng)域中最熱門的概念。NiosⅡ是Altera.公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入到FPGA內(nèi)部,與用戶自定義邏輯組建成一個基于FPGA的片上專用系統(tǒng)。 本文在綜合考慮各種應(yīng)用情況的基礎(chǔ)上,以網(wǎng)絡(luò)技術(shù)、數(shù)據(jù)庫技術(shù)、指紋識別技術(shù)和嵌入式系統(tǒng)技術(shù)為理論基礎(chǔ),提出了一種有效可行的系統(tǒng)架構(gòu)方案。對指紋識別技術(shù)中各個環(huán)節(jié)的算法和原理進(jìn)行了深入研究,合理的改進(jìn)了部分指紋識別算法;同時為了提高系統(tǒng)的實(shí)時性,采用NiosⅡ嵌入式處理器和FPGA硬件模塊實(shí)現(xiàn)指紋圖像處理主要算法。論文主要包括以下幾個方面: 1、對指紋圖像預(yù)處理、特征提取和特征匹配算法原理進(jìn)行闡述,同時改進(jìn)了指紋圖像的細(xì)化算法,提高了算法的性能,并設(shè)計了一套實(shí)用的指紋特征數(shù)據(jù)結(jié)構(gòu); 2、針對指紋圖像預(yù)處理模塊,包括圖像的歸一化、頻率提取、方向提取以及方向?yàn)V波,采用基于FPGA的硬件電路的方式實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明,在保證系統(tǒng)誤識率較低、可靠性高的基礎(chǔ)上,大大提高了系統(tǒng)的執(zhí)行速度; 3、改變了傳統(tǒng)的單枚指紋識別方法,提出采用多枚指紋唯一標(biāo)識身份,大大降低了識別系統(tǒng)的誤識率; 4、改進(jìn)了傳統(tǒng)的基于三角形匹配中獲取基準(zhǔn)點(diǎn)的方法,同時結(jié)合可變界限盒思想進(jìn)行指紋特征匹配。 5、結(jié)合COM+技術(shù)、數(shù)據(jù)庫技術(shù)和網(wǎng)絡(luò)技術(shù),開發(fā)了后臺指紋特征匹配服務(wù)系統(tǒng),實(shí)現(xiàn)了嵌入式指紋識別系統(tǒng)同數(shù)據(jù)庫的實(shí)時信息交換。 實(shí)驗(yàn)結(jié)果表明,本文所提出的系統(tǒng)構(gòu)架方案有效可行,基于FPGA的自動指紋識別系統(tǒng)在速度、功耗、擴(kuò)展性等方面具有獨(dú)特的優(yōu)勢,擁有廣闊的發(fā)展前景。

    標(biāo)簽: FPGA 嵌入式 指紋識別 系統(tǒng)研究

    上傳時間: 2013-04-24

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  • 軟件無線電中數(shù)字下變頻技術(shù)研究

    軟件無線電(SDR,Software Defined Radio)由于具備傳統(tǒng)無線電技術(shù)無可比擬的優(yōu)越性,已成為業(yè)界公認(rèn)的現(xiàn)代無線電通信技術(shù)的發(fā)展方向。理想的軟件無線電系統(tǒng)強(qiáng)調(diào)體系結(jié)構(gòu)的開放性和可編程性,減少靈活性著的硬件電路,把數(shù)字化處理(ADC和DAC)盡可能靠近天線,通過軟件的更新改變硬件的配置、結(jié)構(gòu)和功能。目前,直接對射頻(RF)進(jìn)行采樣的技術(shù)尚未實(shí)現(xiàn)普及的產(chǎn)品化,而用數(shù)字變頻器在中頻進(jìn)行數(shù)字化是普遍采用的方法,其主要思想是,數(shù)字混頻器用離散化的單頻本振信號與輸入采樣信號在乘法器中相乘,再經(jīng)插值或抽取濾波,其結(jié)果是,輸入信號頻譜搬移到所需頻帶,數(shù)據(jù)速率也相應(yīng)改變,以供后續(xù)模塊做進(jìn)一步處理。數(shù)字變頻器在發(fā)射設(shè)備和接收設(shè)備中分別稱為數(shù)字上變頻器(DUC,Digital Upper Converter)和數(shù)字下變頻器(DDC,Digital Down Converter),它們是軟件無線電通信設(shè)備的關(guān)鍵部什。大規(guī)??删幊踢壿嬈骷膽?yīng)用為現(xiàn)代通信系統(tǒng)的設(shè)計帶來極大的靈活性?;贔PGA的數(shù)字變頻器設(shè)計是深受廣大設(shè)計人員歡迎的設(shè)計手段。本文的重點(diǎn)研究是數(shù)字下變頻器(DDC),然而將它與數(shù)字上變頻器(DUC)完全割裂后進(jìn)行研究顯然是不妥的,因此,本文對數(shù)字上變頻器也作適當(dāng)介紹。 第一章簡要闡述了軟件無線電及數(shù)字下變頻的基本概念,介紹了研究背景及所完成的主要研究工作。 第二章介紹了數(shù)控振蕩器(NCO),介紹了兩種實(shí)現(xiàn)方法,即基于查找表和基于CORDIC算法的實(shí)現(xiàn)。對CORDIc算法作了重點(diǎn)介紹,給出了傳統(tǒng)算法和改進(jìn)算法,并對基于傳統(tǒng)CORDIC算法的NCO的FPGA實(shí)現(xiàn)進(jìn)行了EDA仿真。 第三章介紹了變速率采樣技術(shù),重點(diǎn)介紹了軟件無線電中廣泛采用的級聯(lián)積分梳狀濾波器 (cascaded integratot comb, CIC)和ISOP(Interpolated Second Order Polynomial)補(bǔ)償法,對前者進(jìn)行了基于Matlab的理論仿真和FPGA實(shí)現(xiàn)的EDA仿真,后者只進(jìn)行了基于Matlab的理論仿真。 第四章介紹了分布式算法和軟件無線電中廣泛采用的半帶(half-band,HB)濾波器,對基于分布式算法的半帶濾波器的FPGA實(shí)現(xiàn)進(jìn)行了EDA仿真,最后簡要介紹了FIR的多相結(jié)構(gòu)。 第五章對數(shù)字下變頻器系統(tǒng)進(jìn)行了噪聲綜合分析,給出了一個噪聲模型。 第六章介紹了數(shù)字下變頻器在短波電臺中頻數(shù)字化應(yīng)用中的一個實(shí)例,給出了測試結(jié)果,重點(diǎn)介紹了下變頻器的:FPGA實(shí)現(xiàn),其對應(yīng)的VHDL程序收錄在本文最后的附錄中,希望對從事該領(lǐng)域設(shè)計的技術(shù)人員具有一定參考價值。

    標(biāo)簽: 軟件無線電 數(shù)字下變頻 技術(shù)研究

    上傳時間: 2013-06-09

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