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自動檢測技術

  • 一種新的自適應數字水印算法

    為了提高數字水印抗擊各種圖像攻擊的性能和保持圖像的穩(wěn)健性和不可見性,提出了一種基于離散小波變換(DWT),SVD(singular value decomposition)奇異值分解水印圖像和原始載體圖像的離散余弦變換(DCT)的自適應水印嵌入算法,主要是將水印圖像的兩次小波變換后的低頻分量潛入到原始圖像分塊經過SVD分解的S分量矩陣中,同時根據圖像的JPEG壓縮比的不同計算各個圖像塊的水印調節(jié)因子。實驗證明該算法在抗擊JPEG壓縮、中值濾波、加噪等均具有很好的魯棒性,嵌入后的圖像的PSNR達到38,具有良好的視覺掩蔽性

    標簽: 數字水印算法

    上傳時間: 2013-10-09

    上傳用戶:ca05991270

  • 基于LMS算法與RLS算法的自適應濾波

    自適應信號處理的理論和技術已經成為人們常用濾波和去噪技術。文中講述了自適應濾波的原理以及LMS算法和RLS算法兩種基本自適應算法的原理及步驟。并用MATLAB分別對兩種算法進行了自適應濾波仿真和實現。

    標簽: LMS RLS 算法 自適應濾波

    上傳時間: 2013-11-26

    上傳用戶:1051290259

  • Multisim中自定義元器件

    關于multisim如何自定義元器件

    標簽: Multisim 自定義 元器件

    上傳時間: 2013-10-14

    上傳用戶:zw380105939

  • 自適應預失真前饋功率放大系統分析

    在本課題中,兼顧了效率及線性度,采用自適應預失真前饋復合線性化系統來改善高功率放大器的線性度。由于加入自適應控制模塊,射頻電路不受溫度、時漂、輸入功率等的影響,可始終處于較佳工作狀態(tài),這使得整個放大系統更為實用,也更具有拓展價值。

    標簽: 預失真 前饋 功率 放大

    上傳時間: 2013-11-21

    上傳用戶:xauthu

  • 負反饋放大電路自激的概念

      負反饋放大電路之所以能夠產生自激振蕩,是因為在放大電路中存在 RC 環(huán)節(jié)。于是在放大電路的高頻或低頻段會產生附加相移DjAF ,如DjAF的足夠大,使負反饋變成正反饋。

    標簽: 負反饋 放大電路

    上傳時間: 2014-01-26

    上傳用戶:lizhen9880

  • 【開源】線性CCD自適應性算法攻略

    【開源】線性CCD自適應性算法攻略

    標簽: CCD 開源 線性 算法

    上傳時間: 2013-10-23

    上傳用戶:forzalife

  • 斬波穩(wěn)定(自穩(wěn)零)精密運算放大器

    要想獲得最低的失調和漂移性能,斬波穩(wěn)定(自穩(wěn)零)放大器可能是唯一的解決方案。最好的雙極性放大器的失調電壓為25 V,漂移為0.1 V/ºC。斬波放大器盡管存在一些不利影響,但可提供低于5 V的失調電壓,而且不會出現明顯的失調漂移,

    標簽: 斬波穩(wěn)定 精密 運算放大器

    上傳時間: 2013-12-25

    上傳用戶:z754970244

  • Protel 自定義Title Block方法

    Protel 自定義Title Block方法

    標簽: Protel Block Title 自定義

    上傳時間: 2014-12-24

    上傳用戶:yl1140vista

  • pcb layout design(臺灣硬件工程師15年經驗

    PCB LAYOUT 術語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範圍,不與零件腳相接。10. THERMAL PAD:多層板內NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或導通孔。11. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設置處:Setup􀃆pads􀃆stacks

    標簽: layout design pcb 硬件工程師

    上傳時間: 2013-10-22

    上傳用戶:pei5

  • pcb layout規(guī)則

    LAYOUT REPORT .............. 1   目錄.................. 1     1. PCB LAYOUT 術語解釋(TERMS)......... 2     2. Test Point : ATE 測試點供工廠ICT 測試治具使用............ 2     3. 基準點 (光學點) -for SMD:........... 4     4. 標記 (LABEL ING)......... 5     5. VIA HOLE PAD................. 5     6. PCB Layer 排列方式...... 5     7.零件佈置注意事項 (PLACEMENT NOTES)............... 5     8. PCB LAYOUT 設計............ 6     9. Transmission Line ( 傳輸線 )..... 8     10.General Guidelines – 跨Plane.. 8     11. General Guidelines – 繞線....... 9     12. General Guidelines – Damping Resistor. 10     13. General Guidelines - RJ45 to Transformer................. 10     14. Clock Routing Guideline........... 12     15. OSC & CRYSTAL Guideline........... 12     16. CPU

    標簽: layout pcb

    上傳時間: 2013-12-20

    上傳用戶:康郎

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