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芯片規(guī)(guī)格書

fpga+sdram+PHY 芯片設(shè)計(jì)原理圖

fpga+sdram+PHY 芯片設(shè)計(jì)原理圖

標(biāo)簽： sdram fpga PHY 芯片設(shè)計(jì)

上傳時間： 2013-08-14

上傳用戶：chongcongying
以ARM微處理器和FPGA 芯片為核心設(shè)計(jì)了嵌入式CCD 采集系統(tǒng)

提出了基于嵌入式技術(shù)CCD 采集系統(tǒng)的新方法,并以ARM微處理器和FPGA 芯片為核心設(shè)計(jì)了嵌入式CCD 采集系統(tǒng),解決了傳統(tǒng)采集方法中系統(tǒng)過于龐大和復(fù)雜的問題,具有結(jié)構(gòu)簡單、小型化和智能化的特點(diǎn)。試驗(yàn)結(jié)果表明,該系統(tǒng)實(shí)現(xiàn)了CCD 輸出圖像的高速采集和實(shí)時顯示,數(shù)據(jù)采集速率達(dá)到5 MHz。

標(biāo)簽： FPGA ARM CCD 微處理器

上傳時間： 2013-08-15

上傳用戶：baitouyu
采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺上實(shí)現(xiàn)多路HDLC電路

采用Altera公司的FPGA芯片，在MAX+plus II軟件平臺上實(shí)現(xiàn)多路HDLC電路

標(biāo)簽： Altera FPGA HDLC plus

上傳時間： 2013-08-16

上傳用戶：ommshaggar
FPGA芯片的電源控制

FPGA芯片的電源控制的選擇,基礎(chǔ)要求

標(biāo)簽： FPGA 芯片電源控制

上傳時間： 2013-08-17

上傳用戶：zhichenglu
有關(guān)FPGA芯片的管腳的封裝的一些資料。

有關(guān)FPGA芯片的管腳的封裝的一些資料。

標(biāo)簽： FPGA 芯片管腳封裝

上傳時間： 2013-08-18

上傳用戶：dljwq
基于FPGA的JPEG圖像壓縮芯片設(shè)計(jì)

基于FPGA的JPEG圖像壓縮芯片設(shè)計(jì)

標(biāo)簽： FPGA JPEG 圖像壓縮芯片設(shè)計(jì)

上傳時間： 2013-08-18

上傳用戶：木子葉1
一套基于XILIX,SPATAN2,XC2S200 芯片實(shí)驗(yàn)板上的,10個典型VRILOGHDL的FPGA實(shí)驗(yàn)

一套基于XILIX,SPATAN2,XC2S200 芯片實(shí)驗(yàn)板上的,10個典型VRILOGHDL的FPGA實(shí)驗(yàn),有幫助,

標(biāo)簽： VRILOGHDL SPATAN XILIX FPGA

上傳時間： 2013-08-19

上傳用戶：偷心的海盜
一個很好的對不同F(xiàn)PGA時芯片的選擇資料

一個很好的對不同F(xiàn)PGA時芯片的選擇資料,對你的設(shè)計(jì)很有幫助

標(biāo)簽： FPGA 芯片

上傳時間： 2013-08-20

上傳用戶：maricle
16QAM接收機(jī)解調(diào)芯片的FPGA實(shí)現(xiàn)

描述了一個用于微波傳輸設(shè)備的16QAM接收機(jī)解調(diào)芯片的FPGA實(shí)現(xiàn),芯片集成了定時恢復(fù)、載波恢復(fù)和自適應(yīng)盲判決反饋均衡器(DFE),采用恒模算法(CMA)作為均衡算法。芯片支持高達(dá)25M波特的符號速率,在一片EP1C12Q240C8(ALTERA)上實(shí)現(xiàn),即將用于量產(chǎn)的微波傳輸設(shè)備中。\\r\\n

標(biāo)簽： FPGA QAM 16 接收機(jī)

上傳時間： 2013-08-22

上傳用戶：23333
基于FPGA加密芯片設(shè)計(jì)論文（AES和DES算法）

基于FPGA加密芯片設(shè)計(jì)論文（AES和DES算法）

標(biāo)簽： FPGA AES DES 加密

上傳時間： 2013-08-29

上傳用戶：weixiao99