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芯片集成

  • 基于“單片機CPLDFPGA體系結(jié)構(gòu)”的程控交換機系統(tǒng)集成化設(shè)計

    有線通信方式由于具有保密性高、抗干擾能力強在軍事通信中倍受青睞,因此,對軍用有線通信設(shè)備的研究和設(shè)計具有十分重要的戰(zhàn)略意義.TBJ-204型野戰(zhàn)20線程控交換機是一種小型背負(fù)式模擬空分程控用戶交換機,用于裝備全軍各兵種的作戰(zhàn)、演習(xí)和緊急搶險等行動.該項目以該交換機為研究對象,在詳細(xì)分析原設(shè)備的系統(tǒng)結(jié)構(gòu)和功能實現(xiàn)方式的基礎(chǔ)上,指出該機型在使用過程中存在技術(shù)相對陳舊、分立元件過多、可靠性和保密性不夠、體積大、重量大、維修困難等問題,同時結(jié)合系統(tǒng)的低功耗需求和優(yōu)化人機接口設(shè)計,本文提出基于"單片機+CPLD/FPGA體系結(jié)構(gòu)"的集成化設(shè)計方案:①在CPLD中實現(xiàn)信號音分頻和計時頻率生成電路、20路用戶LED狀態(tài)控制電路;②CPLD與單片機以總線接口方式實現(xiàn)譯碼、數(shù)據(jù)和控制信號鎖存功能的VHDL設(shè)計;③基于低功耗設(shè)計的器件選型方案和單片機待機模式設(shè)計;④人機接口的LCD菜單操作方式.該文詳細(xì)介紹了改型設(shè)備的研制過程,包括CPLD片內(nèi)功能設(shè)計實現(xiàn)、主控制板和用戶板各功能模塊工作原理和設(shè)計實現(xiàn)、各硬件模塊功能測試等,最后給出了局內(nèi)呼叫處理功能和話務(wù)員服務(wù)功能的軟件實現(xiàn)流程.文章結(jié)尾介紹了改型設(shè)備的系統(tǒng)性能,它將實現(xiàn)更高的可靠性、保密性和抗干擾能力,同時具備低功耗和小型化的優(yōu)點.最后,該文總結(jié)了項目設(shè)計中使用的關(guān)鍵技術(shù),指出了設(shè)計的創(chuàng)新意義和將來的工作.

    標(biāo)簽: CPLDFPGA 單片機 程控交換機

    上傳時間: 2013-04-24

    上傳用戶:啊颯颯大師的

  • AD6525芯片參考設(shè)計電路原理圖

    基帶芯片AD6525的應(yīng)用電路。在05年之前的手機中應(yīng)用非常廣泛,配合AD652x的幾款芯片便可完成手機信號處理中的大部分功能。

    標(biāo)簽: 6525 AD 芯片 參考設(shè)計

    上傳時間: 2013-04-24

    上傳用戶:guanliya

  • 基于FPGA的8位增強型CPU設(shè)計與驗證

    隨著信息技術(shù)的發(fā)展,系統(tǒng)級芯片SoC(System on a Chip)成為集成電路發(fā)展的主流。SoC技術(shù)以其成本低、功耗小、集成度高的優(yōu)勢正廣泛地應(yīng)用于嵌入式系統(tǒng)中。通過對8位增強型CPU內(nèi)核的研究及其在FPGA(Field Programmable Gate Arrav)上的實現(xiàn),對SoC設(shè)計作了初步研究。 在對Intel MCS-8051的匯編指令集進(jìn)行了深入地分析的基礎(chǔ)上,按照至頂向下的模塊化的高層次設(shè)計流程,對8位CPU進(jìn)行了頂層功能和結(jié)構(gòu)的定義與劃分,并逐步細(xì)化了各個層次的模塊設(shè)計,建立了具有CPU及定時器,中斷,串行等外部接口的模型。 利用5種尋址方式完成了8位CPU的數(shù)據(jù)通路的設(shè)計規(guī)劃。利用有限狀態(tài)機及微程序的思想完成了控制通路的各個層次模塊的設(shè)計規(guī)劃。利用組合電路與時序電路相結(jié)合的思想完成了定時器,中斷以及串行接口的規(guī)劃。采用邊沿觸發(fā)使得一個機器周期對應(yīng)一個時鐘周期,執(zhí)行效率提高。使用硬件描述語言實現(xiàn)了各個模塊的設(shè)計。借助EDA工具ISE集成開發(fā)環(huán)境完成了各個模塊的編程、調(diào)試和面向FPGA的布局布線;在Synplify pro綜合工具中完成了綜合;使用Modelsim SE仿真工具對其進(jìn)行了完整的功能仿真和時序仿真。 設(shè)計了一個通用的擴展接口控制器對原有的8位處理器進(jìn)行擴展,加入高速DI,DO以及SPI接口,增強了8位處理器的功能,可以用于現(xiàn)有單片機進(jìn)行升級和擴展。 本設(shè)計的CPU全面兼容MCS-51匯編指令集全部的111條指令,在時鐘頻率和指令的執(zhí)行效率指標(biāo)上均優(yōu)于傳統(tǒng)的MCS-51內(nèi)核。本設(shè)計以硬件描述語言代碼形式存在可與任何綜合庫、工藝庫以及FPGA結(jié)合開發(fā)出用戶需要的固核和硬核,可讀性好,易于擴展使用,易于升級,比較有實用價值。本設(shè)計通過FPGA驗證。

    標(biāo)簽: FPGA CPU 8位 增強型

    上傳時間: 2013-04-24

    上傳用戶:jlyaccounts

  • 基于FPGA的8051單片機IP核設(shè)計及應(yīng)用

    單片微型計算機(單片機)是將微處理器CPU、程序存儲器、數(shù)據(jù)存儲器、定時/計數(shù)器、輸入/輸出并行接口等集成在一起。由于單片機具有專門為嵌入式系統(tǒng)設(shè)計的體系結(jié)構(gòu)與指令系統(tǒng),所以它最能滿足嵌入式系統(tǒng)的應(yīng)用要求。Intel公司生產(chǎn)的MCS-51系列單片機是我國目前應(yīng)用最廣的單片機之一。 隨著可編程邏輯器件設(shè)計技術(shù)的發(fā)展,每個邏輯器件中門電路的數(shù)量越來越多,一個邏輯器件就可以完成本來要由很多分立邏輯器件和存儲芯片完成的功能。這樣做減少了系統(tǒng)的功耗和成本,提高了性能和可靠性。FPGA就是目前最受歡迎的可編程邏輯器件之一。IP核是將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,設(shè)計成可修改參數(shù)的模塊,讓其他用戶可以直接調(diào)用這些模塊,這樣就大大減輕了工程師的負(fù)擔(dān),避免重復(fù)勞動。隨著FPGA的規(guī)模越來越大,設(shè)計越來越復(fù)雜,使用IP核是一個發(fā)展趨勢。 本課題結(jié)合FPGA與8051單片機的優(yōu)點,主要針對以下三個方面研究: (1)FPGA開發(fā)平臺的硬件實現(xiàn)選用Xilinx公司的XC3S500E-PQ208-4-C作為核心器件,采用Intel公司的EEPROM芯片2816A和SRAM芯片6116作為片內(nèi)程序存儲器,搭建FPGA的硬件開發(fā)平臺。 (2)用VHDL語言實現(xiàn)8051IP核分析研究8051系列單片機內(nèi)部各模塊結(jié)構(gòu)以及各部分的連接關(guān)系,實現(xiàn)了基于FPGA的8051IP核。主要包括如下幾個模塊:CPU模塊、片內(nèi)數(shù)據(jù)存儲器模塊、定時/計數(shù)器模塊、并行端口模塊、串行端口模塊、中斷處理模塊、同步復(fù)位模塊等。 (3)基于FPGA的8051IP核應(yīng)用用所設(shè)計的8051IP核,實現(xiàn)了對一個4×4鍵盤的監(jiān)測掃描、鍵盤確認(rèn)、按鍵識別等應(yīng)用。

    標(biāo)簽: FPGA 8051 單片機 IP核

    上傳時間: 2013-04-24

    上傳用戶:1417818867

  • LED顯示屏單元板芯片介紹

    LED顯示屏單元板芯片介紹 IC的管腳功能 IC芯片分別:74HC245、74HC595、74HC138、74HC04、4953。各IC管腳功能如下: A: 74HC245功能是放大及緩沖。各引腳如圖 20 和1接電源(+5V) 19腳和10腳接電源地(GND)

    標(biāo)簽: LED 顯示屏 單元板 芯片介紹

    上傳時間: 2013-05-17

    上傳用戶:小楊高1

  • ISD4004-16M語音芯片的循環(huán)錄放電路設(shè)計

    針對ISD 語音芯片的特點, 設(shè)計一種由單片機控制, 能夠循環(huán)錄放的語音電路,可作為錄音機、復(fù)讀機、音頻記錄儀使用, 既節(jié)省存儲空間, 又降低成本, 具有較高的實用價值。

    標(biāo)簽: 4004 ISD 16 語音芯片

    上傳時間: 2013-06-24

    上傳用戶:yiwen213

  • 板級光互連協(xié)議研究與FPGA實現(xiàn)

    隨著集成電路頻率的提高和多核時代的到來,傳統(tǒng)的高速電互連技術(shù)面臨著越來越嚴(yán)重的瓶頸問題,而高速下的光互連具有電互連無法比擬的優(yōu)勢,成為未來電互連的理想替代者,也成為科學(xué)研究的熱點問題。目前,由OIF(Optical Intemetworking Forum,光網(wǎng)絡(luò)論壇)論壇提出的甚短距離光互連協(xié)議,主要面向主干網(wǎng),其延遲、功耗、兼容性等都不能滿足板間、芯片間光互連的需要,因此,研究定制一種適用于板級、芯片級的光互連協(xié)議具有非常重要的研究意義。 本論文將協(xié)議功能分為數(shù)據(jù)鏈路層和物理層來設(shè)計,鏈路層功能包括了協(xié)議原語設(shè)計,數(shù)據(jù)幀格式和數(shù)據(jù)傳輸流程設(shè)計,流量控制機制設(shè)計,協(xié)議通道初始化設(shè)計,錯誤檢測機制設(shè)計和空閑字符產(chǎn)生、時鐘補償方式設(shè)計;物理層功能包含了數(shù)據(jù)的串化和解串功能,多通道情況下的綁定功能,數(shù)據(jù)編解碼功能等。 然后,文章采用FPGA(Field Programmable Gate Array,現(xiàn)場可編程門陣列)技術(shù)實現(xiàn)了定制協(xié)議的單通道模式。重點是數(shù)據(jù)鏈路層的實現(xiàn),物理層采用定制具備其功能的IP(Intellectual Property,知識產(chǎn)權(quán))——RocketIO來實現(xiàn)。實現(xiàn)的過程中,采用了Xilinx公司的ISE(Integrated System Environment,集成開發(fā)環(huán)境)開發(fā)流程,使用的設(shè)計工具包括:ISE,ModelSim,Synplify Pro,ChipScope等。 最后,本文對實現(xiàn)的協(xié)議進(jìn)行了軟件仿真和上扳測試,訪真和測試結(jié)果表明,實現(xiàn)的單通道模式,支持的最高串行頻率達(dá)到3.5GHz,完全滿足了光互連驗證系統(tǒng)初期的要求,同時由RocketIO的高速串行差分口得到的眼圖質(zhì)量良好,表明對物理層IP的定制是成功的。

    標(biāo)簽: FPGA 板級 光互連 協(xié)議研究

    上傳時間: 2013-06-28

    上傳用戶:guh000

  • 基于JTAG口的ARM編程器研究與開發(fā)

    ARM微處理器的應(yīng)用已經(jīng)遍及工業(yè)控制、消費類電子產(chǎn)品、通信系統(tǒng)、網(wǎng)絡(luò)系統(tǒng)、無線系統(tǒng)等各類產(chǎn)品市場,占領(lǐng)了32位RISC微處理器75%以上的市場份額。 本文設(shè)計的基于JTAG接口的ARM編程器,以ARM微處理器作為CPU,利用其JTAG接口對Flash在線編程的技術(shù),給以ARM為內(nèi)核的應(yīng)用板(數(shù)控系統(tǒng)硬件平臺)進(jìn)行快速軟件升級。在分析相關(guān)技術(shù)的基礎(chǔ)上,給出了系統(tǒng)的總體設(shè)計方案,設(shè)計了系統(tǒng)的硬件和軟件。 首先詳細(xì)分析了JTAG技術(shù)、USB技術(shù)和Modem通信原理。編程器以USB口和RS-232口作為通信接口,以JTAG接口作為調(diào)試接口和編程接口。 其次,在分析編程器需求的基礎(chǔ)上,給出了系統(tǒng)的總體設(shè)計方案,選擇了主要的部件。系統(tǒng)硬件的核心部件采用了Philips LPC2144ARM芯片,擴展了JTAG接口、USB接口、Modem接口,同時又構(gòu)造出了一個JTAG接口。該芯片具有SPI總線,采用與SPI兼容的外部Flash作為存儲器。編程器軟件在ADS集成開發(fā)環(huán)境下開發(fā)調(diào)試。 最后,對編程器技術(shù)實現(xiàn)上的不足作了分析和編程器設(shè)計的不完善之處作了總結(jié),并對編程器的發(fā)展趨勢作了探討和展望。

    標(biāo)簽: JTAG ARM 編程器

    上傳時間: 2013-06-16

    上傳用戶:mylinden

  • ARM體系的嵌入式工控一體機

    隨著嵌入式控制在工業(yè)領(lǐng)域的不斷滲入,進(jìn)入21世紀(jì)之后,基于ARM體系Linux操作系統(tǒng)的嵌入式一體化工業(yè)控制系統(tǒng)成為了工業(yè)控制的主要發(fā)展方向,ARM芯片不僅體積小,功耗低,而且功能強;Linux由于其開源,穩(wěn)定以及成本低的優(yōu)點,在嵌入式系統(tǒng)中得到了廣泛的應(yīng)用。 本文研究的主要內(nèi)容是基于Linux操作系統(tǒng)ARM體系的嵌入式工控一體機設(shè)計與實現(xiàn)。該嵌入式工控一體機是基于Motorola公司研發(fā)的ARM9嵌入式系統(tǒng)和Linux操作系統(tǒng)的設(shè)備,整個系統(tǒng)體積小,結(jié)構(gòu)精簡,并有很高的執(zhí)行效率。它根據(jù)特定的工業(yè)控制對象定制特定的模型與控制算法。另外,該設(shè)備自身還具備各種數(shù)字PID控制算法,實現(xiàn)PID閉環(huán)控制。可以應(yīng)用于工業(yè)控制領(lǐng)域中的各類被控設(shè)備,以及為高校自動化控制實驗和工業(yè)應(yīng)用研究提供解決方案。它的軟件編程由Qt集成開發(fā)環(huán)境實現(xiàn),Qt是基于C++的針對構(gòu)造圖形用戶界面(程序)所使用的GUI工具包,它速度塊,易于使用,并具有很好的可移植性。 本文首先對嵌入式系統(tǒng)進(jìn)行選型,然后提出了系統(tǒng)的軟硬件整體架構(gòu)和系統(tǒng)的啟動流程。接著介紹了系統(tǒng)開發(fā)環(huán)境的搭建,包括啟動加載器的設(shè)計和實現(xiàn),Linux內(nèi)核的移植,設(shè)備驅(qū)動程序的編寫以及圖形用戶界面的實現(xiàn)。最后,詳細(xì)介紹了一個具有創(chuàng)新性的案例作為該嵌入式Linux工控一體機作為通訊和控制終端的典型應(yīng)用。 該嵌入式Linux工控一體機具有極好的實用性和應(yīng)用前景,并且其設(shè)計和實現(xiàn)過程對于其它嵌入式平臺也具有很好的參考價值。

    標(biāo)簽: ARM 嵌入式 工控

    上傳時間: 2013-07-27

    上傳用戶:zhaiyanzhong

  • Altera FPGA芯片的封裝尺寸選擇指南

    Altera FPGA芯片的封裝尺寸選擇指南

    標(biāo)簽: Altera FPGA 芯片 封裝尺寸

    上傳時間: 2013-06-04

    上傳用戶:edisonfather

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