為了對(duì)中頻PCM信號(hào)進(jìn)行直接解調(diào)，提出一種全新的數(shù)字化PCM中頻解調(diào)器的設(shè)計(jì)方法。在實(shí)現(xiàn)過(guò)程中，采用大規(guī)模的FPGA芯片對(duì)位幀同步器進(jìn)行了融合，便于設(shè)備的集成化和小型化。這種新型的中頻解調(diào)器比傳統(tǒng)的基帶解調(diào)器具有硬件成本低和誤碼率低等優(yōu)點(diǎn)。
標(biāo)簽： FPGA PCM 數(shù)字化 中頻
上傳時(shí)間： 2013-12-20
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設(shè)計(jì)了水聲信號(hào)發(fā)生系統(tǒng)中的功率放大電路，可將前級(jí)電路產(chǎn)生的方波信號(hào)轉(zhuǎn)換為正弦信號(hào)，同時(shí)進(jìn)行濾波、功率放大，使其滿足換能器對(duì)輸入信號(hào)的要求。該電路以單片機(jī)AT89C52，集成6階巴特沃思低通濾波芯片MF6以及大功率運(yùn)算放大器LM12為核心，通過(guò)標(biāo)準(zhǔn)RS232接口與PC進(jìn)行通信，實(shí)現(xiàn)信號(hào)增益的程控調(diào)節(jié)，對(duì)干擾信號(hào)具有良好的抑制作用。經(jīng)調(diào)試該電路工作穩(wěn)定正常，輸出波形無(wú)失真，在輸出功率以及放大增益、波紋系數(shù)等方面均滿足設(shè)計(jì)要求。 This paper presented a design and implementation of underwater acoustic power amplifer. This circuit converted the rectangle signal generated by frontend circuit into the sine signal， then filtered and power amplification， it meets the requirements of the transducer.Included AT89C52， 6th order Butterworth filter MF6， hipower amplififier LM12.Communication with PC through the RS232 port. The signal gain is adjustable and could be remote controlled. It has a good inhibitory effect on the interference signal. After debugged， this circuit works stable， the output waveform has no distortion， it meets the design requirement in outprt power， amplifier gain and ripple factor.
上傳時(shí)間： 2013-11-20
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集成運(yùn)算放大器是一種高倍率的直流放大器。當(dāng)選取不同的反饋電路時(shí)，它就可以對(duì)信號(hào)進(jìn)行放大以及加，減微分，積分等運(yùn)算。
標(biāo)簽： 集成運(yùn)算放大器 可靠性
上傳時(shí)間： 2013-10-25
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實(shí)驗(yàn)八 集成運(yùn)算放大器一、實(shí)驗(yàn)?zāi)康?．學(xué)習(xí)集成運(yùn)算放大器的使用方法。2．掌握集成運(yùn)算放大器的幾種基本運(yùn)算方法。二、預(yù)習(xí)內(nèi)容及要求集成運(yùn)算放大器是具有高開環(huán)放大倍數(shù)的多級(jí)直接耦合放大電路。在它外部接上負(fù)反饋支路和一定的外圍元件便可組成不同運(yùn)算形式的電路。本實(shí)驗(yàn)只對(duì)反相比例、同相比例、反相加法和積分運(yùn)算進(jìn)行應(yīng)用研究。1．圖1是反相比例運(yùn)算原理圖。反相比例運(yùn)算輸出電壓 和輸入電壓 的關(guān)系為：
標(biāo)簽： 集成運(yùn)算放大器
上傳時(shí)間： 2013-11-10
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上傳一分自己用得順心的AD10集成庫(kù)
標(biāo)簽： project Library AD 10
上傳時(shí)間： 2013-11-15
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ORCAD基本問(wèn)題的集成束
上傳時(shí)間： 2013-11-17
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最全的芯片封裝方式(圖文對(duì)照)
上傳時(shí)間： 2013-11-21
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EDA （Electronic Design Automation）即“電子設(shè)計(jì)自動(dòng)化”，是指以計(jì)算機(jī)為工作平臺(tái)，以EDA軟件為開發(fā)環(huán)境，以硬件描述語(yǔ)言為設(shè)計(jì)語(yǔ)言，以可編程器件PLD為實(shí)驗(yàn)載體(包括CPLD、FPGA、EPLD等)，以集成電路芯片為目標(biāo)器件的電子產(chǎn)品自動(dòng)化設(shè)計(jì)過(guò)程。“工欲善其事，必先利其器”，因此，EDA工具在電子系統(tǒng)設(shè)計(jì)中所占的份量越來(lái)越高。下面就介紹一些目前較為流行的EDA工具軟件。 PLD 及IC設(shè)計(jì)開發(fā)領(lǐng)域的EDA工具，一般至少要包含仿真器（Simulator）、綜合器（Synthesizer）和配置器（Place and Routing, P&R）等幾個(gè)特殊的軟件包中的一個(gè)或多個(gè)，因此這一領(lǐng)域的EDA工具就不包括Protel、PSpice、Ewb等原理圖和PCB板設(shè)計(jì)及電路仿真軟件。目前流行的EDA工具軟件有兩種分類方法：一種是按公司類別進(jìn)行分類，另一種是按功能進(jìn)行劃分。 若按公司類別分，大體可分兩類：一類是EDA 專業(yè)軟件公司，業(yè)內(nèi)最著名的三家公司是Cadence、Synopsys和Mentor Graphics；另一類是PLD器件廠商為了銷售其產(chǎn)品而開發(fā)的EDA工具，較著名的公司有Altera、Xilinx、lattice等。前者獨(dú)立于半導(dǎo)體器件廠商，具有良好的標(biāo)準(zhǔn)化和兼容性，適合于學(xué)術(shù)研究單位使用，但系統(tǒng)復(fù)雜、難于掌握且價(jià)格昂貴；后者能針對(duì)自己器件的工藝特點(diǎn)作出優(yōu)化設(shè)計(jì)，提高資源利用率，降低功耗，改善性能，比較適合產(chǎn)品開發(fā)單位使用。 若按功能分，大體可以分為以下三類。 (1) 集成的PLD/FPGA開發(fā)環(huán)境 由半導(dǎo)體公司提供，基本上可以完成從設(shè)計(jì)輸入（原理圖或HDL）→仿真→綜合→布線→下載到器件等囊括所有PLD開發(fā)流程的所有工作。如Altera公司的MaxplusⅡ、QuartusⅡ，Xilinx公司的ISE，Lattice公司的 ispDesignExpert等。其優(yōu)勢(shì)是功能全集成化，可以加快動(dòng)態(tài)調(diào)試，縮短開發(fā)周期；缺點(diǎn)是在綜合和仿真環(huán)節(jié)與專業(yè)的軟件相比，都不是非常優(yōu)秀的。 (2) 綜合類 這類軟件的功能是對(duì)設(shè)計(jì)輸入進(jìn)行邏輯分析、綜合和優(yōu)化，將硬件描述語(yǔ)句（通常是系統(tǒng)級(jí)的行為描述語(yǔ)句）翻譯成最基本的與或非門的連接關(guān)系（網(wǎng)表），導(dǎo)出給PLD/FPGA廠家的軟件進(jìn)行布局和布線。為了優(yōu)化結(jié)果，在進(jìn)行較復(fù)雜的設(shè)計(jì)時(shí)，基本上都使用這些專業(yè)的邏輯綜合軟件，而不采用廠家提供的集成PLD/FPGA開發(fā)工具。如Synplicity公司的Synplify、Synopsys公司的FPGAexpress、FPGA Compiler Ⅱ等。 (3) 仿真類 這類軟件的功能是對(duì)設(shè)計(jì)進(jìn)行模擬仿真，包括布局布線（P&R）前的“功能仿真”（也叫“前仿真”）和P&R后的包含了門延時(shí)、線延時(shí)等的“時(shí)序仿真”（也叫“后仿真”）。復(fù)雜一些的設(shè)計(jì)，一般需要使用這些專業(yè)的仿真軟件。因?yàn)橥瑯拥脑O(shè)計(jì)輸入，專業(yè)軟件的仿真速度比集成環(huán)境的速度快得多。此類軟件最著名的要算Model Technology公司的Modelsim，Cadence公司的NC-Verilog/NC-VHDL/NC-SIM等。 以上介紹了一些具代表性的EDA 工具軟件。它們?cè)谛阅苌细饔兴L(zhǎng)，有的綜合優(yōu)化能力突出，有的仿真模擬功能強(qiáng)，好在多數(shù)工具能相互兼容，具有互操作性。比如Altera公司的 QuartusII集成開發(fā)工具，就支持多種第三方的EDA軟件，用戶可以在QuartusII軟件中通過(guò)設(shè)置直接調(diào)用Modelsim和 Synplify進(jìn)行仿真和綜合。 如果設(shè)計(jì)的硬件系統(tǒng)不是很大，對(duì)綜合和仿真的要求不是很高，那么可以在一個(gè)集成的開發(fā)環(huán)境中完成整個(gè)設(shè)計(jì)流程。如果要進(jìn)行復(fù)雜系統(tǒng)的設(shè)計(jì)，則常規(guī)的方法是多種EDA工具協(xié)調(diào)工作，集各家之所長(zhǎng)來(lái)完成設(shè)計(jì)流程。
上傳時(shí)間： 2013-11-19
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集成元件庫(kù)的創(chuàng)建
上傳時(shí)間： 2013-11-05
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altium_designer_集成庫(kù)制作
標(biāo)簽： altium_designer 集成庫(kù)
上傳時(shí)間： 2013-10-14
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