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菜單設(shè)計

  • 使用簡易閂鎖電路保護電源

    設(shè)計時需要過一款簡單、低成本的閂鎖電路 (latch circuit) ?圖一顯示的就是這樣一款電路,基本上是一個可控矽整流器(SCR),結(jié)合了一些離散組件,只需低成本的元件便可以提供電源故障保護。

    標(biāo)簽: 閂鎖電路 保護電源

    上傳時間: 2013-11-11

    上傳用戶:zq70996813

  • 比較PSoC與MCU在數(shù)位電視設(shè)計中的應(yīng)用

    本文將探討微控制器與 PSoC (可編程系統(tǒng)單晶片)在數(shù)位電視應(yīng)用上的設(shè)計挑戰(zhàn),並比較微控制器和 PSoC 架構(gòu)在處理這些挑戰(zhàn)時的不同處,以有效地建置執(zhí)行。

    標(biāo)簽: PSoC MCU 比較 數(shù)位電視

    上傳時間: 2013-11-22

    上傳用戶:gengxiaochao

  • pcb layout design(臺灣硬件工程師15年經(jīng)驗

    PCB LAYOUT 術(shù)語解釋(TERMS)1. COMPONENT SIDE(零件面、正面)︰大多數(shù)零件放置之面。2. SOLDER SIDE(焊錫面、反面)。3. SOLDER MASK(止焊膜面)︰通常指Solder Mask Open 之意。4. TOP PAD︰在零件面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。5. BOTTOM PAD:在銲錫面上所設(shè)計之零件腳PAD,不管是否鑽孔、電鍍。6. POSITIVE LAYER:單、雙層板之各層線路;多層板之上、下兩層線路及內(nèi)層走線皆屬之。7. NEGATIVE LAYER:通常指多層板之電源層。8. INNER PAD:多層板之POSITIVE LAYER 內(nèi)層PAD。9. ANTI-PAD:多層板之NEGATIVE LAYER 上所使用之絕緣範(fàn)圍,不與零件腳相接。10. THERMAL PAD:多層板內(nèi)NEGATIVE LAYER 上必須零件腳時所使用之PAD,一般稱為散熱孔或?qū)住?1. PAD (銲墊):除了SMD PAD 外,其他PAD 之TOP PAD、BOTTOM PAD 及INNER PAD 之形狀大小皆應(yīng)相同。12. Moat : 不同信號的 Power& GND plane 之間的分隔線13. Grid : 佈線時的走線格點2. Test Point : ATE 測試點供工廠ICT 測試治具使用ICT 測試點 LAYOUT 注意事項:PCB 的每條TRACE 都要有一個作為測試用之TEST PAD(測試點),其原則如下:1. 一般測試點大小均為30-35mil,元件分布較密時,測試點最小可至30mil.測試點與元件PAD 的距離最小為40mil。2. 測試點與測試點間的間距最小為50-75mil,一般使用75mil。密度高時可使用50mil,3. 測試點必須均勻分佈於PCB 上,避免測試時造成板面受力不均。4. 多層板必須透過貫穿孔(VIA)將測試點留於錫爐著錫面上(Solder Side)。5. 測試點必需放至於Bottom Layer6. 輸出test point report(.asc 檔案powerpcb v3.5)供廠商分析可測率7. 測試點設(shè)置處:Setup􀃆pads􀃆stacks

    標(biāo)簽: layout design pcb 硬件工程師

    上傳時間: 2013-11-17

    上傳用戶:cjf0304

  • 說明 除了自身之外

    說明 除了自身之外,無法被其它整數(shù)整除的數(shù)稱之為質(zhì)數(shù),要求質(zhì)數(shù)很簡單,但如何快速的求出質(zhì)數(shù)則一直是程式設(shè)計人員與數(shù)學(xué)家努力的課題,在這邊介紹一個著名的 Eratosthenes求質(zhì)數(shù)方法 解。 以背包問題為例,我們使用兩個陣列value與item,value表示目前的最佳解所得之總價,item表示最後一個放至背包的水果,假設(shè)有負重量 1~8的背包8個,並對每個背包求其最佳解。

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    上傳時間: 2013-12-22

    上傳用戶:二驅(qū)蚊器

  • linux下的BBS

    linux下的BBS,使用BBS CACHE,使得mem消耗很低。 天火系統(tǒng)的特點: 1. 統(tǒng)一物件型態(tài)設(shè)計,讓各種東西都可以在我的最愛出現(xiàn)。 2. 統(tǒng)一各狀態(tài)間的功能鍵。( 程式執(zhí)行過程只 "程式狀態(tài)" "物件型態(tài)" 來判定動作 )。 3. 內(nèi)建各種系統(tǒng)(POP3/SMTP/NNTP/..),未來只需要執(zhí)行單一程式,就會擁有各種功能。 4. 每個人都可以簡單設(shè)定個人板。 5. 未來任兩個 BBS 間都可以透過帳號作某一種程度的同步(Sync)。 6. 使用 pthread 設(shè)計,並且儘量遵守 POSIX ,達到簡單移植到任何系統(tǒng)的目的。 7. 速度快 不使用 signal/shm/sem ,每個 client 上來只吃 50k 不到的記憶體。 8. 朝無站長系統(tǒng)目標(biāo)設(shè)計。

    標(biāo)簽: linux BBS

    上傳時間: 2014-01-24

    上傳用戶:515414293

  • 一篇來自臺灣中華大學(xué)的論文--《無線射頻系統(tǒng)標(biāo)簽晶片設(shè)計》

    一篇來自臺灣中華大學(xué)的論文--《無線射頻系統(tǒng)標(biāo)簽晶片設(shè)計》,彩色版。其摘要為:本論文討論使用於無線射頻辨識系統(tǒng)(RFID)之標(biāo)籤晶片系統(tǒng)的電路設(shè)計和晶片製作,初步設(shè)計標(biāo)籤晶片的基本功能,設(shè)計流程包含數(shù)位軟體及功能的模擬、基本邏輯閘及類比電路的設(shè)計與晶片電路的佈局考量。 論文的第一部份是序論、射頻辨識系統(tǒng)的規(guī)劃、辨識系統(tǒng)的規(guī)格介紹及制定,而第二部份是標(biāo)籤晶片設(shè)計、晶片量測、結(jié)論。 電路的初步設(shè)計功能為:使用電容作頻率緩衝的Schmitt trigger Clock、CRC-16的錯誤偵測編碼、Manchester編碼及使用單一電路做到整流、振盪及調(diào)變的功能,最後完成晶片的實作。

    標(biāo)簽: 大學(xué) 論文 無線射頻

    上傳時間: 2016-08-27

    上傳用戶:tb_6877751

  • 在 Java EE 的藍圖中

    在 Java EE 的藍圖中,JSP Servlet是屬於Web層技術(shù),JSP與Servlet是一體的兩面,您可以使用單獨一項技術(shù)來解決動態(tài)網(wǎng)頁呈現(xiàn)的需求,但最好的方式是取兩者的長處,JSP是網(wǎng)頁設(shè)計人員導(dǎo)向的,而Servlet是程式設(shè)計人員導(dǎo)向的,釐清它們之間的職責(zé)可以讓兩個不同專長的團隊彼此合作,並降低相互間的牽制作用。

    標(biāo)簽: Java EE

    上傳時間: 2016-11-15

    上傳用戶:sxdtlqqjl

  • lunwen1.rar

    臺灣成功大學(xué)的關(guān)于無人機自動駕駛控制的論文集(1) 這包共4篇,分別為: 無人飛機速度控制器設(shè)計與實現(xiàn) 無人飛行船自主性控制設(shè)計與實現(xiàn) 無人飛行載具導(dǎo)引飛控整合自動駕駛儀參數(shù)選取之研究 無人飛行載具導(dǎo)引飛控之軟體與硬體模擬

    標(biāo)簽: lunwen

    上傳時間: 2013-08-03

    上傳用戶:luominghua

  • 開關(guān)電源基本原理介紹

    開關(guān)電源基本原理與設(shè)計介紹,臺達的資料,很好的

    標(biāo)簽: 開關(guān) 電源基本

    上傳時間: 2013-04-24

    上傳用戶:cursor

  • _Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)

    _Wiley_Synthesis_of_Arithmetic_Circuits_-_FPGA_ASIC_and_Embedded_Systems_(2006)_-_DDU一些硬體設(shè)計教學(xué)文件

    標(biāo)簽: Wiley_Synthesis_of_Arithmetic_Cir FPGA_ASIC_and_Embedded_Systems cuits 2006

    上傳時間: 2013-08-20

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