晶體管電路設計，l鈴木雅臣著 周南生譯 張文敏校
標簽： 晶體管 電路設計
上傳時間： 2018-04-23
上傳用戶：luthais
設停車場內只有一個可停放n輛汽車的狹長通道，且只有一個大門可供汽車進出。汽車在停車場內按車輛到達時間的先后順序，依次由北向南排列（大門在最南端，最先到達的第一輛車停放在車場的最北端）；若車場內已停滿n輛汽車，則后來的汽車只能在門外的便道上依次等候，一旦有車開走，則排在便道上的第一輛車即可開入；當停車場內某輛車要離開時，在它之后開入的車輛必須先退出車場為它讓路，待該輛車開出大門外，其它車輛再按原次序進入車場；每輛停放在車場的車在它離開停車場時必須按它停留的時間長短交納費用。試為停車場編制按上述要求進行管理的模擬程序。
標簽： 管理系統
上傳時間： 2018-07-02
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2018界南京郵電大學研究生英語課程課堂翻譯練習
標簽： 研究生 英語
上傳時間： 2018-11-10
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計算機應用基礎 課件 周南岳 第三版
標簽： 計算機應用
上傳時間： 2020-03-01
上傳用戶：zhangyougen
自動停車場由一個可停放 n 輛車的狹長通道構成，且只有一個入口可供汽車進出。在 停車場內，汽車按到達的先后次序，由北向南依次排列（假設入口在最南端）。若停車場 內已停滿 n 輛車，則后來的汽車需在入口外的臨時等候便道上等候，當有車要離開時，臨 時等候便道上的第一輛車即可進入。當自動停車場內某輛車要離開時，必須先將在它之后 進入的車輛移出為其讓路，待該輛車離開后，其他車輛再按原次序移入自動停車場。每輛 車離開自動停車場時，應按其停留時間的長短交費（在臨時等候便道上停留的時間不收 費）。
標簽： 停車場 模擬
上傳時間： 2020-04-28
上傳用戶：oneday
FEMA教材，需要學習潛在失效模式分析的人員可以參考
標簽： FMEA 手冊
上傳時間： 2020-12-21
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設計高速電路必須考慮高速訊 號所引發的電磁干擾、阻抗匹配及串音等效應，所以訊號完整性 (signal integrity)將是考量設計電路優劣的一項重要指標，電路日異複雜必須仰賴可 靠的軟體來幫忙分析這些複雜的效應，才比較可能獲得高品質且可靠的設計， 因此熟悉軟體的使用也將是重要的研究項目之一。另外了解高速訊號所引發之 各種效應(反射、振鈴、干擾、地彈及串音等)及其克服方法也是研究高速電路 設計的重點之一。目前高速示波器的功能越來越多，使用上很複雜，必須事先 進修學習，否則無法全盤了解儀器之功能，因而無法有效發揮儀器的量測功能。 其次就是高速訊號量測與介面的一些測試規範也必須熟悉，像眼圖分析，探針 效應，抖動(jitter)測量規範及高速串列介面量測規範等實務技術，必須充分 了解研究學習，進而才可設計出優良之教學教材及教具。
標簽： 高速電路
上傳時間： 2021-11-02
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電化學測試以及基礎原理，曹楚南做，電化學領域必備讀物，電化學測試必備手冊
標簽： 電化學
上傳時間： 2021-12-22
對南京醫科大學流行病與統計學考研專業有興趣的同學朋友們快來看啦
標簽： 流行病 統計學
上傳時間： 2022-02-04
上傳用戶：XuVshu
主要內容介紹 Allegro 如何載入 Netlist，進而認識新式轉法和舊式轉法有何不同及優缺點的分析，透過本章學習可以對 Allegro 和 Capture 之間的互動關係，同時也能體驗出 Allegro 和 Capture 同步變更屬性等強大功能。Netlist 是連接線路圖和 Allegro Layout 圖檔的橋樑。在這裏所介紹的 Netlist 資料的轉入動作只是針對由 Capture（線路圖部分）產生的 Netlist 轉入 Allegro（Layout部分）1． 在 OrCAD Capture 中設計好線路圖。2． 然後由 OrCAD Capture 產生 Netlist（annotate 是在進行線路圖根據第五步產生的資料進行編改）。 3． 把產生的 Netlist 轉入 Allegro（layout 工作系統）。 4． 在 Allegro 中進行 PCB 的 layout。 5． 把在 Allegro 中產生的 back annotate（Logic）轉出（在實際 layout 時可能對原有的 Netlist 有改動過），並轉入 OrCAD Capture 裏進行回編。
標簽： cadence allegro
上傳時間： 2022-04-28
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