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血氧飽和度

不平衡系統中STATCOM的控制方法和主電路研究.rar

三相電壓不平衡度是衡量電網電能質量的一個重要指標。在三相系統中，引起電壓不平衡的主要原因是發電機的輸出電壓不平衡和負載不平衡兩方面，電壓不平衡比較嚴重時，會給系統帶來諸多危害。近年來，STATCOM因其動態響應速度快，電流諧波含量小，裝置體積小等優點，在電壓不平衡補償中的應用越來越廣。首先本文研究了基于IGCT的STATCOM主電路。為了獲得更高的輸出電壓，通常需要將IGCT串聯使用。然而在器件串聯使用時，由于其特性的差異會產生暫態電壓分配不均衡，導致個別器件上產生過電壓而威脅器件的安全，嚴重時會燒毀器件。因此需要采用均壓電路來保證串聯結構中電壓的平均分配。本文重點對IGCT串聯均壓電路和緩沖電路進行了設計，在分析串聯均壓電路的同時，計算了吸收電容和吸收電阻的取值范圍。而后，對緩沖電路進行了Pspice仿真，通過仿真驗證了均壓電路的工作效果。結果表明，吸收電容和吸收電阻的取值合適，能夠對IGCT的串聯運行起到很好的保護作用。本文還對100Kvar/660VSTATCOM的主電路進行了參數設計，對IGCT的型號和各主要元件進行了選擇。本文重點研究了不平衡系統中STATCOM的控制策略。建立了基于IGCT的STATCOM的數學模型；根據STATCOM的電流暫態模型，對電流電壓進行序分解，并做D—Q坐標變換，建立STATCOM在靜止坐標系下的正、負序數學模型。基于建立的負序模型，研究STATCOM在不平衡情況下的控制策略，本文采用無差拍控制方法；根據實際補償時遇到的問題：收斂速度慢、依賴固定的負載模型、魯棒性差等，對無差拍控制方法進行了優化設計。該優化方法在傳統無差拍的基礎上引入了參考電流觀測器和狀態觀測器；文中具體設計了這個改進無差拍控制器和其相關電路。經分析與仿真驗證了本文提出的優化控制方法，將該方法應用于STATCOM不平衡補償器，取得了良好的不平衡補償性能、快速的動態響應和良好的魯棒性。

標簽： STATCOM 不平衡

上傳時間： 2013-06-05

上傳用戶：abc123456.
基于DSP和ARM的雙核電能質量分析儀的研究.rar

隨著電力系統的迅速發展和電力電子技術的廣泛應用，電能污染日益嚴重，電能質量問題已經成為電力部門及電力用戶越來越關注的問題。電能質量的各項指標若偏離正常水平過大，會給發電、輸變電和用電設備帶來不同程度的危害。電能質量的好壞直接關系到國民經濟的總體效益，因此對電能質量進行檢測和分析從而提高和改善電能質量具有非常重要的意義。本文首先介紹了電能質量的基本概念，對各種電能質量問題的分類、特征及產生原因和危害作了詳細的闡述。通過對電能質量各項指標（供電電壓偏差、頻率偏差、公用電網諧波、三相電壓不平衡度、電壓波動與閃變）的分析，以傳統的傅立葉變換理論為基礎，針對目前電能質量分析的難點即對突變的、暫態的、非平穩的信號的檢測與分類，提出了基于快速傅立葉變換的暫態電能質量分析方法。在系統的研究了電能質量分析的相關理論和檢測技術的基礎上，針對電能質量分析系統中需要支持復雜算法和保持實時性的特殊要求，研制了基于DSP與ARM構架的嵌入式電能質量分析系統的硬件平臺和軟件系統。重點分析了DSP與ARM的選型依據、結構特點、具體應用等。并且詳細的介紹了硬件平臺的各部分組成和電路原理圖。隨后，提出了該裝置軟件部分設計思想，其中重點介紹了DSP部分的FFT算法設計、ARM部分的UC/OS-II操作系統移植和MiniGUI圖形界面開發。最后對論文的主要工作進行了總結，對以后可深入研究的方向進行了展望。關鍵詞：電能質量；傅立葉變換；快速傅立葉變換；UC/OS-Ⅱ；MiniGUI

標簽： DSP ARM 雙核

上傳時間： 2013-06-15

上傳用戶：songrui
基于LabVIEW和SOPC的智能型函數發生器的研究與設計.rar

函數發生器又名任意波形發生器，是一種常用的信號源，廣泛應用于通信、雷達、導航等現代電子技術領域。信號發生器的核心技術是頻率合成技術，主要方法有：直接模擬頻率合成、鎖相環頻率合成（PLL）、直接數字合成技術（DDS）。DDS是開環系統，無反饋環節，輸出響應速度快，頻率穩定度高。因此直接數字頻率合成技術是目前頻率合成的主要技術之一，其輸出信號具有相對較大的帶寬、快速的相位捷變、極高的相位分辨率和相位連續等優點。本文的主要工作是采用SOPC結合虛擬儀器技術，進行DDS智能函數發生器的研制。本文介紹了虛擬儀器技術的基本理論，簡要闡述了儀器驅動程序、VISA等相關技術。對SOPC技術進行了深入的研究：SOPC技術是基于可編程邏輯器件的可重構片上系統，它作為SOC和CPLD/FPGA相結合的一項綜合技術，結合了兩者的優點，集成了硬核或軟核CPU、DSP、鎖相環、存儲器、I/O接口及可編程邏輯，可以靈活高效地解決SOC方案，而且設計周期短，設計成本低，非常適合本設計的應用。本文還對基于DDS原理的設計方案進行了分析，介紹了DDS的基本理論以及數學綜合，在研究DDS原理的基礎上，利用SOPC技術，在一片FPGA芯片上實現了整個函數發生器的硬件集成。本文就函數發生器的設計制定了整體方案，對軟硬件設計原理及實現方法進行了具體的介紹，包括整個系統的硬件電路，SOPC片上系統和PC端軟件的設計。在設計中，LabVIEW波形編輯軟件和函數發生器二者采用異步串口進行通信。利用LabVIEW的強大功能，把波形的編輯，系統的設置放到計算機上完成，具有人機界面友好、系統升級方便、節約硬件成本等諸多優勢。同時充分利用了FPGA內部大量的邏輯資源，將DDS模塊和微處理器模塊集成到一個單片FPGA上，改變了傳統的系統設計思路。通過對系統仿真和實際測試，結果表明該智能型函數發生器不僅能產生理想的輸出信號，還具有集成度高、穩定性好和擴展性強等優點。關鍵詞：智能型函數發生器，虛擬儀器，可編程片上系統，直接數字合成技術，NiosⅡ處理器。

標簽： LabVIEW SOPC 智能型

上傳時間： 2013-07-09

上傳用戶：zw380105939
基于DSP和FPGA導航計算機硬件電路研究與設計.rar

為適應組合導航計算機系統的微型化、高性能度的要求，拓寬導航計算機的應用領域，本文設計出一種基于浮點型DSP(TMS320C6713)和可編程邏輯陣列器件(FPGA： EP1C12N240C8)協同合作的導航計算機系統。論文在闡述了組合導航計算機的特點和應用要求后，提出基于DSP和FPGA的組合導航計算機系統方案。該方案以DSP為導航解算處理器，由FPGA完成IMU信號的采集和緩存以及系統控制信號的整合；DSP通過EMIF接口實現和FPGA通信。在此基礎上研究了各擴展通信接口、系統硬件原理圖和PCB的開發，且在FPGA中使用調用IP核來實現FIR低通濾波數據處理機抖激光陀螺的機抖振動的影響。其次，詳細闡述了利用TI公司的DSP集成開發環境和DSP/BIOS準實時操作系統開發多任務系統軟件的具體方案。本文引入DSP/BIOS實時操作系統提供的多任務機制，將采集處理按照功能劃分四個相對獨立的任務，這些任務在DSP/BIOS的調度下，按照用戶指定的優先級運行，大大提高系統的工作效率。最后給了DSP芯片Bootloader的制作方法。導航計算機系統研制開發是軟、硬件研究緊密結合的過程。在微型導航計算機系統方案建立的基礎上，本文首先討論了系統硬件整體設計和軟件開發流程；其次針對導航計算機系統各個功能模塊以及多項關鍵技術進行了設計與開發工作，涉及系統數據通信模塊、模擬信號采集模塊和數據存儲模塊；最后，對導航計算機系統進行了聯合調試工作，并對各個模塊進行了詳細的功能測試與驗證，完成了微型導航計算機系統的制作。以DSP/FPGA作為導航計算機硬件平臺的捷聯式慣性導航實時數據系統能夠滿足系統所要求的高精度、實時性、穩定性要求，適應了其高性能、低成本、低功耗的發展方向。

標簽： FPGA DSP 導航計算機

上傳時間： 2013-04-24

上傳用戶：lishuoshi1996
基于線陣CCD和FPGA干涉型甲烷測量儀的研究.rar

近年來，瓦斯事故在煤礦生產事故中所占比例越來越高，給礦工的生產生活帶來了極大的災難，必須加強對瓦斯的監測監控，避免瓦斯爆炸事故。因此對瓦斯氣體進行快速、實時檢測對于煤礦安全生產及環境保護有特別重要的意義。便攜式甲烷檢測報警儀是各國應用最早最普遍的一種甲烷濃度檢測儀表，可隨時檢測作業場所的甲烷濃度，也可使用甲烷傳感器對甲烷濃度進行連續實時地監測。大體上當前應用的便攜式甲烷檢測儀器，按檢測原理分為光學甲烷檢測儀、熱導型甲烷檢測儀、熱催化型甲烷檢測報警儀、氣敏半導體式甲烷檢測儀等幾種。光干涉甲烷檢測儀性能穩定、使用壽命長，測量準確，是我國煤礦主要的便攜式甲烷檢測儀器。但現有的光干涉甲烷檢測儀存在自動化程度低、測量方法繁瑣、讀數不直觀，人為誤差較大、不能存儲數據等缺點。為此本文在干涉型甲烷檢測儀實現的原理上提出利用線陣型電荷耦合器件(CCD)對干涉條紋進行非接觸式的自動測量，獲得條紋信息，通過CCD驅動、高速模數轉換、數據采集等關鍵技術，實現了干涉條紋位移的精確測量，由單片機對量化后的測量信號進行智能處理，數字化顯示甲烷含量的測量結果。光干涉甲烷檢測的關鍵是對干涉條紋中白基線以及黑色條紋位置的檢測，本設計采用線陣CCD成像獲取條紋信息判別其位置。CCD是一種性能獨特的半導體光電器件，近年來在攝像、工業檢測等科技領域里得到了廣泛的應用。將CCD技術應用于位置測量可以實現高精度和非接觸測量的要求；運用FPGA實現CCD芯片的驅動具有速度快、穩定高等優點：模數轉換之后的數據沒有采用專用存儲芯片進行存儲，而采用FPGA硬件開發平臺和Verilog HDL硬件描述語言編寫代碼實現數據采集模塊系統，同時提高數據采集精準度，既降低成本又提高了存儲效率。本文設計的新系統使用方便、精度高、數據可儲存，克服了傳統光干涉甲烷檢測儀的缺點，技術指標和功能都得到較大改善。

標簽： FPGA CCD 線陣

上傳時間： 2013-06-08

上傳用戶：jogger_ding
基于DSP和FPGA的數字化開關電源的實用化研究.rar

文章開篇提出了開發背景。認為現在所廣泛應用的開關電源都是基于傳統的分立元件組成的。它的特點是頻率范圍窄、電力小、功能少、器件多、成本較高、精度低，對不同的客戶要求來“量身定做”不同的產品，同時幾乎沒有通用性和可移植性。在電子技術飛速發展的今天，這種傳統的模擬開關電源已經很難跟上時代的發展步伐。隨著DSP、ASIC等電子器件的小型化、高速化，開關電源的控制部分正在向數字化方向發展。由于數字化，使開關電源的控制部分的智能化、零件的共通化、電源的動作狀態的遠距離監測成為了可能，同時由于它的智能化、零件的共通化使得它能夠靈活地應對不同客戶的需求，這就降低了開發周期和成本。依靠現代數字化控制和數字信號處理新技術，數字化開關電源有著廣闊的發展空間。在數字化領域的今天，最后一個沒有數字化的堡壘就是電源領域。近年來，數字電源的研究勢頭與日俱增，成果也越來越多。雖然目前中國制造的開關電源占了世界市場的80％以上，但都是傳統的比較低端的模擬電源。高端市場上幾乎沒有我們份額。本論文研究的主要內容是在傳統開關電源模擬調節器的基礎上，提出了一種新的數字化調節器方案，即基于DSP和FPGA的數字化PID調節器。論文對系統方案和電路進行了較為具體的設計，并通過測試取得了預期結果。測試證明該方案能夠適合本行業時代發展的步伐，使系統電路更簡單，精度更高，通用性更強。同時該方案也可用于相關領域。本文首先分析了國內外開關電源發展的現狀，以及研究數字化開關電源的意義。然后提出了數字化開關電源的總體設計框圖和實現方案，并與傳統的開關電源做了較為詳細的比較。本論文的設計方案是采用DSP技術和FPGA技術來做數字化PID調節，通過數字化PID算法產生PWM波來控制斬波器，控制主回路。從而取代傳統的模擬PID調節器，使電路更簡單，精度更高，通用性更強。傳統的模擬開關電源是將電流電壓反饋信號做PID調節后--分立元器件構成，采用專用脈寬調制芯片實現PWM控制。電流反饋信號來自主回路的電流取樣，電壓反饋信號來自主回路的電壓采樣。再將這兩個信號分別送至電流調節器和電壓調節器的反相輸入端，用來實現閉環控制。同時用來保證系統的穩定性及實現系統的過流過壓保護、電流和電壓值的顯示。電壓、電流的給定信號則由單片機或電位器提供。再次，文章對各個模塊從理論和實際的上都做了仔細的分析和設計，并給出了具體的電路圖，同時寫出了軟件流程圖以及設計中應該注意的地方。整個系統由DSP板和ADC板組成。DSP板完成PWM生成、PID運算、環境開關量檢測、環境開關量生成以及本地控制。ADC板主要完成前饋電壓信號采集、負載電壓信號采集、負載電流信號采集、以及對信號的一階數字低通濾波。由于整個系統是閉環控制系統，要求采樣速率相當高。本系統采用FPGA來控制ADC，這樣就避免了高速采樣占用系統資源的問題，減輕了DSP的負擔。DSP可以將讀到的ADC信號做PID調節，從而產生PWM波來控制逆變橋的開關速率，從而達到閉環控制的目的。最后，對數字化開關電源和模擬開關電源做了對比測試，得出了預期結論。同時也提出了一些需要改進的地方，認為該方案在其他相關行業中可以廣泛地應用。模擬控制電路因為使用許多零件而需要很大空間，這些零件的參數值還會隨著使用時間、溫度和其它環境條件的改變而變動并對系統穩定性和響應能力造成負面影響。數字電源則剛好相反，同時數字控制還能讓硬件頻繁重復使用、加快上市時間以及減少開發成本與風險。在當前對產品要求體積小、智能化、共通化、精度高和穩定度好等前提條件下，數字化開關電源有著廣闊的發展空間。本系統來基本上達到了設計要求。能夠滿足較高精度的設計要求。但對于高精度數字化電源，系統還有值得改進的地方，比如改進主控器，提高參考電壓的精度，提高采樣器件的精度等，都可以提高系統的精度。本系統涉及電子、通信和測控等技術領域，將數字PID算法與電力電子技術、通信技術等有機地結合了起來。本系統的設計方案不僅可以用在電源控制器上，只要是相關的領域都可以采用。

標簽： FPGA DSP 數字化

上傳時間： 2013-06-29

上傳用戶：dreamboy36
基于FPGA的卷積編碼和維特比譯碼的研究與實現.rar

在數字通信中，采用差錯控制技術(糾錯碼)是提高信號傳輸可靠性的有效手段，并發揮著越來越重要的作用。糾錯碼主要有分組碼和卷積碼兩種。在碼率和編碼器復雜程度相同的情況下，卷積碼的性能優于分組碼。卷積碼的譯碼方法主要有代數譯碼和概率譯碼。代數譯碼是基于碼的代數結構；而概率譯碼不僅基于碼的代數結構，還利用了信道的統計特性，能充分發揮卷積碼的特點，使譯碼錯誤概率達到很小。卷積碼譯碼器的設計是由高性能的復雜譯碼器開始的，對于概率譯碼最初的序列譯碼，隨著譯碼約束長度的增加，其譯碼錯誤概率可達到非常小。后來慢慢地向低性能的簡單譯碼器演化，對不太長的約束長度，維特比(Viterbi)算法是非常實用的。維特比算法是一種最大似然的譯碼方法。當編碼約束度不太大(小于等于10)或者誤碼率要求不太高(約10-5)時，Viterbi譯碼算法效率很高，速度很快，譯碼器也較簡單。目前，卷積碼在數傳系統，尤其是在衛星通信、移動通信等領域已被廣泛應用。本論文對卷積碼編碼和Viterbi譯碼的設計原理及其FPGA實現方案進行了研究。同時，將交織和解交織技術應用于編碼和解碼的過程中。首先，簡要介紹了卷積碼的基礎知識和維特比譯碼算法的基本原理，并對硬判決譯碼和軟判決譯碼方法進行了比較。其次，討論了交織和解交織技術及其在糾錯碼中的應用。然后，介紹了FPGA硬件資源和軟件開發環境Quartus Ⅱ，包括數字系統的設計方法和設計規則。再有，對基于FPGA的維特比譯碼器各個模塊和相應算法實現、優化進行了研究。最后，在Quartus Ⅱ平臺上對硬判決譯碼和軟判決譯碼以及有無交織等不同情況進行了仿真，并根據仿真結果分析了維特比譯碼器的性能。分析結果表明，系統的誤碼率達到了設計要求，從而驗證了譯碼器設計的可靠性，所設計基于FPGA的并行Viterbi譯碼器適用于高速數據傳輸的場合。

標簽： FPGA 卷積編碼

上傳時間： 2013-04-24

上傳用戶：tedo811
基于USB和FPGA技術的高性能數據采集模塊的設計與實現

在合成孔徑雷達的研究和研制工作中，合成孔徑雷達模擬技術具有十分重要的作用。本文以440MHz帶寬線性調頻信號，采樣頻率500MHz高分辨合成孔徑雷達視頻模擬器為研究對象。首先對模擬器的幾項主要技術進行分析，在對點目標回波信號模型分析研究的基礎上，對點目標原始回波數據進行模擬并做了成像驗證，從而為硬件實現提供了正確的信號模型；針對傳統的“波形存儲直讀法”方案，即在計算機平臺上用模擬軟件產生原始回波數據并存儲，再通過計算機接口實現數據傳輸，最后完成數模轉換產生視頻信號這一過程，分析指出該方案在實現高分辨率時的速度和容量瓶頸。　　針對具體的設計要求，圍繞速度和容量問題，本文著眼于高分辨率SAR模擬器的FPGA實現研究，指出FPGA實時生成點目標原始回波數據是其實現的核心；針對這一核心問題，充分利用現代VLSI設計中的流水線技術與并行陣列技術以及FPGA的優良性能和豐富資源，在時間上采用同步流水結構、空間上采用并行陣列形式，將速度和容量問題統一為數據的高速生成問題；給出了系統總體設計思想，該方案不需要大容量存儲器單元，大大減少模擬器復雜度；對原始回波數據實時生成模塊的各主要單元給出了結構并進行了仿真，結果表明FPGA可以滿足課題設計要求；同時，對該模擬器片上系統的實現、增強人機交互性，給出了人機界面的設計思路。　　分析指出了點目標原始回波數據實時生成模塊通過并行擴展即可實現多點目標的原始回波數據實時生成；最后對復雜場景目標模擬器的實現進行了構思，指出了傳統方案在改進的基礎上實現高分辨率視頻模擬器的可行性。本文首次提出以FPGA實現高分辨率合成孔徑雷達原始回波數據實時生成的思想，為國內業界在此方向做了一些理論和實踐上的有益探索，對于國內高分辨率合成孔徑雷達的研制具有一定的實際意義。

標簽： FPGA USB 性能數據采集模塊

上傳時間： 2013-05-26

上傳用戶：alia
基于ARM和WindowsCE的H264解碼器的研究及優化

隨著通信產業的發展，尤其是今年3G牌照的發放，視頻業務在移動多媒體方面將會有更加重要的地位，所以在移動終端上實現支持高效視頻編碼標準的解碼功能就成為一項非常有實際意義的工作。 H．264作為新一代的高壓縮率的視頻標準，憑借其較高的壓縮率和優秀圖像質量，使得H．264只要利用較小的空間就能存儲更多的視頻數據，在更低的網絡帶寬條件下提供更優質量的視頻。然而高度的壓縮必然付出較高的硬件代價。如何能完成視頻良好解碼并能節約硬件資源成為研究熱點。考慮到H．264視頻編解碼的計算復雜度，在硬件選擇上一般比較注重高性能處理器的選擇。計算目前主流的實現方式包括ASIC的專用集成芯片實現或者是DSP的軟件實現。ARM處理器伴隨技術的進步，尤其是對支持數字信號處理的功能加強后，在視頻編解碼領域的應用也越來越廣泛。本文以WindowsCE5．0和S3C2440A嵌入式平臺作為H．264解碼器的載體，研究的代碼版本是t264-src-0．14，主要進行了以下幾個方面的工作：研究了H．264視頻壓縮標準和它的體系結構，尤其是對解碼器部分進行了硬件要求的分析。深入研究了WINCE5．0和ARM結合的平臺特性，根據實際的硬件平臺需要，定制了相應的操作系統。完成了基于T264代碼的解碼庫在WINCE5．0下的移植，并進行了相應的代碼和算法的優化并完成了基于WINCE5．0操作系統下播放程序的編寫。通過實驗數據證明，在基于單核的ARM芯片中，主要靠軟件進行QCIF格式的H．264視頻解碼從而獲得良好播放效果的方法是有效的。

標簽： WindowsCE H264 ARM 解碼器

上傳時間： 2013-07-24

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基于DSP和ARM的雙核電能質量分析儀的研究

隨著電力系統的迅速發展和電力電子技術的廣泛應用，電能污染日益嚴重，電能質量問題已經成為電力部門及電力用戶越來越關注的問題。電能質量的各項指標若偏離正常水平過大，會給發電、輸變電和用電設備帶來不同程度的危害。電能質量的好壞直接關系到國民經濟的總體效益，因此對電能質量進行檢測和分析從而提高和改善電能質量具有非常重要的意義。本文首先介紹了電能質量的基本概念，對各種電能質量問題的分類、特征及產生原因和危害作了詳細的闡述。通過對電能質量各項指標（供電電壓偏差、頻率偏差、公用電網諧波、三相電壓不平衡度、電壓波動與閃變）的分析，以傳統的傅立葉變換理論為基礎，針對目前電能質量分析的難點即對突變的、暫態的、非平穩的信號的檢測與分類，提出了基于快速傅立葉變換的暫態電能質量分析方法。在系統的研究了電能質量分析的相關理論和檢測技術的基礎上，針對電能質量分析系統中需要支持復雜算法和保持實時性的特殊要求，研制了基于DSP與ARM構架的嵌入式電能質量分析系統的硬件平臺和軟件系統。重點分析了DSP與ARM的選型依據、結構特點、具體應用等。并且詳細的介紹了硬件平臺的各部分組成和電路原理圖。隨后，提出了該裝置軟件部分設計思想，其中重點介紹了DSP部分的FFT算法設計、ARM部分的UC/OS-II操作系統移植和MiniGUI圖形界面開發。最后對論文的主要工作進行了總結，對以后可深入研究的方向進行了展望。

標簽： DSP ARM 雙核分析儀

上傳時間： 2013-05-22

上傳用戶：hw1688888