一個(gè)不錯(cuò)的串口控制紅外接收發(fā)送的,C語言程序,工程項(xiàng)目中的一部分。大家可以學(xué)習(xí)和借鑒的。
上傳時(shí)間: 2017-09-24
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vc 關(guān)于串口的發(fā)送和接收文件的一個(gè)小程序,向連接串口上載文件,在接收端接收文件,
標(biāo)簽: vc 串口
上傳時(shí)間: 2015-03-27
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符合能量星標(biāo)準(zhǔn)的電源電路圖符合能量星標(biāo)準(zhǔn)的電源電路圖符合能量星標(biāo)準(zhǔn)的電源電路圖
標(biāo)簽: 電源電路
上傳時(shí)間: 2021-12-09
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基于藍(lán)牙接收模塊的TPA3110音頻功放板ALTIUM 設(shè)計(jì)硬件原理圖+PCB+封裝庫(kù)文件,采用TPA3110數(shù)字功放芯片,功率可達(dá)15W,兩種電源接口。藍(lán)牙部分使用bk8000L成品模塊,性能不錯(cuò),價(jià)格實(shí)惠。支持按鍵播放暫停,曲目切換,音量調(diào)整,同時(shí)還支持外部音頻線路輸入和麥克風(fēng)輸入。
標(biāo)簽: 藍(lán)牙接收模塊 tpa3110 音頻
上傳時(shí)間: 2022-01-25
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實(shí)現(xiàn)M=4,8 PSK星設(shè)圖 M=4的PSK系統(tǒng),分別取信噪比為odB、10dB和20dB,在星座圖上觀察接收端接收到的信號(hào)向量。
標(biāo)簽: PSK
上傳時(shí)間: 2014-01-05
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互聯(lián)網(wǎng)、移動(dòng)通信、星基導(dǎo)航是21世紀(jì)信息社會(huì)的三大支柱產(chǎn)業(yè),而GPS系統(tǒng)的技術(shù)水平和發(fā)展歷程代表著全世界衛(wèi)星導(dǎo)航系統(tǒng)的發(fā)展?fàn)顩r。目前,我國(guó)已經(jīng)成為GPS的使用大國(guó),衛(wèi)星導(dǎo)航產(chǎn)業(yè)鏈也已基本形成。然而,我們對(duì)GPS核心技術(shù)的研究還不夠深入,我國(guó)GPS產(chǎn)品的核心部分多數(shù)還是靠進(jìn)口。 GPS接收機(jī)工作時(shí),為了將本地信號(hào)和接收到的信號(hào)同步,要完成復(fù)雜的信號(hào)處理過程。其中,如何捕獲衛(wèi)星信號(hào)并保持對(duì)信號(hào)的跟蹤是最重要的核心技術(shù)。很多研究者提出了多種解決方法,但這些方法多數(shù)都只停留在理論階段,無法應(yīng)用于GPS接收機(jī)系統(tǒng)進(jìn)行實(shí)時(shí)處理。 本課題在分析了多種現(xiàn)有算法的基礎(chǔ)上,研究設(shè)計(jì)了基于FPGA的GPS信號(hào)捕獲與跟蹤系統(tǒng)。在研究過程中,首先利用Nemerix公司的GPS芯片組設(shè)計(jì)制作了GPS接收機(jī)模塊,它能正常穩(wěn)定地工作,并可用作GPS基帶信號(hào)處理的研究平臺(tái);該平臺(tái)可實(shí)時(shí)地輸出GPS數(shù)字中頻信號(hào);本課題在中頻信號(hào)的基礎(chǔ)上深入研究了GPS信號(hào)的捕獲與跟蹤技術(shù)。先詳細(xì)分析比較了幾種GPS信號(hào)捕獲方法,給出了步進(jìn)相關(guān)的捕獲方案;接著分析了跟蹤環(huán)路的特點(diǎn),給出了鎖頻環(huán)和鎖相環(huán)交替工作跟蹤載波以及載波輔助偽碼的跟蹤方案,并最終實(shí)現(xiàn)了這些方案。 本課題設(shè)計(jì)的GPS信號(hào)捕獲與跟蹤處理系統(tǒng)是通過硬件和軟件協(xié)同工作的方式實(shí)現(xiàn)的。硬件電路主要實(shí)現(xiàn)數(shù)據(jù)速率高、邏輯簡(jiǎn)單的相關(guān)器功能;而基于MicroBlaze軟處理器的軟件主要實(shí)現(xiàn)數(shù)據(jù)速率低、邏輯復(fù)雜的功能。本文給出了硬件電路的詳細(xì)設(shè)計(jì)、仿真結(jié)果以及軟件設(shè)計(jì)的詳細(xì)流程。 本課題最終在FPGA上實(shí)現(xiàn)了GPS信號(hào)的捕獲與跟蹤功能,而且系統(tǒng)的性能良好。由此可以得出結(jié)論:本設(shè)計(jì)能夠滿足系統(tǒng)功能和性能的要求,可以直接用于實(shí)時(shí)GPS接收機(jī)系統(tǒng)的設(shè)計(jì)中,為自主設(shè)計(jì)GPS接收機(jī)奠定了基礎(chǔ)。 本課題的研究得到了大連市信息產(chǎn)業(yè)局集成電路設(shè)計(jì)專項(xiàng)的資助,項(xiàng)目名稱是“定位與通信集成功能的SOC設(shè)計(jì)”,研究成果將在2008年上半年投入試用。
上傳時(shí)間: 2013-04-24
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隨著空間科學(xué)任務(wù)的增加,需要處理的空間科學(xué)數(shù)據(jù)量激增,要求建立一個(gè)高速的空間數(shù)據(jù)連接網(wǎng)絡(luò).高速?gòu)?fù)接器作為空間飛行器星上網(wǎng)絡(luò)的關(guān)鍵設(shè)備,其性能對(duì)整個(gè)空間數(shù)據(jù)網(wǎng)絡(luò)的性能起著重要影響.該文闡述了利用先入先出存儲(chǔ)器FIFO進(jìn)行異步速率調(diào)整,應(yīng)用VHDL語言和可編程門陣列FPGA技術(shù),對(duì)多個(gè)信號(hào)源數(shù)據(jù)進(jìn)行數(shù)據(jù)打包、信道選通調(diào)度和多路復(fù)接的方法.設(shè)計(jì)中,用VHDL語言對(duì)高速?gòu)?fù)接器進(jìn)行行為級(jí)建模,為了驗(yàn)證這個(gè)模型,首先使用軟件進(jìn)行仿真,通過編寫testbench程序模擬FIFO的動(dòng)作特點(diǎn),對(duì)程序輸入信號(hào)進(jìn)行仿真,在軟件邏輯仿真取得預(yù)期結(jié)果后,繼續(xù)設(shè)計(jì)硬件電路,設(shè)計(jì)出的實(shí)際電路實(shí)現(xiàn)了將來自兩個(gè)不同速率的信源數(shù)據(jù)(1394總線數(shù)據(jù)和1553B總線數(shù)據(jù))復(fù)接成一路符合CCSDS協(xié)議的位流業(yè)務(wù)數(shù)據(jù).在實(shí)驗(yàn)調(diào)試中對(duì)FPGA的輸出數(shù)據(jù)進(jìn)行檢驗(yàn),同時(shí)對(duì)設(shè)計(jì)方法進(jìn)行驗(yàn)證.驗(yàn)證結(jié)果完全符合設(shè)計(jì)目標(biāo).應(yīng)用硬件可編程邏輯芯片F(xiàn)PGA設(shè)計(jì)高速?gòu)?fù)接器,大幅度提高了數(shù)據(jù)的復(fù)接速率,可應(yīng)用于未來的星載高速數(shù)據(jù)系統(tǒng)中,能夠完成在軌系統(tǒng)的數(shù)據(jù)復(fù)接任務(wù).
上傳時(shí)間: 2013-07-17
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合成孔徑雷達(dá)的實(shí)時(shí)信號(hào)處理系統(tǒng),可以分成相對(duì)獨(dú)立的幾個(gè)階段,即A/D變換和緩存、距離向預(yù)處理器、方位向預(yù)處理器、距離向壓縮處理、轉(zhuǎn)置存儲(chǔ)器、方位向壓縮處理、逆轉(zhuǎn)置存儲(chǔ)器.合成孔徑雷達(dá)預(yù)處理的目的,就是緩解高處理數(shù)據(jù)率和低傳輸數(shù)據(jù)率的矛盾,使得在不太影響成像質(zhì)量的前提下,盡量減少傳輸?shù)臄?shù)據(jù)率,有利于后續(xù)處理的硬件實(shí)現(xiàn),做到實(shí)時(shí)處理.論文結(jié)合電子所合成孔徑雷達(dá)實(shí)時(shí)成像處理系統(tǒng),設(shè)計(jì)開發(fā)了基于Xilinx Virtex-E FPGA的星載SAR高速預(yù)處理板,該信號(hào)處理板處理能力強(qiáng),結(jié)構(gòu)緊湊,運(yùn)行效率高;其硬件電路的設(shè)計(jì)思路和結(jié)構(gòu)形式有很強(qiáng)的通用性和使用價(jià)值.論文重點(diǎn)研究了預(yù)處理的核心部分—固定系數(shù)FIR濾波器的設(shè)計(jì)問題.而固定系數(shù)FIR濾波器的實(shí)現(xiàn)問題的重點(diǎn)又是FPGA內(nèi)部的固定系數(shù)FIP濾波器實(shí)現(xiàn)問題,針對(duì)FPGA內(nèi)部的查找表資源,我們選擇目前流行的分布式算法來實(shí)現(xiàn)FIR濾波器的設(shè)計(jì).對(duì)比于預(yù)處理器中其他濾波器設(shè)計(jì)方案,基于FPGA分布式算法的FIR濾波器的設(shè)計(jì),避免了乘累加運(yùn)算,提高了系統(tǒng)運(yùn)行的速度并且節(jié)省了大量的FPGA資源.并且由于FPGA可編程的特性,所以可以靈活的改變?yōu)V波器的系數(shù)和階數(shù).所設(shè)計(jì)的電路簡(jiǎn)單高速,工作正常、可靠,完全滿足了預(yù)處理器設(shè)計(jì)的技術(shù)要求.隨著超大規(guī)模集成電路技術(shù),高密度存儲(chǔ)器技術(shù),計(jì)算機(jī)技術(shù)的發(fā)展,一個(gè)全數(shù)字化的機(jī)載實(shí)時(shí)成像處理系統(tǒng)的研制,已經(jīng)不是非常困難的事情了.而在現(xiàn)有條件下,全數(shù)字化的高分辨率星載實(shí)時(shí)成像處理系統(tǒng)的研制,將是一個(gè)非常具有挑戰(zhàn)意義的課題,論文以星載SAR的預(yù)處理器設(shè)計(jì)為例,拋磚引玉,希望對(duì)未來全數(shù)字化星載實(shí)時(shí)成像處理系統(tǒng)的研制起到一定參考價(jià)值.
上傳時(shí)間: 2013-07-03
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這篇論文以數(shù)字電視條件接收系統(tǒng)為研究對(duì)象,系統(tǒng)硬件設(shè)計(jì)以DSP和FPGA為實(shí)現(xiàn)平臺(tái),采用以DSP實(shí)現(xiàn)其加密算法、以FPGA實(shí)現(xiàn)其外圍電路,對(duì)數(shù)字電視條件接收系統(tǒng)進(jìn)行設(shè)計(jì)。首先根據(jù)數(shù)字電視條件接收系統(tǒng)的原理及其軟硬分離的發(fā)展趨勢(shì),提出采用 DSP+FPGA結(jié)構(gòu)的設(shè)計(jì)方式,將ECC與AES加密算法應(yīng)用于SK與CW的加密;根據(jù)其原理對(duì)系統(tǒng)進(jìn)行總體設(shè)計(jì),同時(shí)對(duì)系統(tǒng)各部分的硬件原理圖進(jìn)行詳細(xì)設(shè)計(jì),并進(jìn)行 PCB設(shè)計(jì)。其次采用從上而下的設(shè)計(jì)方式,對(duì)FPGA實(shí)現(xiàn)的邏輯功能劃分為各個(gè)功能模塊,然后再對(duì)各個(gè)模塊進(jìn)行設(shè)計(jì)、仿真。采用Quartus Ⅱ7.2軟件對(duì)FPGA實(shí)現(xiàn)的邏輯功能進(jìn)行設(shè)計(jì)、仿真。仿真結(jié)果表明:基于通用加擾算法(CSA)的加擾器模塊,滿足TS流加擾要求;塊加密模塊的最高時(shí)鐘頻率達(dá)到229.89MHz,流加密模塊的最高時(shí)鐘頻率達(dá)到331.27MHz,對(duì)于實(shí)際的碼流來說,具有比較大的時(shí)序裕量;DSP接口模塊滿足 ADSP BF-535的讀寫時(shí)序;包處理模塊實(shí)現(xiàn)對(duì)加密后數(shù)據(jù)的包處理。最后對(duì)條件接收系統(tǒng)中加密算法程序采用結(jié)構(gòu)化、模塊化的編程方式進(jìn)行設(shè)計(jì)。 ECC設(shè)計(jì)時(shí)采用C語言與匯編語言混合編程,充分利用兩種編程語言的優(yōu)勢(shì)。將ECC 與AES加密算法在VisualDSP++3.0開發(fā)環(huán)境下進(jìn)行驗(yàn)證,并下載至ADSP BF-535評(píng)估板上運(yùn)行。輸出結(jié)果表明:有限域運(yùn)算匯編語言編程的實(shí)現(xiàn)方式,其運(yùn)行速度明顯提高, 192位加法提高380個(gè)時(shí)鐘周期,32位乘法提高92個(gè)時(shí)鐘周期;ECC與AES達(dá)到加密要求。上述工作對(duì)數(shù)字電視條件接收系統(tǒng)的設(shè)計(jì)具有實(shí)際的應(yīng)用價(jià)值。關(guān)鍵詞:條件接收,DSP,F(xiàn)PGA,ECC,AEs
標(biāo)簽: DSPFPGA 數(shù)字電視 條件接收系統(tǒng)
上傳時(shí)間: 2013-07-03
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隨著數(shù)字電視機(jī)頂盒接收節(jié)目的增加,條件接收顯得越來越重要,但是在實(shí)際情況下,一個(gè)發(fā)射塔會(huì)供給許多區(qū)域接收節(jié)目,而具體的區(qū)域應(yīng)有具體的區(qū)域限制,智能卡也應(yīng)有區(qū)域性的選擇解擾。本文提出了一種在NIT表中添加描述子以確定具體區(qū)域,解擾該區(qū)域特定節(jié)目的方法,實(shí)際應(yīng)用證明,該方法操作簡(jiǎn)單,修改容易,實(shí)用性較強(qiáng)。
標(biāo)簽: 改進(jìn)型 條件接收 機(jī)頂盒
上傳時(shí)間: 2013-12-18
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