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計算機硬件

  • 華為-硬件工程師手冊.rar

    華為硬件工程師手冊 華為技術(shù)公司內(nèi)部資料 做硬件的同志學(xué)習(xí)一下

    標(biāo)簽: 華為 硬件工程師

    上傳時間: 2013-07-26

    上傳用戶:neu_liyan

  • 基于FPGA的圖像處理算法的研究與硬件設(shè)計.rar

    隨著微電子技術(shù)的高速發(fā)展,實時圖像處理在多媒體、圖像通信等領(lǐng)域有著越來越廣泛的應(yīng)用。FPGA就是硬件處理實時圖像數(shù)據(jù)的理想選擇,基于FPGA的圖像處理專用芯片的研究將成為信息產(chǎn)業(yè)的新熱點。 本文以FPGA為平臺,使用VHDL硬件描述語言設(shè)計并實現(xiàn)了中值濾波、順序濾波、數(shù)學(xué)形態(tài)學(xué)、卷積運算和高斯濾波等圖像處理算法。在設(shè)計過程中,通過改進算法和優(yōu)化結(jié)構(gòu),在合理地利用硬件資源的條件下,有效地挖掘出算法內(nèi)在的并行性,采用流水線結(jié)構(gòu)優(yōu)化算法,提高了頂層濾波模塊的處理速度。在中值濾波器的硬件設(shè)計中,本文提出了一種快速中值濾波算法,該算法大大節(jié)省了硬件資源,處理速度也很快。在數(shù)學(xué)形態(tài)學(xué)算法的硬件實現(xiàn)中,本文提出的最大值濾波和最小值濾波算法大大減少了硬件資源的占用率,適應(yīng)了流水線設(shè)計的要求,提高了圖像處理速度。 整個設(shè)計及各個模塊都在Altera公司的開發(fā)環(huán)境QuartusⅡ以及第三方仿真軟件Modelsim上進行了邏輯綜合以及仿真。綜合和仿真的結(jié)果表明,使用FPGA硬件處理圖像數(shù)據(jù)不僅能夠獲得很好的處理效果,達到較高的工作頻率,處理速度也遠遠高于軟件法處理圖像,可滿足實時圖像處理的要求。 本課題為圖像處理專用FPGA芯片的設(shè)計做了有益的探索性嘗試,對今后完成以FPGA圖像處理芯片為核心的實時圖像處理系統(tǒng)的設(shè)計有著積極的意義。

    標(biāo)簽: FPGA 圖像處理 法的研究

    上傳時間: 2013-06-08

    上傳用戶:shuiyuehen1987

  • 基于FPGA的磁盤陣列控制器的硬件設(shè)計與實現(xiàn).rar

    隨著存儲技術(shù)的迅速發(fā)展,存儲業(yè)務(wù)需求的不斷增長,獨立的磁盤冗余陣列可利用多個磁盤并行存取提高存儲系統(tǒng)的性能。磁盤陣列技術(shù)采用硬件和軟件兩種方式實現(xiàn),軟件RAID(Redundant Array of Independent Disks)主要利用操作系統(tǒng)提供的軟件實現(xiàn)磁盤冗余陣列功能,對系統(tǒng)資源利用率高,節(jié)省成本。硬件RAID將大部分RAID功能集成到一塊硬件控制器中,系統(tǒng)資源占用率低,可移植性好。 分析了軟件RAID的性能瓶頸,使用硬件直接完成部分計算提高軟件RAID性能。針對RAID5采用FPGA(Field Programmable Gate Array)技術(shù)實現(xiàn)RAID控制器硬件設(shè)計,完成磁盤陣列啟動、數(shù)據(jù)緩存(Cache)以及數(shù)據(jù)XOR校驗等功能。基于硬件RAID的理論,提出一種基于Virtex-4的硬件RAID控制器的系統(tǒng)設(shè)計方案:獨立微處理器和較大容量的內(nèi)存;實現(xiàn)RAID級別遷移,在線容量擴展,在線數(shù)據(jù)熱備份等高效、用戶可定制的高級RAID功能;利用Virtex-4內(nèi)置硬PowerPC完成RAID服務(wù)器部分配置和管理工作,運行Linux操作系統(tǒng)、RAID管理軟件等。控制器既可以作為RAID控制卡在服務(wù)器上使用,也可作為一個獨立的系統(tǒng),成為磁盤陣列的調(diào)試平臺。 隨著集成電路的發(fā)展,芯片的體積越來越小,電路的布局布線密度越來越大,信號的工作頻率也越來越高,高速電路的傳輸線效應(yīng)和信號完整性問題越來越明顯。RAID控制器屬于高速電路的范疇,在印刷電路板(Printed Circuit Block, PCB)實現(xiàn)時分別從疊層設(shè)計、布局、電源完整性、阻抗匹配和串?dāng)_等方面考慮了信號完整性問題,并基于IBIS(I/O Buffer Information Specification)模型進行了信號完整性分析及仿真。

    標(biāo)簽: FPGA 磁盤陣列 控制器

    上傳時間: 2013-04-24

    上傳用戶:jeffery

  • 基于FPGA的通用加擾算法(CSA)的設(shè)計和實現(xiàn).rar

    隨著數(shù)字視頻廣播的發(fā)展,觀眾將會面對越來越多綜合或?qū)iT頻道的選擇,欣賞到更高品質(zhì),更多服務(wù)的節(jié)目。而廣播業(yè)者則要為這些節(jié)目的版權(quán)購買,制作而承受更高的成本,單純的廣告收入已經(jīng)不夠。要求對用戶收取一定的收視費用,而另一方面,調(diào)查也顯示用戶是愿意預(yù)付一定費用以獲得更好服務(wù)的。條件接受系統(tǒng)(Conditional Access system)就是為了商業(yè)目的而對某些廣播服務(wù)實施接入控制,決定一個數(shù)字接受設(shè)備能否將特定的廣播節(jié)目展現(xiàn)給最終用戶的系統(tǒng)。CA技術(shù)要求既能使用戶自由選擇收看節(jié)目又能保護廣播業(yè)者的利益,確算只有已支付了或即將支付費用的用戶才能收看到所選的電視節(jié)目。在數(shù)字電視領(lǐng)域中,CA系統(tǒng)無疑將成為發(fā)展新服務(wù)的必需條件。但是在不同的運營商可能會使用不同的CA系統(tǒng),在不同的CA系統(tǒng)之間進行互操作所必需共同遵守的最基本條件是:通用的加擾算法。每個用戶接收設(shè)備中應(yīng)集成相應(yīng)的解擾模塊。在我國國家標(biāo)準(zhǔn)--數(shù)字電視條件接收系統(tǒng)GY/Z 175-2001的附錄H中有詳細的描述。 FPGA是英文Field Programmable Gate Array的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。可以說,F(xiàn)PGA芯片是小批量系統(tǒng)提高系統(tǒng)集成度、可靠性的最佳選擇之一。 首先本文簡要介紹CA系統(tǒng)的目的和組成,F(xiàn)PGA的結(jié)構(gòu)和原理,優(yōu)勢。然后介紹了利用FPGA來實現(xiàn)CA系統(tǒng)主要組成部分即加擾的原理和步驟,分析算法,劃分邏輯結(jié)構(gòu),軟件仿真,劃分硬件模塊,硬件性能分析,驗證平臺構(gòu)建,硬件實現(xiàn)等。 然后對以上各個部分做詳細的闡述。同時為了指導(dǎo)FPGA設(shè)計,給出了FPGA的結(jié)構(gòu)和原理與FPGA設(shè)計的基本原則、設(shè)計的基本技巧、設(shè)計的基本流程; 最后給出了該加擾系統(tǒng)的測試與驗證方法以及驗證和測試結(jié)果。

    標(biāo)簽: FPGA CSA 算法

    上傳時間: 2013-06-22

    上傳用戶:chongchong2016

  • 經(jīng)典的硬件工程師培訓(xùn)資料.rar

    經(jīng)典 的 硬件 工程師 培訓(xùn)資料

    標(biāo)簽: 硬件工程師 培訓(xùn)資料

    上傳時間: 2013-07-18

    上傳用戶:372825274

  • 超寬帶脈沖與MB-OFDM物理層的FPGA實現(xiàn)

    現(xiàn)代通信系統(tǒng)對帶寬和數(shù)據(jù)速率的要求越來越高,超寬帶(ultra-wideband,UWB)通信以其傳輸速率高、空間容量大、成本低、功耗低的優(yōu)點,成為解決企業(yè)、家庭、公共場所等高速因特網(wǎng)接入的需求與越來越擁擠的頻率資源分配之間的矛盾的技術(shù)手段。 論文主要圍繞兩方面展開分析:一是介紹用于UWB無載波脈沖調(diào)制及直接序列碼分多址調(diào)制(DS-CDMA)的新型脈沖,即Hermite正交脈沖,并且分析了這種構(gòu)建UWB多元通信和多用戶通信的系統(tǒng)性能。二是分析了UWB的多帶頻分復(fù)用物理層提案(MBOA)的調(diào)制技術(shù),并在FPGA上實現(xiàn)了調(diào)制模塊。正交Hermite脈沖集被提出用于UWB的M元雙正交調(diào)制系統(tǒng),獲得高數(shù)據(jù)速率。調(diào)整脈沖的脈寬因子和中心頻率能使脈沖滿足FCC的頻譜要求。M元雙正交調(diào)制的接收機需要M/2個相關(guān)器,遠比M元正交調(diào)制所需的相關(guān)器數(shù)量少。誤碼率一定時,維數(shù)M的增加可獲得高的比特率和低的信噪比。雖然高階的Hermite脈沖易受抖動時延的影響,但當(dāng)抖動時延范圍小于0.02ns時,其影響較為不明顯。本文認為1~8階的Hermite脈沖皆可用,可構(gòu)成16元雙正交系統(tǒng)。 正交Hermite脈沖集也可以構(gòu)造UWB多用戶系統(tǒng)。各用戶的信息用不同的Hermite脈沖同時傳輸,其多用戶的誤比特率上限低于高斯單脈沖構(gòu)成的PPM多用戶系統(tǒng)的誤比特率,所以其系統(tǒng)性能更優(yōu)。正交Hermite脈沖還可以用于UWB的DS-CDMA調(diào)制,在8個脈沖可用的情況下,最多可容64個用戶同時通信。 基于MBOA提出的UWB物理層協(xié)議,本文用Verilog硬件語言實現(xiàn)了調(diào)制與解調(diào)結(jié)構(gòu),并用Modelsim做了時序驗證。用Verilog編程實現(xiàn)的輸出數(shù)據(jù)與Matlab生成的UWB建模的輸出結(jié)果一致。為了達到UWBMB-OFDM系統(tǒng)的FFT處理器的要求,一個混和基多通道流水線的FFT算法結(jié)構(gòu)被提出。其有效的實現(xiàn)方法也被提出。這種結(jié)構(gòu)采用多通道以獲得高的數(shù)據(jù)吞吐量。此外,它用于存儲和復(fù)數(shù)乘法器的硬件損耗相比其他的FFT處理器是最少的。高基的FFT蝶算減少了復(fù)數(shù)乘法器的數(shù)量。在132MHz的工作頻率下,整個128點FFT變換在此結(jié)構(gòu)模式下只需要242.4ns,滿足了MBOA的要求。

    標(biāo)簽: MB-OFDM FPGA 超寬帶 脈沖

    上傳時間: 2013-07-29

    上傳用戶:TI初學(xué)者

  • 基于DSP/FPGA的多波形數(shù)字脈沖壓縮系統(tǒng)硬件的研究與實現(xiàn)

    現(xiàn)代雷達系統(tǒng)廣泛采用脈沖壓縮技術(shù),用以解決作用距離與分辨能力之間的矛盾。脈沖壓縮是指雷達通過發(fā)射寬脈沖,保證足夠的最大作用距離,而接收時,采用相應(yīng)的脈沖壓縮法獲得窄脈沖以提高距離分辨率的過程。同時,數(shù)字信號處理技術(shù)的迅猛發(fā)展和廣泛應(yīng)用,為雷達脈沖壓縮處理的數(shù)字化實現(xiàn)提供了可能。 本文主要研究雷達多波形頻域數(shù)字脈沖壓縮系統(tǒng)的硬件系統(tǒng)實現(xiàn)。在匹配濾波理論的指導(dǎo)下,成功研制了基于FPGAEP1K100QC208-1和4片高性能ADSP21160M的多波形頻域數(shù)字脈沖壓縮系統(tǒng)。該系統(tǒng)可處理時寬在42μs以內(nèi)、帶寬在5MHz以下的線性調(diào)頻信號(LFM),非線性調(diào)頻信號(NLFM)和Taylor四相碼信號,且技術(shù)指標(biāo)完全滿足實用系統(tǒng)的設(shè)計要求。 本文完成的主要工作和創(chuàng)新之處有:(1)基于雙通道模數(shù)轉(zhuǎn)換器AD10242設(shè)計高精度數(shù)據(jù)采集電路,為整個脈壓系統(tǒng)的工作提供必要的條件。完成了前端模擬信號輸入電路的優(yōu)化和差分輸入時鐘的產(chǎn)生,以實現(xiàn)高精度采樣。 (2)根據(jù)協(xié)議和脈壓系統(tǒng)的工作要求,以基于FPGAEP1K100QC208完成系統(tǒng)控制,使整個脈壓系統(tǒng)正確穩(wěn)定地工作。同時以該FPGA生成雙口RAM,實現(xiàn)數(shù)據(jù)暫存,以匹配采樣速率和脈壓系統(tǒng)頻率。 (3)設(shè)計基于4片高性能ADSP21160M的緊耦合并行處理系統(tǒng),以完成多波形頻域數(shù)字脈沖壓縮的全部運算工作。4片DSP共享外部總線,且各DSP以鏈路口互連,進行數(shù)據(jù)通信。各DSP還使用一個鏈路口連接到接口板DSP,將脈壓結(jié)果送出。 (4)以一片ADSP21160M和一片EP1K100QC208為核心,設(shè)計輸出板電路,完成數(shù)據(jù)對齊、求模和數(shù)據(jù)向下一級的輸出,并產(chǎn)生模擬輸出。 (5)調(diào)試并改進處理板和輸出板。

    標(biāo)簽: FPGA DSP 多波形 壓縮系統(tǒng)

    上傳時間: 2013-06-11

    上傳用戶:qq277541717

  • 基于FPGA的電路板光板測試機硬件設(shè)計與樣機研制

      本文提出一種基于PC104嵌入式工業(yè)控制計算機與現(xiàn)場可編程門陣列(FPGA)的PCB測試機的硬件控制系統(tǒng)設(shè)計方案。方案中設(shè)計高效高壓控制電路,實現(xiàn)測試電壓與測試電流的精確數(shù)字控制。選用雙高壓電子開關(guān)形式代替高壓模擬電子開關(guān),大幅度提高測試電壓。采用多電源方式在低控制電壓下實現(xiàn)對高壓電子開關(guān)的控制。設(shè)計高速信號處理電路對測試信號進行處理,從硬件上提高系統(tǒng)測試速度。  本設(shè)計中選用Altera公司的現(xiàn)場可編程器(FPGA)EP1K50,利用EDA設(shè)計工具Synplify、Modelsim、QuartusⅡ以及Verilog硬件描述語言完成了控制系統(tǒng)的硬件設(shè)計及調(diào)試,解決了由常規(guī)電路難以實現(xiàn)的問題。

    標(biāo)簽: FPGA 電路板 測試機 硬件設(shè)計

    上傳時間: 2013-06-04

    上傳用戶:lizhen9880

  • 紅外焦平面陣列非均勻校正算法研究及其FPGA硬件實現(xiàn)

      本文結(jié)合中國科技大學(xué)大規(guī)模集成電路實驗室和中國科學(xué)院上海技術(shù)物理研究所合作的星載紅外相機項目,為了解決紅外相機上的不同波段的紅外探測元陣列存在的非均勻性問題,對紅外焦平面探測元陣列存在的非均勻性問題展開了深入的分析和研究。 主要研究和分析了兩類算法的基本原理,重點研究和實現(xiàn)了定標(biāo)校正算法,通過對積分球定標(biāo)數(shù)據(jù)進行深入的分析,將探測元分成線性探測元和非線性探測元,對線性探測元采用兩點校正法,對非線性探測元采用多點分段校正算法,在利用FPGA硬件實現(xiàn)非均勻校正時,分析設(shè)計了基于乘法運算和加法運算的FPGA實現(xiàn),在基于乘加器運算的FPGA實現(xiàn)中。設(shè)計出了乘法和加法整體運算的乘加器,內(nèi)部采用流水線wallace樹壓縮結(jié)構(gòu),大大加快乘法和加法的速度。

    標(biāo)簽: FPGA 紅外焦平面 校正 算法研究

    上傳時間: 2013-04-24

    上傳用戶:weddps

  • 指紋識別算法的研究及基于FPGA的硬件實現(xiàn)

    隨著圖像處理和模式識別技術(shù)的進步,基于生物特征的識別技術(shù)成為蓬勃發(fā)展的高技術(shù)之一,根據(jù)IBG(InternationalBiometricGroup)組織對生物特征市場的統(tǒng)計和預(yù)測,該領(lǐng)域的收入的年增長率30-50%,到2008年,全球總收入將達到46.39億美元。而基于指紋特征的識別技術(shù)由于其獨特的可靠性,穩(wěn)定性,方便快捷的特點,恰好符合了市場的需求。目前指紋識別技術(shù)是生物識別領(lǐng)域中應(yīng)用最廣泛的識別技術(shù),也是研究與應(yīng)用的一個熱點。 SOPC片上可編程系統(tǒng)和嵌入式系統(tǒng)是當(dāng)前電子設(shè)計領(lǐng)域中最熱門的概念。NiosⅡ是Altera公司開發(fā)的一種采用流水線技術(shù)、單指令流的RISC嵌入式處理器軟核,可以將它嵌入FPGA內(nèi)部,與用戶自定義邏輯結(jié)合構(gòu)成一個基于FPGA的片上系統(tǒng)。與嵌入式硬核相比較,嵌入式軟核具有更大的靈活性。而FPGA的高速性、恰恰滿足了指紋識別系統(tǒng)對速度的要求。 本文對指紋識別技術(shù)中各個環(huán)節(jié)的算法進行了較為深入的研究,結(jié)合NiosⅡ嵌入式處理器的特點,對算法進行了合理的選擇與優(yōu)化,形成了一套完整的指紋識別算法,并提出了一種基于FPGA的指紋識別系統(tǒng)硬件設(shè)計方案。 論文的內(nèi)容主要包括以下幾個方面: 1、對指紋圖像預(yù)處理、后處理和匹配算法進行了改進,提高了算法的性能;設(shè)計了一種適用于快速匹配的指紋特征數(shù)據(jù)結(jié)構(gòu);提出了一套基于特征點匹配的指紋識別算法。實驗結(jié)果表明該算法速度快、誤識率較低、可靠性較高,可以滿足實用的要求。 2、本著增加系統(tǒng)集成度、減小系統(tǒng)體積、提高便攜性、降低功耗和成本,同時提升系統(tǒng)的性能的原則,使用Altera公司提供的外圍設(shè)備IP核配合NiosⅡ處理器軟核搭建了一個單片嵌入式系統(tǒng),然后以內(nèi)嵌NiosⅡ軟核的FPGA和FPS200指紋采集器為核心芯片,外配片外RAM和Flash存儲器以及小鍵盤和LCD顯示屏等器件,設(shè)計了一個便攜式指紋識別系統(tǒng),提出了一套基于FPGA的硬件設(shè)計方案。 3、利用NiosⅡ開發(fā)板對硬件設(shè)計方案進行了初步的驗證,實現(xiàn)了指紋采集芯片F(xiàn)PS200與FPGA的接口,并進行了算法的移植。 實驗結(jié)果表明本文所提出的系統(tǒng)設(shè)計方案是可行的。基于FPGA的自動指紋識別系統(tǒng)在速度、功耗、體積、擴展性方面有著獨特的優(yōu)勢,具有廣闊的發(fā)展空間。最后提出了對這一設(shè)計繼續(xù)改進的思路和下一步研究的內(nèi)容。

    標(biāo)簽: FPGA 指紋識別 法的研究 硬件實現(xiàn)

    上傳時間: 2013-06-07

    上傳用戶:kikye

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