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設(shè)計實(shí)驗

Delphi中工作列狀態(tài)區(qū)的設計參考文件資料

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TC&MSC高階函式庫設計技術, 如何在DOS下作出圖形介面的程式, 備有豐富的程式庫.

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這一篇論文的標題為「適應性BIC-MIMO-OFDM系統(tǒng)的性能分析和接收器設計」是2007發(fā)表的

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需要工具： 1. Python 2.3 以上 2. BOA Constructor Python設定檔介面程式設計這段程式碼主要是把資料儲存到config.txt這個檔案中

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將Verilog設計轉成VHDL設計的程式

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將VHDL設計轉換成Verilog設計的程式

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JPEG的硬體設計採用的是VHDL設計,有源碼

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使用FPGA設計WiMax接收機之OFDM同步硬體電路(內附VHDL code)

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一個簡單的游戲設計...好好玩的

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倒數(shù)計時器提供時間到關機的功能可自由設定是否關機或者提供警示

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