陣列信號處理是當前信號處理的熱門方向，為信號處理帶來極大的方便，陣列信號處理中的各通道不一致問題將會給陣列信號處理帶來影響，很多文獻中介紹過關于自適應幅相誤差校正的理論及方法，但實現起來都比較耗費資源和時間，且效果有待實踐驗證。提出一種工程上可實現且計算量較小的通道校正方法-查表法。通過仿真，結果表明此方法可以對特定來向的有用信號進行較為準確的校正。
標簽： 陣列天線 幅相誤差 校正
上傳時間： 2014-01-12
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!!研究了一種新型高功率微波相移器%%%同軸插板式相移器!其設計思想為&在同軸波導內插入金屬導體板!將同軸波導分為幾個扇形截面波導!由于扇形截面波導中傳輸的82!!模相速度與同軸82; 模的相速度不同!通過改變插入金屬板的長度就可以實現相移的調節.
標簽： 高功率 相移器
上傳時間： 2013-10-29
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單相逆變器光伏仿真程序
標簽： 單相逆變器 光伏 仿真程序
上傳時間： 2013-11-20
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編碼器倍頻、鑒相電路在FPGA中的實現
標簽： FPGA 編碼器 倍頻 中的實現
上傳時間： 2013-10-27
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文章詳細介紹了一種以Xilinx 公司生產的CPLD 器件XC9536 為核心來產生電機繞組參考電流, 進而實現具有繞組電流補償功能的兩相混合式步進電動機10 細分和50 細分運行方式的方法。實踐證明, 該方法可以有效地提高兩相混合式步進電動機系統的運行效果。
標簽： CPLD 器件 中的應用 步進電動
上傳時間： 2013-11-16
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數字三相鎖相環中含有大量乘法運算和三角函數運算，占用大量的硬件邏輯資源。為此，提出一種數字三相鎖相環的優化實現方案，利用乘法模塊復用和CORDIC算法實現三角函數運算，并用Verilog HDL硬件描述語言對優化前后的算法進行了編碼實現。仿真和實驗結果表明，優化后的數字三相鎖相環大大節省了FPGA的資源，并能快速、準確地鎖定相位，具有良好的性能。
標簽： FPGA 數字 三相 優化設計
上傳時間： 2013-10-22
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介紹了應用VHDL技術設計嵌入式全數字鎖相環路的方法。詳細描述了其工作原理和設計思想，并用可編程邏輯器件FPGA加以實面。
標簽： FPGA 全數字 鎖相環路
上傳時間： 2013-10-20
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DSP 實現軟件鎖相環
標簽： F2812 2812 320F TMS
上傳時間： 2013-11-05
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軟件鎖相環設計相關資料料
標簽： 軟件鎖相環
上傳時間： 2015-01-02
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鎖相環設計相關資料
標簽： 4046 PWM CD 頻率跟蹤
上傳時間： 2013-11-08
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