本設計以AT89C52為核心,充分利用AT89C52的三個定時/計時器,采用測量N個周期信號波形的算法.實現了頻率,周期高精度的測量.
標簽： 89C C52 AT 89
上傳時間： 2015-09-24
上傳用戶：上善若水
可批次轉換TIFF(包含TFW)或JPG(包含JGW)格式影像成ECW格式,方便大量壓縮及轉換GIS圖形格式
標簽： TIFF TFW JPG JGW
上傳時間： 2014-06-28
上傳用戶：fredguo
基于決策樹的n則交叉驗證分類器 （決策樹程序直接調用matlab中的） crossvalidate.m N則交叉驗證程序，N可選 NDT.mat 含9個國際公認標準數據集，已做過標么處理，可直接使用 專業
標簽： crossvalidate matlab 決策樹 交叉驗證
上傳時間： 2013-12-29
上傳用戶：784533221
以wxWidget撰寫的簡繁體中文轉換程式 已在Linux上編譯過
標簽： wxWidget Linux 程式
上傳時間： 2014-05-28
上傳用戶：sunjet
陽曆與陰曆換算 很好用的陰曆與陰曆互相轉換的Pascal程式庫
標簽： Pascal 程式
上傳時間： 2013-12-24
上傳用戶：hfmm633
本文件是LED燈閃碩實驗程序；LED燈每隔1秒亮1秒 將跳線器JP4短接 使用外22.1184MHz晶振.
標簽： LED 22.1184 JP4 MHz
上傳時間： 2013-12-02
上傳用戶：hasan2015
sin產生器，可以於VHDL產生sin之數值波形，進而輸出至dac做轉換
標簽： sin
上傳時間： 2013-12-25
上傳用戶：小儒尼尼奧
將VHDL設計轉換成Verilog設計的程式
標簽： Verilog VHDL 程式
上傳時間： 2016-01-18
上傳用戶：wkchong
DPLL由 鑒相器 模K加減計數器 脈沖加減電路 同步建立偵察電路 模N分頻器 構成. 整個系統的中心頻率(即signal_in和signal_out的碼速率的2倍) 為clk/8/N. 模K加減計數器的K值決定DPLL的精度和同步建立時間,K越大,則同步建立時間長,同步精度高.反之則短,低.
標簽： signal_out signal_in DPLL 模
上傳時間： 2013-12-26
上傳用戶：希醬大魔王
sigma-delta ADC轉換之matlab模型，整個系統都可模擬。
標簽： sigma-delta matlab ADC 模型
上傳時間： 2014-01-24
上傳用戶：xjz632
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